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systemVerilog_3.1a Language Reference Manual 1人参与	lvsy 2014-2-11 15:58	1 674	relchhiclty 2019-3-12 11:01
AD转换中的主要概念 1人参与	A-Lin 2019-3-12 10:09	1 344	Demyar 2019-3-12 11:01
I2C总线简介 1人参与	House 2019-3-12 10:19	1 475	gaoxings 2019-3-12 11:00
xilinx各个工具总结 1人参与	Taio 2019-3-12 07:00	1 249	fanichicl 2019-3-12 10:58
I2C协议 1人参与	House 2019-3-12 10:18	1 560	kinidrily 2019-3-12 10:57
AD转换认识 1人参与	House 2019-3-12 07:00	1 328	yxlk 2019-3-12 10:56
关于AD转换设计的一些经验总结 1人参与	A-Lin 2019-3-12 10:09	1 303	relchhiclty 2019-3-12 10:56
电话计费器的Verilog实现 6人参与 ...2	zzfd97 2009-3-13 22:05	15 3181	Demyar 2019-3-12 10:55
VHDL引用库 1人参与	Taio 2019-3-12 10:15	1 350	gaoxings 2019-3-12 10:55
I2C与串行端口、SPI对比 1人参与	House 2019-3-12 10:18	1 570	helendcany 2019-3-12 10:53
锁存器、触发器和寄存器 1人参与	Zedd 2019-3-12 10:26	1 497	fanichicl 2019-3-12 10:52
DSP + FPGA的信号处理实验系统研制 6人参与	House 2018-9-14 11:35	6 370	缘分五月lck 2019-3-11 17:05
关于这段代码，请大神指点一下，实在搞不清楚 1人参与	cj223356 2019-3-11 16:27	1 302	relchhiclty 2019-3-11 16:47
Xilinx.ISE.Design.Suite.v14.1.ISO-TBE 下载链接 5人参与	wkjatzju 2015-2-15 11:10	4 978	gaoxings 2019-3-11 16:47
请教大神，modelsim无法建立project 怎么办？ 1人参与	Mhza 2019-3-11 16:29	1 817	helendcany 2019-3-11 16:46
VHDL操作符 1人参与	Ferrya 2019-3-10 08:00	1 420	Demyar 2019-3-11 15:11
PLD、PLA、PAL、GAL的简单介绍与区别 1人参与	Zedd 2019-3-11 11:07	1 4718	gaoxings 2019-3-11 15:11
通俗讲解单片机、ARM、MUC、DSP、FPGA、嵌入式错综复杂的关系！ 1人参与	Ferrya 2019-3-11 10:44	1 427	wu68aq 2019-3-11 15:11
VHDL流水灯设计 1人参与	Taio 2019-3-11 11:30	1 471	helendcany 2019-3-11 15:10
verilog中的可综合与不可综合 1人参与	Ferrya 2019-3-10 19:00	1 343	fanichicl 2019-3-11 15:10
VHDL入门学习-程序组成 1人参与	House 2019-3-11 10:35	1 281	relchhiclty 2019-3-11 15:08
FPGA内部RAM有什么用? 1人参与	Zedd 2019-3-11 10:37	1 452	Demyar 2019-3-11 15:08
Verilog代码优化之case语句 1人参与	A-Lin 2019-3-11 11:01	1 681	wu68aq 2019-3-11 15:07
通信接口——编解码 1人参与	Diabloa 2019-3-11 11:10	1 354	helendcany 2019-3-11 15:07
FPGA 在图象处理中的应用 1人参与	Ferrya 2019-3-11 13:26	1 403	fanichicl 2019-3-11 15:06