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伪随机数发生器的FPGA实现与研究 1人参与	A-Lin 2019-3-8 11:30	1 259	relchhiclty 2019-3-8 13:30
FIR_filters_设计 1人参与	Allevi 2019-3-8 11:26	1 338	Demyar 2019-3-8 13:30
关于锁相环（PLL）必须要知道的事 1人参与	House 2019-3-8 11:55	1 399	wu68aq 2019-3-8 13:29
计算机系统结构：量化研究方法 1人参与	A-Lin 2019-3-8 11:33	1 375	helendcany 2019-3-8 13:29
verilog 基础语法-端口 1人参与	Taio 2019-3-8 11:42	1 384	fanichicl 2019-3-8 13:29
verilog 编写testbench教程（Lattice公司出品） 28人参与 ...2 3	lemio 2008-9-27 18:28	31 7147	kinidrily 2019-3-8 13:28
并行快速FIR滤波器的FPGA实现 1人参与	Ferrya 2019-3-8 09:00	1 232	yxlk 2019-3-8 13:28
什么是VHDL语言,有什么用? 1人参与	House 2019-3-8 11:48	1 376	relchhiclty 2019-3-8 13:28
VHDL中常用函数类型转换程序包 1人参与	Allevi 2019-3-8 11:05	1 387	Demyar 2019-3-8 13:27
玩不转JTAG接口，就别想炼就为嵌入式开发大神 3人参与	姗姗的shanshan 2018-9-7 10:03	3 284	gaoxings 2019-3-8 13:27
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VHDL入门学习-程序组成 1人参与	House 2019-3-8 11:49	1 338	fanichicl 2019-3-8 13:26
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FPGA编程，为什么要走命令行而不是图形路线？ 1人参与	Mhza 2019-3-7 14:08	1 374	wu68aq 2019-3-7 17:50
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静态时序分析（Static Timing Analysis）基础与应用 1人参与	Allevi 2019-3-7 10:33	1 403	Demyar 2019-3-7 17:46
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混沌跳频序列发生器的FPGA实现 1人参与	Taio 2019-3-7 10:42	1 351	wu68aq 2019-3-7 17:46
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请教大神们，FPGA的时钟频率提高后，会对资源占用有影响吗？提高时钟频率后，需要... 1人参与	cj223356 2019-3-7 14:07	1 367	yxlk 2019-3-7 17:44
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高吞吐量低存储量的LDPC码译码器FPGA实现 1人参与	Taio 2019-3-7 10:44	1 332	wu68aq 2019-3-7 17:41