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楼主: jimmy
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★★★ 大家一起学PADS (一)★★★......【有问必答贴】

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661#
发表于 2011-11-14 19:50 | 只看该作者
你好,群主,我是刚用ORCAD画原理图,有个问题请教一下,我用ORCAD画完原理图后,导出表络表,在PADS LAYOUT中导入,导过来是没有任何出错报告,但是我发现有一些元件的一端没有连网络,我检查过原理图,连接是没有问题的,请问这是什么原因造成呢???

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原理图连接存在问题.PCB只是网表导进来后的体现.原理图和网表是怎么样的,导进来的PCB就是怎么样的.  发表于 2011-11-15 11:00

该用户从未签到

662#
发表于 2011-11-14 21:47 | 只看该作者
请问楼主,PADS做的PCB资料,现在要求导入到CR5000软件中(给日本客户),要怎么样转?

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CR5000可导入pads的asc文件.  发表于 2011-11-15 11:00

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663#
发表于 2011-11-15 19:19 | 只看该作者
jing 发表于 2011-11-9 15:12
  S& X- f; i; U" S楼主好厉害啊$ h) e8 C) ]8 h; b6 M
0 s9 C6 V& m% R4 {. k9 p+ T' Q# q
我想请问下   pads5.0 中PCB的pdf产看文件 怎么导出来啊
) ]% C/ L& \; @" O
{:soso_e100:} 谢谢楼主。。。。

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664#
发表于 2011-11-15 19:28 | 只看该作者
群主   帮我加下群啊    214676624   谢谢啦{:soso_e181:}

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665#
发表于 2011-11-15 19:40 | 只看该作者
大家好    我想请教下  pads layout 中如何用铜箔  写字呢   {:soso_e132:}    我修改别人的一块板子  pcb版本  日期 等等都是铜箔 ,我自己用copper写的时候   写的可难看了

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你想写什么字?可以放置text在top层.出光绘时记得选上.  发表于 2011-11-16 17:51

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666#
发表于 2011-11-16 00:48 | 只看该作者
请问楼主:
9 V; Z! q% H) ?4 U0 y: KECO TO PCB时提示错误:Dangling Connections without a Net Name
; |3 j& n8 i4 l# x" F0 j: C9 X% L' y
_WR
1 U) [4 L' n2 f% j  RCPU          X2500  Y4600
! w, ]" Z4 ~1 {* ^! ~  u# |
% V# _8 Z7 r+ u( M+ ]" GDangling Connections with a Net Name
$ L9 g5 M* Z) [" E) W% V6 w6 e$ q3 I4 h  ?" q" c: r
_CS_RAM* O9 G/ P( N7 Y, Z3 M! N
CPU          X6000  Y2200 " |, ^* S2 R1 [% }, o% g
CPU          X9000  Y3100
  C7 d6 V, k4 _; W; I, HCPU          X9400  Y5300 9 f% ^3 }' [* w" }

' p; d, E( [) X4 N# L% m是不是这两种错误不会影响网络连接?即对PCB不会有影响?

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不会影响.可以改一下网络名,以防万一  发表于 2011-11-16 17:51

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667#
发表于 2011-11-16 17:59 | 只看该作者
loveineda 发表于 2008-10-10 13:18 6 F7 Z& E4 }5 [6 i
初次使用PADS,出现如图中央的问题,左边的电容和右边FPGA不能正常连接!# B6 k- x8 N1 ~( L7 ~: P1 ]
可能是我的走线比FPGA的管脚要粗 ...

. O# L3 f: F: R! \! A& [& S+ v/ T走线是粗了!导致安全间距不符合!所以开DRP是连不上的!关掉可以!但是最好改细点!如果是滤波的,你可以从IC引进出来细点,然后加粗! ) f. U/ Y0 x$ Q+ |

& o7 Z, S. {! J# K! w

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668#
发表于 2011-11-16 20:37 | 只看该作者
本帖最后由 jimmy 于 2011-11-17 10:19 编辑
" q+ {) x7 L4 M5 a7 r4 t3 J" O1 `) [$ M/ [; @' H9 w2 {0 |
一般那些网络需要包地,那些线要等长,数据线是否都有要求四线带1 地,' m) e+ i$ u$ N3 n+ y
这方面是否有详细的理论解释?
9 A: v3 r4 _% X5 H  Y如果需要包地,应注意那些事情,比如地线线宽是否有要求等
8 M+ i) H' i) G# \5 s
8 e. @3 n8 S/ ^  r1 _jimmy回复:
- U1 k8 d: t; a& Q- j  z% W' X4 Q6 y: F" D
1,时钟线,高速信号线,差分线,模拟线有空间的情况下需要包地.
! |; }1 d; _* o8 e* j, a. e9 t# c' ?# Y: [5 a$ j
2,有时序要求的线都要等长,如存储器的数据线,地址线,还有其他的并行总线.; H5 Z) O1 P+ R% p
5 |9 c. ^6 \5 ^. n. r  Q

3 {4 W& X5 H% I4 b# @. p2 T. K: j, {" S, E; l
另外,你指的数据线要求四线带1地是什么意思?) n7 O$ ~% ~, d

. V* E4 v6 y) F" R, T4 {1 ~3,如果需要包地,包地线的线宽最好在注意包地线离被包线的间距最好做到20mil或3w以上,然后包地线上要按一定的间距(100~200mil)打地过孔,以达到立体包地的效果.如果没有办法做到立体包地,还不如不包.只需要将线与线之间的间距拉开至少3w就可以.
$ U( _; Z6 M+ W: f& H) k! |
+ O8 l; M+ E5 o5 j: T" Y) `
. N5 V6 M  x4 t* H# P

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669#
发表于 2011-11-16 20:57 | 只看该作者
我做了一个封装,网络表显示有连接,但是一导入pads后,发现电源脚没有任何线连接上去,这个是怎么回事情?难道封装的原因?

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无图无真相.  发表于 2011-11-17 10:22

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670#
发表于 2011-11-17 09:22 | 只看该作者
jing 发表于 2011-11-15 19:40 ; e+ i/ G6 |, C2 q% |& P
大家好    我想请教下  pads layout 中如何用铜箔  写字呢       我修改别人的一块板子  pcb版 ...
+ I. w, [2 P8 O* b# N% _4 F
[attach]46133    不知道这个附件你能看到不    就是铺垌上的字的笔画部分是镂空的   
/ h! s1 Q" E0 j; ~5 U% F' L, c+ y) e) f& [; q' n/ E
6 U% L- A  _, |2 u) l
- i! x: U2 T" B7 ]2 V/ b; c3 q6 t* `
顺便再问下   在布局中   创建族  有多大的意义呢        辛苦你了    谢谢啊               {:soso_e160:}

铜箔字.doc

46.5 KB, 下载次数: 37, 下载积分: 威望 -5

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打开后显示乱码/  发表于 2011-11-17 10:22

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671#
发表于 2011-11-17 13:35 | 只看该作者
jing 发表于 2011-11-17 09:22
! x) y) K1 i: t/ Z) v[attach]46133    不知道这个附件你能看到不    就是铺垌上的字的笔画部分是镂空的   
4 t5 X1 H; E  d) w) L$ K
我是新手学画PCB呢    今天在书上看到簇   练了一上午   没觉得多大的用处   你能指导我一下学习的方向吗? {:soso_e100:}   

点评

簇没什么实际的用处.书上的只是详细给你介绍一下菜单的使用,无任何实际的指导价值.多向身边的PCB设计师交流和沟通.  发表于 2011-11-21 11:10

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672#
发表于 2011-11-17 19:03 | 只看该作者
求助楼主:router中set width如何自动出现上次设定值?6 L# y5 k! B# X" B0 Z# y
打开pads router,拉线,键入W,出现线宽设置小窗口,在"set width"后面输入线宽值,比如“5”,回车,则当前的线宽被设置成“5”。
( U3 T5 x. w) M/ n  _: |8 H 再次键入W,则"set width"后面自动出现上次输入的值“5”,不必手动再输入一次,直接回车即可,省了不少麻烦。
) }/ G( w. h# n3 S 悲剧的是,有时候键入W,它不出现最近输入的线宽值,而是一片空白,像软件刚打开时一样。. O1 u5 |% F/ m3 _- S/ n
更悲剧的是,我在另一电脑上,新装pads9.3,从来就不出现最近输入的线宽值。老版本在这个电脑上现象相同。
" Z( _! P$ E3 p8 M请问这个现象如何解决?; h& P# E6 k/ P3 y; D, g
多谢!

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没用过此功能.  发表于 2011-11-21 11:13

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673#
发表于 2011-11-17 21:09 | 只看该作者
gui_qu 发表于 2011-11-16 20:37 : x" ]- |0 g# D. B" x+ B
一般那些网络需要包地,那些线要等长,数据线是否都有要求四线带1 地,- F6 P7 D7 I" p. y5 ?% Q
这方面是否有详细的理论解释?* M4 B2 |4 @' o: \
如果需 ...
2 M* e- t) g2 `' e8 z! w6 I% q& ^
非常谢谢jimmy回复,, v' `% ^) }% z) r% c0 K, w

0 U/ I0 T7 \2 ]# ^/ j2 r6 d3 a- \% L/ P/ ~) h6 B8 r  w& Y7 P

) c! y8 V2 Z# R& _另还有些疑问.请教.
+ @& \2 |6 K$ D8 e  m# x/ U# E1.包地原因,主要针对易受干拢的信号 ,还是针对易产生干拢的信号?或都是两种信号都要进入包地?- b+ M. Z8 s3 X* _0 {: u4 G
2.等长知道是时序要求才做的,但对那些线有时序要求,有时分不清,- D2 D* t; d$ U2 D" l" o/ o
如DDR的数据线与控制线是否要求等长?8 w' @' {6 ~9 T4 t, x
地址线与数据线是否要求等长?
# ^; Q  j% @: w6 o  N或者是只要求成组的数据线等长?" q- P* Y( c8 y. n
又或者只要求数据结的高8位等长,再低8位等长,高位与低位不等长?,
- w. S  T0 i8 ]; f! b, b2 c
' o, p+ p8 W) t3 o- Z另还有一重要问题,
$ h. O7 j2 c0 R5 m- C5 Q通俗的说多少M频率的数据信号有时序要求,如是400M,800,还是1G.?
9 ~7 g0 H% N  b1 T- ?6 d" \9 Q" k$ i5 _5 U# y3 T7 I+ y1 C
一个实际的问题,如DDR数据线,最长的那根线有800MILS,但大多数线在400以内可以走通,* S" U2 l  `. m2 X
如果频率是800M,这个时候,走等长好还是不走等长好?
1 |  ]$ L6 @4 D9 W% O. R! i5 l) j' g; M2 g
另对于双DDR,或多DDR,如何等长?) m4 A5 l6 `1 S" V- X

' ^5 {& E8 n) N) |* d0 Z3.以前经常有听到较多数据线时,如16根时,5 z: P7 H1 [7 m
走4根线时要走一根地线,不要16根同时走,不知道是否正确,不知道具体是如何要求的?
6 E- X! |) U! i( j# i5 s( S& n0 a# q1 {1 A) ?& O) f( V

2 u/ O- ^8 _' x7 M3 j6 j* ~0 z3 ]! W2 N' M& R% ]

6 }  X6 ~4 X4 `- a" V5 l

点评

1,有空间就包吧. 2,分不清有空间的话就全部作等长. 3,双DDR或多DDR,走星形或菊花链拓扑进行等长. 4,可以16根一起走.不能一起走的话,可能这16根里面有发送和接收,所以要将发送和接收分开. 如果有具体的原理图才行  发表于 2011-11-21 11:15
貌似这些都是原理的问题,不是pads技术的问题了  发表于 2011-11-18 11:22

该用户从未签到

674#
发表于 2011-11-17 21:11 | 只看该作者
gui_qu 发表于 2011-11-17 21:09
, z) @5 f5 Q5 V/ @, ?非常谢谢jimmy回复,
6 z; X$ I; K8 c5 n; ?( C  I4 L
再次麻烦,有些不好意思,; P5 K6 G) _7 f2 l
但还是..........................., y, B' v; `3 L, }
非常感谢.

该用户从未签到

675#
发表于 2011-11-17 23:14 | 只看该作者
Jimmy 大哥:! ^. D) E' n' D  ?, [
     你好,上次有看过你写的一篇关于《PADS Router 如何设置快捷打孔》的文章,
& z0 y5 @2 F, W; M, f我也照着你的MCR文件 改成2层板的,在Router里是可以实现双击鼠键打孔,
, O4 _. I8 Y& i$ I8 N不过,现在碰到一个问题,想请教下你:
4 c0 Y4 C( H5 J' o    我按数字键1,孔类型改为“Current Via Type is set to Via1”  ,打的孔也是Via1的孔;
1 g: K3 o: V& s: \6 s& n( d5 L我再按数字键2,孔类型改为“Current Via Type is set to Via2” ,打的孔却是Via1的属性的孔
; [( u4 f) l1 R' y不是我要求的,除非改下面的地方才能打Via2的孔 “Design Properties\Via Biasing”只保留Via2的勾 才行(开始下面这里全是勾上的)。
7 N/ H9 j2 \* q& ?+ K& i         # S( Z1 q* m0 d

2 X/ n5 {9 r6 Y! P& |5 \" c9 P& F呵呵 说得有点哆嗦了,麻烦解答下,谢谢了!{:soso_e100:} (附上MCR文件) , r5 N6 R  w1 @

2层板实现快速打孔的问题.rar

58.69 KB, 下载次数: 20, 下载积分: 威望 -5

点评

同时双面板不需要设置为埋盲孔.  发表于 2011-11-21 11:16
你设置了钻孔层对了吗?  发表于 2011-11-21 11:12
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