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FPGA ------- （十三）modelsim自动化仿真环境 3人参与	mytomorrow 2019-7-10 16:14	3 353	xixihahaheihei 2019-7-11 18:06
怎样在diamond中手动安装lattice fpga的本地离线IP包? 1人参与	Touuqu 2019-7-11 16:00	1 354	yxlk 2019-7-11 18:05
FPGA中SPI复用配置的编程方法 1人参与	Taio 2019-7-11 13:34	1 290	abcde1234 2019-7-11 18:03
FPGA的最小系统 1人参与	pulbieup 2019-7-11 15:10	1 267	fanichicl 2019-7-11 18:02
基于FPGA的全数字锁相环设计 6人参与	whipple 2009-7-13 09:59	7 1403	xuzwg 2019-7-11 18:01
双端口RAM的设计（同步读写）之FPGA 1人参与	ulppknot 2019-7-11 16:35	1 291	xuzwg 2019-7-11 18:00
FPGA很难学？？？因为没总结出数电的尽头是模电！ 2人参与	mytomorrow 2019-7-11 14:46	2 503	junfeng.nie 2019-7-11 17:30
想买一款FPGA开发板，麻烦大神们给推荐一下，感谢！ 1人参与	Mhza 2019-7-11 10:50	1 170	fanichicl 2019-7-11 17:13
zynq IC上的框架是FPGA(PL)+2 arm(PS)，那么在PL端设计了中断，怎么在PS端产生中... 1人参与	cj223356 2019-7-11 10:56	1 268	fanichicl 2019-7-11 17:11
如何在ISE开发环境下对信号进行希尔伯特（hilbert）变换？ 1人参与	qpggup 2019-7-10 15:43	1 272	xixihahaheihei 2019-7-10 17:56
Xilinx zynq系列FPGA中相关资源----实现神经网络 2人参与	mytomorrow 2019-5-14 18:58	2 373	dqwuf2008 2019-7-10 17:55
大家有人研究nios ii内核程序的吗？能帮我一下下吗？ 1人参与	uelophim 2019-7-10 15:46	1 178	relchhiclty 2019-7-10 17:54
FPGA vhdl语言 process for loop循环？？？ 1人参与	beachsun 2019-7-10 15:47	1 347	yxlk 2019-7-10 17:54
Verilog典型电路设计_华为 10人参与	wangsuiyun2010 2012-9-6 10:59	11 1342	xixihahaheihei 2019-7-10 17:52
绘制原理图时放置FPGA芯片后显示的引脚个数和参考手册上面显示的个数差别很大？？ 1人参与	uerriup 2019-7-10 15:49	1 268	lrq 2019-7-10 17:52
同步FIFO的设计之FPGA 1人参与	ulppknot 2019-7-10 12:35	1 194	relchhiclty 2019-7-10 17:50
NiosⅡ的红外图像实时跟踪系统设计 2人参与	A-Lin 2019-7-9 08:39	2 197	kinidrily 2019-7-10 17:49
FPGA的指导性原则 1人参与	A-Lin 2019-7-10 08:45	1 305	relchhiclty 2019-7-10 17:48
FPGA ------- SRIO IP核的三层协议的作用？ 3人参与	thinkfunny 2019-7-9 16:08	3 252	yxlk 2019-7-10 17:47
AD采样80MHz,中频信号60MHz，在数字下变频时NCO输出频率设置为多少？ 1人参与	Mhza 2019-7-10 10:06	1 218	wu68aq 2019-7-10 17:18
FPGA ------- 学习（九）SPI协议通信 3人参与	mytomorrow 2019-7-9 11:28	3 324	fanichicl 2019-7-10 17:17
Tco探秘 1人参与	House 2019-7-10 07:30	1 147	fanichicl 2019-7-10 17:16
Tsu_Tco约束方法 1人参与	House 2019-7-10 07:00	1 137	wu68aq 2019-7-10 17:15
verilog 教程，想学的进来看看 1人参与	duanjian_205 2018-4-9 22:12	1 277	fanichicl 2019-7-10 17:15
FPGA ------- SRIO IP核系统总览以及端口介绍（三）（Messaging Port、User-Define... 1人参与	pulbieup 2019-7-10 13:45	1 325	ygcgsa 2019-7-10 17:13