信号完整性SI/PI仿真今日: 0|主题: 11926|排名: 34

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[Cadence Sigrity] 使用sigrity做PI&SI仿真的资料 23人参与 ...2	小猪佩奇AAA 2020-1-13 20:03	23 1692	shacom 2022-2-28 11:10
[仿真讨论] 小公司是否需要专人来做信号信号完整性？ 4人参与	wisuhuu 2020-1-13 10:02	4 586	kkk228 2020-2-18 19:35
[仿真讨论] PCB走线中途容性负载反射 1人参与	dark 2020-1-13 09:46	1 389	沈不清 2020-1-13 10:19
[ADS仿真] ADS PCB仿真加载allegro brd文件OK,里面还是空白的？ 4人参与	hyxs714154 2020-1-12 19:20	4 969	kkk228 2020-2-18 19:48
[ADS仿真] ADS能建一个10L以上的VIA模型，还是只能使用模板里面的？ 3人参与	hyxs714154 2020-1-12 18:50	7 929	Dc2023061230a 2023-6-19 15:22
[HyperLynx] HyperLynx 导入没有电源平面 4人参与	tyb0220 2020-1-11 17:12	4 896	xingnuolgsx 2020-4-26 10:08
[ADS仿真] ADS并联端接时上拉电源怎么添加 2人参与	hyxs714154 2020-1-10 19:38	2 886	hyxs714154 2020-1-12 18:53
[ADS仿真] 咨询ADS 第四章短桩线的反射问题点 5人参与	hyxs714154 2020-1-10 18:32	5 1713	胖葱丶 2022-9-7 20:57
[Hspice仿真] 请教如何提高HSPICE的仿真速度	ajingge 2020-1-10 18:09	0 739	ajingge 2020-1-10 18:09
Ads仿qsfp+差分缺一个s5gx_ami_tx.ibs模型 4人参与	Cbwft199636 2020-1-10 14:07	8 469	lc1234 2025-6-19 19:48
[Cadence Sigrity] OPI里面计算电容的回路电感包含电容本身的寄生电感了嘛？ 1人参与	hyxs714154 2020-1-10 11:54	1 593	3THEYE 2020-4-23 00:37
[仿真讨论] PCB设计需要做信号完整性分析吗？ 3人参与	weqsss 2020-1-10 08:25	3 474	yuan_2020 2020-1-11 09:15
[仿真讨论] 速率不高的PCB需要考虑信号完整性吗？ 2人参与	embnn 2020-1-9 10:06	2 507	JovenNi 2020-1-9 19:48
[Cadence Sigrity] 打开SigXplorer 中组件用不了 5人参与	fang05081248 2020-1-8 22:46	6 1270	lmlan 2025-2-4 21:46
[ADS仿真] ADS 2019版本，RFpro和PI SI均无法使用 1人参与	duwei 2020-1-8 17:01	1 980	dzkcool 2020-1-9 10:39
[Cadence Sigrity] Sigrity种加上电容的寄生参数讨论 4人参与	hyxs714154 2020-1-8 14:50	8 757	3THEYE 2020-4-23 00:36
跪求用sigrity仿真ddr的相关文档 3人参与	changjinling 2020-1-8 11:49	4 463	changjinling 2020-1-9 11:33
[仿真讨论] 为什么要重视系统化信号完整性设计方法 2人参与	ededewa 2020-1-8 09:57	2 406	天涯678 2020-1-8 11:54
[Ansys仿真] Siwave仿真点不到下面的按钮，分辨率调低也不行 4人参与	hyxs714154 2020-1-7 21:58	6 681	hyxs714154 2020-1-11 12:42
[仿真讨论] 新版ansys转化pcb成hfss模型 3人参与	womi1010 2020-1-7 16:44	4 633	womi1010 2020-1-8 09:54
[仿真讨论] 有关接收端容性负载的反射 1人参与	SSWASD 2020-1-7 09:46	1 572	fawa 2020-1-7 17:57
[Cadence Sigrity] Allegro16.5 中进行SI 仿真 5人参与	mars_yang 2020-1-7 09:11	5 788	HSH125 2020-2-15 23:56
[Cadence Sigrity] cadence 17.2 allegro怎么才能有ansys插件，转brd文件到Siwave中，教程allegro带an... 4人参与	hyxs714154 2020-1-6 20:03	4 2328	kkk228 2020-2-18 20:05
[Cadence Sigrity] 怎么理解Buffer模型 1人参与	rainwwww 2020-1-6 11:43	1 701	yangjinxing521 2020-1-6 16:51
[仿真讨论] 传输线和走线长度的关系 4人参与	weqsss 2020-1-6 10:31	2 682	changjinling 2020-1-8 11:43