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楼主: li_suny
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《Mentor SiP系统级封装设计与仿真》出版与技术答疑!

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601#
发表于 2013-9-17 11:47 | 只看该作者
lalasa1987 发表于 2013-9-17 09:28  \5 K9 U; \7 I5 }
李工,补充下,需要的是原理图中导出的带网络名的管脚列表。。。
8 C9 @+ B- v6 R# C% s: ~; P+ l
原理图有个ICT Viewer的工具,在他的Hierarchy页看看,貌似里面可以把器件的管脚列表拷贝出来。没怎么用过这个,不太熟悉,你可以试一下看看。

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602#
 楼主| 发表于 2013-9-18 16:51 | 只看该作者
v520 发表于 2013-9-14 16:21. F5 w- M& f, T1 {9 B9 i$ U
我将pads pcb转为ee后,没有阻焊层和助焊层,有什么办法可以将这两个层加上
) H4 u; P6 z+ E
那就需要手工在Padstacks里面添加,如果怕麻烦且要求不高,可以在出Gerber时,用焊盘层出。

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603#
 楼主| 发表于 2013-9-18 16:53 | 只看该作者
lalasa1987 发表于 2013-9-17 09:285 k6 T# L% I) b/ v, c3 m
李工,补充下,需要的是原理图中导出的带网络名的管脚列表。。。

- ?+ z. \+ N/ `/ |- W, t4 D( B可参考 yth0 提供的方法。

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604#
发表于 2013-9-25 17:21 | 只看该作者
li_suny 发表于 2013-9-18 16:53
; g3 C7 H2 _# h# w6 M  }% j可参考 yth0 提供的方法。
4 S& L, V+ B, h' P/ f4 U- d7 e8 `
谢谢答复,这个方法我之前一直用,但是不方便,如果多个symbol的fracture part需要拷贝多次整合起来,还有就是拷出来的没有pin number的,所以还要和器件的pin list合并起来。。。这个方法比较麻烦,是不是我操作不对啊,请指教~

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605#
发表于 2013-9-26 11:10 | 只看该作者
李工:你好,请问dx执行Package操作时哪个选项可能导致器件的Value值发生变化?(变成了0)

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606#
发表于 2013-9-26 20:54 | 只看该作者
张湘岳 发表于 2013-9-26 11:10( {2 v- ?& q4 ]5 O7 i
李工:你好,请问dx执行Package操作时哪个选项可能导致器件的Value值发生变化?(变成了0)
% [0 y5 I+ g" G: A
已经解决了。part多了个value属性,值是0.然后package时选择了第一项。

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607#
 楼主| 发表于 2013-9-27 12:07 | 只看该作者
lalasa1987 发表于 2013-9-25 17:215 w; _7 n. o% ?3 z- M; D& [3 t8 t
谢谢答复,这个方法我之前一直用,但是不方便,如果多个symbol的fracture part需要拷贝多次整合起来,还 ...
4 X* E% I6 ?' V) `' O
不清楚为何要用这种方法导出引脚,通常可以把符号Symbol保存到库里面再编辑。

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608#
发表于 2013-9-29 15:06 | 只看该作者
lalasa1987 发表于 2013-9-25 17:21
8 A! u+ m- v& r* a" [谢谢答复,这个方法我之前一直用,但是不方便,如果多个symbol的fracture part需要拷贝多次整合起来,还 ...
8 q3 f& ^* B4 d4 q: l: K
呵呵,不好意思,可能我没看清楚你的要求,那个确实有这问题。

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609#
发表于 2013-9-30 14:02 | 只看该作者
li_suny 发表于 2013-9-27 12:070 J4 [& _, J) g
不清楚为何要用这种方法导出引脚,通常可以把符号Symbol保存到库里面再编辑。

  Q- f+ S9 k) r: J+ t其实就是为了导出FPGA调整后的管脚网络名。。。。从库里面导出的直接是管脚名而已

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610#
发表于 2013-9-30 15:19 | 只看该作者
我等后辈感激各位大大的分享!! 给力!

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611#
发表于 2013-9-30 21:42 | 只看该作者
李工,你出的书我买了,到手了,看了下,内容还行,不过内容能更详细些就好了,还有仿真的部份,比较简单

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612#
发表于 2013-10-14 21:12 | 只看该作者
li_suny 发表于 2012-11-15 15:53  s% k$ ^% p7 _3 S4 I( p
可以的,通过NetFilter,参看下图
4 q$ p' r" _: N
lz我用的EE2005.怎么没有找到 你这个界面呢?EE新手…………换软件,好辛苦{:soso_e109:}

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613#
发表于 2013-10-23 11:37 | 只看该作者
李博  有没有详细介绍sip设计的资料给分享一下  或者给个demo看看

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614#
 楼主| 发表于 2013-10-25 15:18 | 只看该作者
lalasa1987 发表于 2013-9-30 14:02
! J, ^: T% P( }  R8 x: }3 O, d其实就是为了导出FPGA调整后的管脚网络名。。。。从库里面导出的直接是管脚名而已

2 T3 l, {6 ~- A! p如果做FPGA的话,可试试IODesigner,用熟了非常方便。

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615#
 楼主| 发表于 2013-10-25 15:20 | 只看该作者
ytmgadw 发表于 2013-9-30 21:42
+ m; X, h, ?( v: Z李工,你出的书我买了,到手了,看了下,内容还行,不过内容能更详细些就好了,还有仿真的部份,比较简单
% J7 w' }: l3 t2 n: M
主要针对SiP写的,pcb设计没有写的太细,主要讲了流程,仿真由于篇幅只写了一章,做了简单介绍。
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