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楼主: forevercgh
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【原创】理性认识SQ的时序仿真功能(不断更新中)_如需转载,请务必征得作者同意

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该用户从未签到

181#
发表于 2008-12-18 20:51 | 只看该作者
看看,多谢!

该用户从未签到

182#
发表于 2008-12-26 15:45 | 只看该作者
不断学习

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183#
发表于 2008-12-28 11:30 | 只看该作者
学习学习

该用户从未签到

184#
发表于 2008-12-29 15:30 | 只看该作者
学习学习) K+ g. d# k* H. S0 Y9 i
学习学习,版主的水平很高啊!

该用户从未签到

185#
发表于 2009-1-1 10:19 | 只看该作者
版主的造就好深阿,努力学习

该用户从未签到

186#
发表于 2009-1-13 12:59 | 只看该作者
学习性很强啊,新手初来,发现这个地方真是个好地方。

该用户从未签到

187#
发表于 2009-1-18 21:34 | 只看该作者
是啊.

该用户从未签到

188#
发表于 2009-1-19 13:58 | 只看该作者
这个不错,学习下~

该用户从未签到

189#
发表于 2009-2-5 16:25 | 只看该作者
我问一个弱弱的问题哈:在时钟同步系统中,时钟CLK和数据的logic time(或说的笼统一点flight time)一般是不一样的,所以才会通过一些手段来完成两者的匹配,我能这样理解吗?

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190#
发表于 2009-2-8 16:39 | 只看该作者
那个板凳看,大家的讨论好精彩啊~~

该用户从未签到

191#
发表于 2009-2-8 17:08 | 只看该作者
请问在进行clk仿真的时候,如搂住所说由于时钟要求严格的单调性(姑且认为只在上升沿采集数据),那接受端的Vil和Vih,应该设置成什么值呢?我现在用的方法是将Vil和Vih设置成相同的值(实际操作的时候将Vil和Vih之间有个很小的差值),大概就是将Vil和Vih取一个加权平均数(也有取归一化值得,但是这个具体方法不太了解)
8 \# D: q$ m! k, Q- m. Z$ N; V1 Y请问接受端的Vil和Vih,与驱动端Vmeas,有什么具体的联系么?是否也需要保持一致?1 v- h" G) o9 R% W* l
假设接受端的Vil=0.8,Vih=2,驱动端Vmeas=1.8,应该如果设置呢?如果推广一下,假如驱动端Vmeas超过了接受端的Vih这个应该如何理解呢?+ T+ y+ _) p+ \/ a" V- P
期待楼主的精彩回复,也希望各位看客能给出自己的答案,谢谢

该用户从未签到

192#
发表于 2009-2-9 14:35 | 只看该作者
学习,学习,再学习

该用户从未签到

193#
发表于 2009-2-11 17:55 | 只看该作者
以前粗略看过,没这里讲得这么精细,呵呵

该用户从未签到

194#
发表于 2009-3-4 16:03 | 只看该作者
学习中

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195#
发表于 2009-3-12 13:46 | 只看该作者
看来要顶啊
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