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楼主: forevercgh
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【原创】理性认识SQ的时序仿真功能(不断更新中)_如需转载,请务必征得作者同意

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该用户从未签到

151#
发表于 2008-10-9 11:30 | 只看该作者
我来学习了

该用户从未签到

152#
发表于 2008-10-9 15:07 | 只看该作者
我来也

该用户从未签到

153#
发表于 2008-10-10 13:45 | 只看该作者
非常好的观点,值得我们新手学学啊 !!!
" |- _# P2 W3 `" p :)

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154#
发表于 2008-10-13 15:33 | 只看该作者

sadadadasdad

看看,,,看看,,,看看,,,

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155#
发表于 2008-10-14 13:17 | 只看该作者
学习学习
头像被屏蔽

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156#
发表于 2008-10-16 11:41 | 只看该作者
学习~~~

该用户从未签到

157#
发表于 2008-10-17 17:15 | 只看该作者
很热闹啊,看看

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158#
发表于 2008-10-20 16:04 | 只看该作者
期待SQ已经很久了

该用户从未签到

159#
发表于 2008-10-20 16:40 | 只看该作者
学习中

该用户从未签到

160#
发表于 2008-10-21 10:25 | 只看该作者
我没接触过仿真。。顶了各位再学习。。。。' p  V- Z6 A* `" r: {$ x6 m
不晓得你们所说的仿真是不是zuken里面有的那个什么ansoft,lightning,傳輸線分析一樣阿...都沒整過阿

该用户从未签到

161#
发表于 2008-10-21 11:22 | 只看该作者
学习一下

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162#
发表于 2008-10-21 15:16 | 只看该作者

回复 2# 的帖子

应该是 资料吧 ,瞅瞅 ,谢了 。

该用户从未签到

163#
发表于 2008-10-26 09:42 | 只看该作者
正在学习SQ,楼主是强人啊!

该用户从未签到

164#
发表于 2008-10-27 21:00 | 只看该作者
问题一:版主在讲buffer delay时,图中的C点输出的是CLK还是Data?$ L" b  r. b6 y+ |( ]: ~) r- r
             如果是Data,Data在Clk的参照下输出,所以有Logic delay。
2 l: i2 `8 H! v             如果是clk,则C点输出的clk是由A点输入的clk处理得到的。4 }3 s. ]$ Q2 V
             这样理解对吗?3 n7 J* o) B/ W8 F
             A点输入的CLK是驱动信号吗?(晶振产生的clk或别的IC提供的clk)
8 l( M6 ~9 a2 n$ N: _1 t# z            我们在用SQ仿真时,仿真图上只有buffer delay 没有Logic delay ,是这样吗?9 A8 n1 I  P: T1 o" R4 o) Q! |
            那logic delay 对我们没什么作用,是吧!
/ R9 r! ^2 [1 U问题二:版主说实际系统系统的load情形是不同于test load的。那么就要考虑到如何修正Tco的问题。
* d  D+ u* k- e2 K               ( k) g  `" Y2 I
我们将IBIS模型中的输出参数更改为实际的负载参数,就可以了吧?
2 Z  G& u" }' K  A: \问题三:版主在37楼的图片中,buffer delay waveform 对应下图中的A点波行吗?driver waveform对应c点波形吗?
! R. Q5 O6 v* ]9 J& [8 l $ S( `+ Z& L6 m" R  {
谢谢版主回答!!!!   不胜感激,嘿嘿!!!

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forevercgh + 5 积极讨论,要加分哈

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该用户从未签到

165#
 楼主| 发表于 2008-10-28 21:06 | 只看该作者
问题一:时钟同步系统中,C点为所有参考CLK的信号。当然不会是CLK
5 A, \8 d( T' d2 |4 k问题二:有人提出过这种方法。我没去验证过,你不妨自己试试。不过,datasheet给的timing参数是test load参数。你即便在IBIS中修改了,也没意义啊,一样是要修正Tco。
# o& u4 F1 g2 E; Z% P问题三:C点' p7 r+ W# J1 D+ c0 N
, w) k, J1 o; l, g2 E7 I7 A# K2 [
大家多多讨论啊 + G; g: C% \# T. O9 h, Q
3 K, C4 m" v) j
我的都是 一面之词
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