某射频单板PCB检视：

funeng3688

首先，射频线是否控制了阻抗？
9 r. h0 k, c" N2 O; G1 b用Polar软件计算线宽、介质厚度。
6 \4 V% t3 r& T/ i$ s6 Y其次，射频连接器接口PCB部分要做电磁场仿真。

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funeng3688

第一版还要关注在实验室环境的分模块可测试性设计，举个例子：如何单独调试PA部分，PA工作是否正常？那首先要将PA输入输出与其它电路隔离开，PA输入端用开口同轴电缆（一般用086电缆）芯线焊接在微带线某个焊盘上，电缆屏蔽外导体焊接在表面的地铜皮上，并保证这两个电缆焊盘尽可能靠近，以减小环路、减小测试驻波。那么地铜皮上的对应位置要绿油开窗。PA输出端也要这么做。
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另外还得注意测试时要有隔直电容，避免测试仪器的直流通路影响PA工作点，或者PA直流进入仪器，可能会损坏仪器。
+ J4 \: Z$ p) }2 |/ l实验室测试是个动手技术活。

funeng3688

. `' ]$ K) E9 N, [2 D. m8 c1 B仍然是VDDPA，功放芯片脚附近只有一个10pF电容，而其它电容在很远的地方。
8 Z( c- \$ E& j2 ^& [1 ]要求将其它电容也放到功放芯片脚附近。
理由是PA芯片是个大负载，是产生大功率噪声的地方，所以在噪声源头位置滤波，才会有最好的效果。
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EMC原则是：从源头消灭噪声
# d0 w4 j1 L4 b+ t2 I0 l4 S# Y; l还有，VDDPA的6个电容接地脚，居然只共用2个接地孔，太少了。至少1:1吧。

=======版主检视的错误结论也保留下来，理由是想说明规范的重要性：这种原理图设计命名不规范的，会误导同事，甚至版主也被骗了。
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即使这个芯片不是PA，而是LNA，那么滤波电容组也应该放在这LNA附近。离远了，滤波效果差。
给谁滤波的，就应该靠近谁。
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funeng3688

7 f# Y7 F7 t+ V; G# q- A
" d" ~1 a7 R! Q% ?4 f7 @$ p# y仍然是上图的天线连接器接口部分，要增加一个ESD电感接地才好些，或者用1/4波长高阻线接地也行。位于隔直电容与天线连接器之间位置。
) R. s: G! S, ?# `4 e% L* Q. J
1 w" f3 _; f5 }8 J, t加个电感或者用1/4波长高阻线，抗ESD的保险系数高。

maikeo

持续关注

funeng3688

# B6 B& [& M7 U4 [( T+ ?! ^

1242126999

1.阻抗匹配是按照要求计算了的
2.射频连接器的中心宽度远超线宽，线宽是阻抗计算得到的，连接器的宽度也是按照封装画的，这个怎么解决呢？
- ^, D5 D3 C! U9 c3.射频线的周边放地孔，这个注意到了，一定得3d仿真吗？

1242126999

funeng3688 发表于 2019-2-15 15:09

# t6 O0 q& r! C0 @受教 了
2 }; b5 z: j. T  y

shelby

现场教学贴~ 持续关注中

1242126999

funeng3688 发表于 2019-2-15 14:50
仍然是上图的天线连接器接口部分，要增加一个ESD电感接地才好些，或者用1/4波长高阻线接地也行。位于隔直电 ...

ESD电感是什么呢
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funeng3688

这块板的接地过孔数量，己经少到能劣化射频指标的程度。
+ T5 A8 w: x$ M5 z6 x

9 M5 W- j4 a6 Z/ D: Y; `1 ]
5 s+ L; S* S' `" W: r一般情况下，多打接地过孔，对射频指标没有坏处。——肯定有好处，可能有极小的好处，可能有极小极小忽略不计的指标改善。基本上没有坏处。
+ w' Y* V" n# ?0 C4 Z# a* i# n但接地过孔多，PCB成本会增加。——PCB制造厂家可能希望多打些过孔，反正羊毛出在羊身上。
' P4 ]% E' R$ B接地过孔打多了，也没必要。
4 S% [0 o$ b9 b, C" H
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从无到有

回楼上的，就是防静电用的，怕静电通过天线进来打坏PA
版主好贴，持续关注啊

1242126999

从无到有 发表于 2019-2-15 15:22
回楼上的，就是防静电用的，怕静电通过天线进来打坏PA
0 s8 J# f7 E& z- T  d版主好贴，持续关注啊

楼主说的是电感
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helendcany

赶上直播了？

gaoxings

学习中...

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funeng3688 发表于 2019-2-15 15:09

7 t9 e; }) w& l# O8 U) Y$ f射频区域每一层都要是铺地？意思是电源层都用导线联通？四层都是GND层吗？

needham

难得一见啊，希望直播贴多一点，哈哈