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DDR3差分线,出现下列问题

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1#
发表于 2013-12-18 15:18 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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现在在布DM8168 的DDR3的CK  差分线,遇到这个问题,请大神们解决一下,谢谢了啊

DDR3_不能布线.png (9.82 KB, 下载次数: 0)

DDR3_不能布线.png

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2#
 楼主| 发表于 2013-12-18 15:19 | 只看该作者
不能布差分线

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3#
发表于 2013-12-18 16:15 | 只看该作者
焊盘之间间距太小 不能同时容下两根线,建议按shift+z分开走线,之后调整,或去背面走线

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4#
 楼主| 发表于 2013-12-18 16:34 | 只看该作者
那走的是DDR3 的CLK信号,布线的宽度和间隙是多少呢?这个有没有相关的文档的啊

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5#
 楼主| 发表于 2013-12-18 16:35 | 只看该作者
whylove0707 发表于 2013-12-18 16:15; }4 Z! b3 n4 n  Z) n/ {
焊盘之间间距太小 不能同时容下两根线,建议按shift+z分开走线,之后调整,或去背面走线
) x: x5 u1 X* N) ~9 ?% F. i
那走的是DDR3 的CLK信号,布线的宽度和间隙是多少呢?这个有没有相关的文档的啊?。。。。还有分开走线,多少距离?
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