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设计规范-没拿事板子找渣!

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发表于 2013-9-5 15:47 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 Julia_E365 于 2013-9-5 16:15 编辑 1 U' C8 g( H2 d/ X

- o* e  D1 S+ o! E$ |# I% z设计规范问题,或者有些人没受过专业培训,一直都是这样做,又或者公板就是这样做的,习惯了就没在意了,看看,有没有自己的影子?
; A4 _9 f! M5 Z$ J6 j# G! ~( c: h  1、本来可以摆均匀、整齐的元件没却参差不齐。这样的情况有很多。原因有二:格点太小,而且没设置大小格点,不方便对齐;垂直方向不均匀,因为布局很随意。
% w, N1 J' k! Q3 i6 b" E* R! B+ k        - `* h; ~/ F, c+ Z, W

, B( y6 f3 T0 N7 c6 P       
: G6 V2 p+ h, \- s" g6 r; N3 J3 v        . B) z# f& ]: v- c2 n% ?
        2、空间允许,孔为什么要打得这么乱呢,而且有些离电容管脚太近了;小元件铺铜越过管脚并在两脚之间打孔有什么好处吗?在我的概念里是绝对不允许的。. U( `7 l' T6 I+ s' m, J2 a
       
% E5 d) f4 u6 m* C. _; w: G& g. X$ j7 s9 j
        3、这也是天线!第二个图中好好的一块铜就这样被镂空了。打孔时稍微注意一点就可以避免的问题,把孔打整齐,拉开孔的间距很难吗?) ~& D# g) M7 @5 h8 Z: t
        [img]
0 O2 x, d+ \+ Y8 \! ]
% k( Q$ f) |) ~7 o8 H, u" S6 s        4、铺铜很随意,以致孔只有一部分在铜上(这种情况在一块板内竟然非常多!)。
7 A) h! P  m: C8 |+ Q/ j        / r7 P' _6 s( {
) j5 H/ d* h  o) N
        5、既然铺了铜,为什么还要连线呢?也许这样做也没什么问题,但给人的感觉很不规范。9 N5 K. m2 C# \/ r9 s7 u5 `9 O7 r
       
5 Y+ U4 J  |7 ]3 q7 |. B7 B& B: }4 \6 |) c4 g+ {& {8 f. u! X
        6、铺了铜却不打孔。3 }* C( B9 l6 I
       
2 z( b# W/ k7 Z$ i       
' `9 C8 I& C' N- {; y        7、锐角走线;两地孔完全不必这样挤在一起。* ?, J6 a% K# x8 E# N+ u8 e: W
        + b& b0 J5 _  Q+ Z# p

# @, Y8 [' Y* f2 }8 u4 V" a( j5 z        8、走线问题. E7 `" u! g1 Z. y% D
        改成下图那样会不会好很多?(非得在焊盘里拐一下不可吗?)
, C8 H3 i# ~; Y3 h1 ~) h" ]8 j% e        4 f! i0 N8 |$ v- V

0 Z0 m# o, d+ p        * A4 n2 G+ t+ g

3 p7 @1 I" f8 v  |8 m- L5 o        已经养成很随意走线的坏习惯,做完了也不去修一下。) b1 x7 m  k- }" D* z1 l: p1 `* g* q
       
) y( y  M0 S9 k& W& ~# @* A1 b, _       
- d; P3 u+ |: Z' w. [6 O        * j# }& i! G( x+ A7 r2 k

" z3 Z! s* P" a$ m8 c6 B# V+ j        怎么看都感觉很别扭啊!
# e5 N) n! P8 J       
1 z. j$ l% O3 \* e
/ r4 n2 X/ h  k. }) ^        2 Y6 _9 b7 G5 l
# {& K5 m) D) P' r. {8 s- ?
        9、这是一块大铜皮,0402电阻就这样被铜皮包围着,焊着可能出问题。2 D7 i7 l  a2 ?1 r0 D
       
! T% u: ?! q" t$ x3 A3 M" E* B* R% o5 R
        10、平面层两块同间距只有0.18mm,有那么大的空间,为什么铜与铜的间距非要这么近不可呢?BGA里面为为了保证阻抗连续性,局部间距泪点可以理解,很多地方铜与铜的间距不到0.2mm,何解?
, y6 l% x2 G6 y) n        / v0 H& x& ?, b/ u9 K: ~
5 p2 }5 L0 b  y1 v0 B1 T' {. M% S
        11、有空间就把孔打到10mil以外吧,挤在一起干吗呢?
+ W- w$ S; ?4 a- A4 B       
+ F+ X6 r8 R8 |" B# p. Q* Z- `0 o/ N$ m/ L' Z
        12、这是拉线时没选Replace etch的结果。
# v! q% B9 J4 N% i9 q# P0 W        - `+ C& V6 {4 X3 e9 m! d7 j
$ b0 T9 D, O4 ?- T
        13、这种情况应该走钝角。
9 p+ E: T% v2 s% l- @4 {- m- k       
# [# Q9 L7 y/ K% B3 m; `
. `2 k9 f/ X; d5 G        14、电源先经过电容再到芯片,没错,但电容的位置可以变的嘛,不至于把线走得这么难看吧。- \# V1 U- w9 ^7 J8 ]% v8 G
        ; l! m2 n7 V2 s
! n+ [# F  |, M$ y/ i
        15、复位信号间距太近了,有空间为啥不拉开点呢?
$ B% h! h& x+ H8 w: i7 J5 |+ a& q       
# K, |0 C0 ^& F" Q" O. f% y# E: j* F- \7 a5 C% }+ Y- d
        16、有空间应该拉开点间距;对于高速信号,拐弯会引起反射,能不拐弯就不拐弯;右边拉开点间距并且远离一点安装孔吧。- u2 J8 o+ @- X2 s' H- }" K  F
       
+ r" b6 C, {6 \" y, N9 e3 Q) @
& o7 n8 K1 B( N0 ~9 N; K        17、把下边那个孔往左移一点,紫色的线就可以少拐4个弯了!* {+ T1 f) Q4 R
       
+ g1 s; \1 m" T7 g6 `
. N' B. J- \9 B7 p: d9 \        18、这两个地孔有必要打那么远吗?
; n# o8 i2 f# u* f; _7 A5 `       
9 q* n$ `- c6 z0 J9 j( V. R& x1 f; i5 i
        19、滤波电容基本上都没有按先大后小的顺序来布局,很多线还少拐几个弯,还可以短很多的。

点评

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支持  发表于 2013-9-5 17:03
支持!: 5 反对!: 1
  发表于 2013-9-5 15:52

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 楼主| 发表于 2013-9-6 09:46 | 只看该作者
pmp_mcu 发表于 2013-9-5 21:44  m/ v! W2 u5 {- t
这个图这样做是对的。不能只看表面。PCB layout是黑色艺术。

; b( @. s8 z" c" x( E9 o6 p5 u对比一下,塾优塾劣?6 ?4 n, j/ `, L1 q" ^

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发表于 2014-11-25 20:44 | 只看该作者
Julia_E365 发表于 2014-11-25 18:245 n. z* L+ N" }9 ^# k, A
当客户指出这些问题的时候就晚了,这些虽然是细节,但给人的感觉就是不够专业。
6 o' p, N- M( U, j3 p
呵呵,不同类型的单板不同的规范,有些新手做的可能不到位,但是不能一棒子打死。要给他们鼓励,严格是好的,但是要有尺度,那些新人也是有自尊的,我觉得我手下的新人,虽然现在细节处理不到位,那个是需要实战经验的,将来他们或许会比我强的,所以得尊重新人。" H/ [1 o- r/ h/ g7 t
还有就是每个人包括客户,大家的想法不一样。有时候你做的再完美,那也只是在你眼,客户看起来或许未必是那样的。既然做设计就不要怕客户提意见,客户和你,关注的点不同,有时候你所关注的,客户或许并不太在意;要明白客户在意的点,和你设计的单板的类型并注意该类型的设计中有哪要点,这个要优先处理好,尤其是项目进度比较紧急的时候。优化是无止境的。
; K/ Y/ ]3 {& H' S
  • TA的每日心情
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    [LV.1]初来乍到

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    发表于 2013-9-6 21:59 | 只看该作者
    Julia_E365 发表于 2013-9-6 09:46; D1 Q  g6 t# ^# }
    对比一下,塾优塾劣?

    9 f4 L; V" O3 B左侧第一对差分也许是为了进行对内等长才不做到齐头并进 无法判断一定是错的
    . z: H( J0 K& p7 y$ F6 r下方那对差分楼主的做法是对的,应该要避免差分锐角走线的产生
    3 p% m9 w8 s* E* J& A; H& s右边的差分个人认为楼主的做法没有原图中的好,两差分线之间的耦合距离比原图中要差一点,原图更接近via处才分开,楼主的耦合距离偏大,对信号的影响更明显" ^  w: Q+ {2 Z9 T
    个人拙见 见笑了

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    3#
    发表于 2013-9-5 16:11 | 只看该作者
    嘿嘿,谢谢楼主的指导,这些其实都是很容易忽视的细节,如果都能养成习惯,Layout出来的东西必定少很多问题

    该用户从未签到

    4#
    发表于 2013-9-5 16:34 | 只看该作者
    都是些很细节的东西,对于我这种有轻微强迫症的人来说,做不到反而很难受啊

    该用户从未签到

    5#
    发表于 2013-9-5 17:06 | 只看该作者
    LZ已经是高人了...

    该用户从未签到

    6#
     楼主| 发表于 2013-9-5 17:21 | 只看该作者
    fsq2011 发表于 2013-9-5 17:06/ B  R/ |0 u6 j1 \6 {9 X$ ?
    LZ已经是高人了...

    9 B& u# g1 F3 E5 j不及你啊{:soso_e113:}

    该用户从未签到

    7#
     楼主| 发表于 2013-9-5 17:25 | 只看该作者
    抛砖引玉罢了,望高手出来指点呀。

    该用户从未签到

    8#
    发表于 2013-9-5 17:29 | 只看该作者
    个人认为画PCB就和审美一样,画出的PCB就代表着审美观。

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    9#
    发表于 2013-9-5 17:36 | 只看该作者
    好像自己之前画的板子啊,要严格要求,细节决定成败,

    该用户从未签到

    10#
    发表于 2013-9-5 19:29 | 只看该作者
    看来layout心思不在板子上,以连通为目的,PCB美观和内涵边lay边漏。跟规范没关系,规范不可能什么都要求。对于第二个问题,对于大封装的电容,建议在两pin之间成对打孔,VCC和gnd的互感会减小总的环路电感,对于电源要求宽频低阻抗是有好处的。作用有多大,It depends。这不算坏习惯

    该用户从未签到

    11#
    发表于 2013-9-5 20:10 | 只看该作者
    3345243 发表于 2013-9-5 19:296 K( E  e8 d* S8 y1 m  w5 B& f! n
    看来layout心思不在板子上,以连通为目的,PCB美观和内涵边lay边漏。跟规范没关系,规范不可能什么都要求。 ...
    6 U9 c! Z1 }: `  N
    为什么能减少环路电感?

    该用户从未签到

    12#
    发表于 2013-9-5 21:44 | 只看该作者
    这个图这样做是对的。不能只看表面。PCB layout是黑色艺术。

    untitled.png (96.86 KB, 下载次数: 1)

    untitled.png

    该用户从未签到

    14#
    发表于 2013-9-6 11:36 | 只看该作者
    就一般而言,楼主是对的,但是某些高频的pcb处理,很多时候就是乱七八糟的,美观不一定就性能好,在layout概念上,只要符合EMC,信号完整性【包括电源完整性】、安规等guide后,再考虑美观;追求完美是对的,但不要过分,楼主不算重呵呵;我的观点:我们现在所绘的是一板一眼的西洋画,其实有时国画的意境更为深远呵呵

    该用户从未签到

    15#
    发表于 2013-9-6 11:43 | 只看该作者
    看了看感觉还是有一定的指导意义的  赞同性能至上,兼容美观的观点
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