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设计规范-没拿事板子找渣!

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发表于 2013-9-5 15:47 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 Julia_E365 于 2013-9-5 16:15 编辑 ' Q5 V. R9 Y+ ?( w. }( e0 }8 D

! P" N! ^; e! X) v- T设计规范问题,或者有些人没受过专业培训,一直都是这样做,又或者公板就是这样做的,习惯了就没在意了,看看,有没有自己的影子?. l" I& R7 H. |3 k  G1 [3 r
  1、本来可以摆均匀、整齐的元件没却参差不齐。这样的情况有很多。原因有二:格点太小,而且没设置大小格点,不方便对齐;垂直方向不均匀,因为布局很随意。
# |, b& @; Y3 l5 R/ [; Y8 _6 H        4 Z3 `" V& x# m0 ?! ?- [# W
1 Z$ `% {6 G* k5 S" H
        . S/ H, G! p: Z
       
' i- L) ^4 T7 L  z4 c+ c9 V# x        2、空间允许,孔为什么要打得这么乱呢,而且有些离电容管脚太近了;小元件铺铜越过管脚并在两脚之间打孔有什么好处吗?在我的概念里是绝对不允许的。
( n- N& H1 M$ e# l5 \# s+ N1 }1 o/ S. v       
5 i) _& c2 i+ y* y" Y) t7 L- c/ [+ Y# o5 J* g7 O
        3、这也是天线!第二个图中好好的一块铜就这样被镂空了。打孔时稍微注意一点就可以避免的问题,把孔打整齐,拉开孔的间距很难吗?
; E2 h0 v4 v& Z# c2 [2 |1 r7 ?/ m        [img]
8 j& X. w6 D' m6 R' v' O+ N( g8 ^# I0 ]. C- [# D/ _" [
        4、铺铜很随意,以致孔只有一部分在铜上(这种情况在一块板内竟然非常多!)。
5 N0 N1 [0 |7 _        $ y7 Z" n8 K& A4 @  ~  ]
& k3 v9 }  @* s9 n
        5、既然铺了铜,为什么还要连线呢?也许这样做也没什么问题,但给人的感觉很不规范。7 U9 i8 z  M; J
          u& z( Q7 M  ~/ s- P

/ G5 r+ V: l3 C/ s; b: t! R        6、铺了铜却不打孔。
3 t+ u" @8 v: R" I; f3 ~) x9 D  {       
. q+ ]3 K  W( p6 D: A5 j, A( v$ p0 @        : i: x: k7 B3 p" k: X! j& k$ A
        7、锐角走线;两地孔完全不必这样挤在一起。
" o: `# V% l9 F/ H        0 s( N& L7 L' x+ F3 |9 M
( [, |- p8 d& U' o, C% @! g% d: s
        8、走线问题
$ G+ |) @8 c, y( l        改成下图那样会不会好很多?(非得在焊盘里拐一下不可吗?)
. H+ N5 K5 i# [9 W+ M       
. r$ c* o9 ~  o$ u1 X" C9 ~( U" h8 S, p. {8 W+ F1 |" `3 q7 a
       
5 |7 n- a8 ?) `2 Y* S  l. o* M2 B/ @9 N8 k3 k9 ]- H
        已经养成很随意走线的坏习惯,做完了也不去修一下。
4 }# F  @  s% n' P; @4 U3 p6 G" k6 v        + Y: k/ Z7 x5 P+ |. I2 a
        . m2 B, s3 d3 w
        3 D9 w' l4 ?- O

3 m9 B2 a" |0 b2 ]5 M) c        怎么看都感觉很别扭啊!: [: C: q/ o( `% D( h" J0 m- ]
        # e9 a4 ?, ?+ U5 X0 {$ F
. L) k, b' T8 c. V4 o3 S, k
        $ c; M- N8 z7 o. b' x' ]& P5 U

8 _5 o$ |/ f* @- E1 T        9、这是一块大铜皮,0402电阻就这样被铜皮包围着,焊着可能出问题。
: k1 q5 s3 ~) a        : a2 \( U$ s" t+ S- }

' d6 N$ J- ~- H9 @; ~        10、平面层两块同间距只有0.18mm,有那么大的空间,为什么铜与铜的间距非要这么近不可呢?BGA里面为为了保证阻抗连续性,局部间距泪点可以理解,很多地方铜与铜的间距不到0.2mm,何解?8 d- N# T* o4 Y" Q% K
        ' S. k7 H7 m. b7 p$ z

/ H( I! I4 s. f7 F        11、有空间就把孔打到10mil以外吧,挤在一起干吗呢?8 C# B& A1 H& J2 i! b
       
9 _& \' m5 Y+ t4 o7 o/ H0 d
& A6 u! \4 X5 a* v. T& E3 Y        12、这是拉线时没选Replace etch的结果。- z' o- C: r) n/ l0 Y4 P7 ^
       
) j6 ?) l, i# g4 h/ C4 y
* ]  a5 ~+ V/ Z  N  p        13、这种情况应该走钝角。  x, u3 ?1 W/ \; A& b" g3 Z
       
9 Z8 V9 T8 i; v! [( J, B
6 k' d2 X8 q4 O* j. G. K; D        14、电源先经过电容再到芯片,没错,但电容的位置可以变的嘛,不至于把线走得这么难看吧。: e; D1 t# x2 \8 k
        ' @- i8 O0 U& @+ w- ]

$ T; X- k  I( |/ d# s6 ?4 a# W7 B( P        15、复位信号间距太近了,有空间为啥不拉开点呢?# r$ M+ b/ |, O# y. z2 L/ m
        1 f1 h+ a: f& J8 W& ]- W6 [2 I" a

; k1 t/ Z7 k6 G& _/ J4 g7 o4 }        16、有空间应该拉开点间距;对于高速信号,拐弯会引起反射,能不拐弯就不拐弯;右边拉开点间距并且远离一点安装孔吧。0 z! e8 Q4 i. t5 x9 q
       
9 Y7 q; z( A# \: B: \% l% [" Q) m. D6 G
        17、把下边那个孔往左移一点,紫色的线就可以少拐4个弯了!
0 S/ o% l# F3 g3 Z" l( F! L        8 w* K9 {, b; L6 x9 h

. m+ {/ q/ J# h        18、这两个地孔有必要打那么远吗?
' T" u; x5 t% |/ i7 x4 }        1 f' `- ^: H) Q. L( G
+ l. A3 ~$ J* U: a. }
        19、滤波电容基本上都没有按先大后小的顺序来布局,很多线还少拐几个弯,还可以短很多的。

点评

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支持  发表于 2013-9-5 17:03
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  发表于 2013-9-5 15:52

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 楼主| 发表于 2013-9-6 09:46 | 只看该作者
pmp_mcu 发表于 2013-9-5 21:445 a' h7 ~# V- f& ]" W% I
这个图这样做是对的。不能只看表面。PCB layout是黑色艺术。
5 U% y. I9 z# B8 j
对比一下,塾优塾劣?
% D, t5 O2 v8 V9 S* g. v

该用户从未签到

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发表于 2014-11-25 20:44 | 只看该作者
Julia_E365 发表于 2014-11-25 18:24' B9 L  |' G: G+ u1 q
当客户指出这些问题的时候就晚了,这些虽然是细节,但给人的感觉就是不够专业。

1 Y" g- k7 P- V6 [5 s呵呵,不同类型的单板不同的规范,有些新手做的可能不到位,但是不能一棒子打死。要给他们鼓励,严格是好的,但是要有尺度,那些新人也是有自尊的,我觉得我手下的新人,虽然现在细节处理不到位,那个是需要实战经验的,将来他们或许会比我强的,所以得尊重新人。$ N% v3 S- z; A+ ~9 v9 d9 R
还有就是每个人包括客户,大家的想法不一样。有时候你做的再完美,那也只是在你眼,客户看起来或许未必是那样的。既然做设计就不要怕客户提意见,客户和你,关注的点不同,有时候你所关注的,客户或许并不太在意;要明白客户在意的点,和你设计的单板的类型并注意该类型的设计中有哪要点,这个要优先处理好,尤其是项目进度比较紧急的时候。优化是无止境的。3 y: S/ R0 T6 s  E, G3 a& g, B; @
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    [LV.1]初来乍到

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    发表于 2013-9-6 21:59 | 只看该作者
    Julia_E365 发表于 2013-9-6 09:46/ C/ c  j" Q* |& c9 M9 Z
    对比一下,塾优塾劣?
    " \2 O) C* y6 ~8 \1 C
    左侧第一对差分也许是为了进行对内等长才不做到齐头并进 无法判断一定是错的4 i$ d% n# n! M5 Q
    下方那对差分楼主的做法是对的,应该要避免差分锐角走线的产生
    5 D; _; E6 O& K9 Z右边的差分个人认为楼主的做法没有原图中的好,两差分线之间的耦合距离比原图中要差一点,原图更接近via处才分开,楼主的耦合距离偏大,对信号的影响更明显
    - f8 F" T4 w2 T' X( g个人拙见 见笑了

    该用户从未签到

    3#
    发表于 2013-9-5 16:11 | 只看该作者
    嘿嘿,谢谢楼主的指导,这些其实都是很容易忽视的细节,如果都能养成习惯,Layout出来的东西必定少很多问题

    该用户从未签到

    4#
    发表于 2013-9-5 16:34 | 只看该作者
    都是些很细节的东西,对于我这种有轻微强迫症的人来说,做不到反而很难受啊

    该用户从未签到

    5#
    发表于 2013-9-5 17:06 | 只看该作者
    LZ已经是高人了...

    该用户从未签到

    6#
     楼主| 发表于 2013-9-5 17:21 | 只看该作者
    fsq2011 发表于 2013-9-5 17:06
    ) g! d) z4 Z3 M/ m+ I; B$ v9 k7 bLZ已经是高人了...

    1 ~6 o0 H! }/ h. X1 I不及你啊{:soso_e113:}

    该用户从未签到

    7#
     楼主| 发表于 2013-9-5 17:25 | 只看该作者
    抛砖引玉罢了,望高手出来指点呀。

    该用户从未签到

    8#
    发表于 2013-9-5 17:29 | 只看该作者
    个人认为画PCB就和审美一样,画出的PCB就代表着审美观。

    该用户从未签到

    9#
    发表于 2013-9-5 17:36 | 只看该作者
    好像自己之前画的板子啊,要严格要求,细节决定成败,

    该用户从未签到

    10#
    发表于 2013-9-5 19:29 | 只看该作者
    看来layout心思不在板子上,以连通为目的,PCB美观和内涵边lay边漏。跟规范没关系,规范不可能什么都要求。对于第二个问题,对于大封装的电容,建议在两pin之间成对打孔,VCC和gnd的互感会减小总的环路电感,对于电源要求宽频低阻抗是有好处的。作用有多大,It depends。这不算坏习惯

    该用户从未签到

    11#
    发表于 2013-9-5 20:10 | 只看该作者
    3345243 发表于 2013-9-5 19:29  B- q  N* G" [( d" T" _! `
    看来layout心思不在板子上,以连通为目的,PCB美观和内涵边lay边漏。跟规范没关系,规范不可能什么都要求。 ...
    , u8 t" T) o) E( A+ Y" j
    为什么能减少环路电感?

    该用户从未签到

    12#
    发表于 2013-9-5 21:44 | 只看该作者
    这个图这样做是对的。不能只看表面。PCB layout是黑色艺术。

    untitled.png (96.86 KB, 下载次数: 1)

    untitled.png

    该用户从未签到

    14#
    发表于 2013-9-6 11:36 | 只看该作者
    就一般而言,楼主是对的,但是某些高频的pcb处理,很多时候就是乱七八糟的,美观不一定就性能好,在layout概念上,只要符合EMC,信号完整性【包括电源完整性】、安规等guide后,再考虑美观;追求完美是对的,但不要过分,楼主不算重呵呵;我的观点:我们现在所绘的是一板一眼的西洋画,其实有时国画的意境更为深远呵呵

    该用户从未签到

    15#
    发表于 2013-9-6 11:43 | 只看该作者
    看了看感觉还是有一定的指导意义的  赞同性能至上,兼容美观的观点
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