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为JIMMY出DDR3的教程铺路。

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  • TA的每日心情

    2019-11-20 15:11
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    [LV.1]初来乍到

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    1#
    发表于 2013-3-21 11:56 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    本帖最后由 jimmy 于 2014-1-24 10:08 编辑 3 ?/ ?8 N% x, y) j8 x: f. y

    8 p5 V& Y3 I% Z3 qRT,先为JIMMY老大的教程普及基本常识。我想应该有很多人知道数据,地址,控制,命令等等,但好像不能对号入座。哪这里先给出一份名词解析,方便大家。有不对的地方,欢迎指出。
    ' k. n# j( d; Q0 K+ HClocks----时钟4 D0 |' r: Z  t1 s% T7 F* P
    CKP CKN -----DDR differential clock outputs-----DDR时钟差分
    ) H8 d) R1 x! Y9 s! i& h/ L* Q! x
    Data ---数据
    3 E" c4 A: X7 c0 i1 Y2 O: V& |. B; [: t; ]
    DQ -----数据BUS总线
    * v0 D* T0 w6 E0 z0 Y  e
    # T$ d$ [  k2 b' Q) S: bECC------自检纠错总线
    * ~8 T6 `8 y, x3 x; A( n% C0 Z; n8 c" R$ B( L; M% g! z6 U, N
    DM-------Data mask pins 数据屏蔽- ~/ l2 @( E3 g3 @+ U
    . W! e6 I6 V+ d1 L2 w7 d
    DQS------Data strobe pins 数据选通(差分)3 [/ U" E- @; }: q6 z& V$ K
    ! r6 C5 F9 P% k! k
    Address/Command---------地址/命令& Q  G4 c' F" B$ D% q7 H$ q, H
    A------Address bus ----------地址BUS总线+ u+ L( J4 P! W& V( q, O0 S0 j+ t

    % V# H/ g! X# `7 v0 ~BA ----Bank address --------本体地址(不确定)
      L5 g. ^, C" i/ v+ g& V
    * g' m7 B! V( Z4 iRAS----Row address strobe---------行地址选通
    9 \4 ], U7 P' Y" ?9 N$ H5 T! a2 k1 B9 r; B/ A
    CAS----Column address strobe-----列地址选通
    % i; j: U0 T8 M/ K4 L  x2 t# ?  }) t* s# F3 o4 b( O5 R9 T" ^" T0 P
    WE-----Write enable------------------写入使能0 ~3 g% Y/ a" y  u

    1 U3 p1 s  D6 t) G. s& N- `Control----控制
    8 S7 p, [2 P5 r1 pODT-------------------------------------片内终结
    ( E3 U* n% r$ T/ K
    3 K; t& I% r' u- S. m5 m8 |# jCKE ------Clock enable----------------时钟使能
    + C$ W3 c7 l( b7 P% `0 Q( F. I) N/ }6 KCS--------Chip selects-----------------片选
    9 E  l/ s; p$ `+ W$ p
    ) j9 Y( B5 l8 u* p2 Q7 l% I% }/ B2 X" b) J
    DDR3视频在随书的光盘中有免费赠送!请大家关注新书。* l: f$ y8 q+ x0 i2 P) P5 N0 D# R

    + S: I0 M8 O) \$ s- I购书地址:http://item.taobao.com/item.htm?id=366663732126 f6 n, u' V0 e. g
    : j( m( D2 m- r& f' @

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    支持!: 5
      发表于 2014-1-26 12:22

    评分

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    该用户从未签到

    推荐
    发表于 2014-2-8 17:10 | 只看该作者
    DDR3跟DDR2在走线等长方面有哪些不同的要求

    该用户从未签到

    推荐
    发表于 2015-4-16 09:58 | 只看该作者
    真的真的要大大的赞一个

    该用户从未签到

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    发表于 2014-1-25 14:15 | 只看该作者
    感谢一下,是好东西
  • TA的每日心情

    2019-11-20 15:11
  • 签到天数: 1 天

    [LV.1]初来乍到

    2#
     楼主| 发表于 2013-3-21 11:56 | 只看该作者
    本帖最后由 wpc4208211 于 2013-3-21 11:58 编辑 7 N5 `$ s# R6 K% Y0 I
    7 }6 X' \  a/ P$ {3 j8 D
    Feedback-反馈
    ! |0 s' S, ^% R  u; z+ o% |( L+ c! B6 ]' W& @+ m7 e( c
    SYNC_OUT---DRAM DLL synchronization output-----同步DRAM的DLL输出3 j* H" A& q# H% S8 \1 |( V
    SYNC_IN------DRAM DLL synchronization input-------同步DRAM的DLL输入: w1 f4 \. E$ s8 `8 E3 _
    , x3 v) i5 o5 r* R
    Power-电源6 f9 Z( b' s. R
    ! Q3 Z" W1 j) j$ P; |% O
    VREF----Voltage reference for differential receivers---采样电压- R+ ]2 V2 I; b" _
    VTT---Termination voltage-----------------------------------端接电压
    $ c3 j% J6 }2 z

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      发表于 2014-1-26 12:23

    该用户从未签到

    3#
    发表于 2013-3-21 11:59 | 只看该作者
    铜球

    该用户从未签到

    4#
    发表于 2013-3-21 12:43 | 只看该作者
    继续
  • TA的每日心情
    奋斗
    2026-4-15 15:55
  • 签到天数: 170 天

    [LV.7]常住居民III

    5#
    发表于 2013-3-21 15:22 | 只看该作者
    做DDR的应该都有内部规范,发个过来
  • TA的每日心情

    2019-11-20 15:11
  • 签到天数: 1 天

    [LV.1]初来乍到

    6#
     楼主| 发表于 2013-3-22 20:04 | 只看该作者
    yangjinxing521 发表于 2013-3-21 15:22
    , v# p% c, Q" T: ]1 i. U2 E做DDR的应该都有内部规范,发个过来

    % \, L+ P' i  f* S+ w' B3 F给你一个DDR3的文档好了,我帮JIMMY普及的是对应的新手。不是老鸟。你这样的老鸟按理说不需要的。

    DDR3.rar

    953.91 KB, 下载次数: 838, 下载积分: 威望 -5

  • TA的每日心情
    奋斗
    2026-4-15 15:55
  • 签到天数: 170 天

    [LV.7]常住居民III

    7#
    发表于 2013-3-22 22:21 | 只看该作者
    wpc4208211 发表于 2013-3-22 20:04
    6 e1 F7 B3 o* t给你一个DDR3的文档好了,我帮JIMMY普及的是对应的新手。不是老鸟。你这样的老鸟按理说不需要的。

      B7 o& s' [7 \7 P( C6 {6 ~4 x我也没做过DDR3的板子。LAYOUT DDR3和新手差不多啊。。。

    该用户从未签到

    8#
    发表于 2013-3-23 09:09 | 只看该作者
    {:soso_e179:}{:soso_e179:} 对于我们新手 是很好的资料了  非常感谢!!

    该用户从未签到

    9#
    发表于 2013-3-23 10:17 | 只看该作者
    太好了

    该用户从未签到

    10#
    发表于 2013-3-23 16:55 | 只看该作者
    受教了

    该用户从未签到

    11#
    发表于 2013-7-5 17:20 | 只看该作者
    很好,适合新手
  • TA的每日心情

    2019-11-19 16:12
  • 签到天数: 1 天

    [LV.1]初来乍到

    12#
    发表于 2013-7-5 23:53 | 只看该作者
    这几天正在学习DDR知识的,加上以前看的资料,感觉懵懵懂懂。
    ' D: l* f) L: L) ~; X; t比如说下面这个DDR2的内部解析图:我一直没搞明白它的列地址线用到了多少根,行地址线是13根吧?那它的总容量应该是行地址数(2的13次幂)X列地址数(2的多少次幂)X8(banks),这是存储单元的总数吧?然后再X16(位宽)才得到的多少Mbit吧?
    " W* V( {/ i: H  V# f7 G! @, a) Q' `" F虽然有些人说没有必要了解它里面的结构,但我还是想搞明白点。
    ! m: ?, f( y' L7 ^7 k8 P. ~7 D

    D9R9F@FFM7OB@W@A9BM~_[H.jpg (97.57 KB, 下载次数: 13)

    D9R9F@FFM7OB@W@A9BM~_[H.jpg

    该用户从未签到

    13#
    发表于 2013-7-6 09:11 | 只看该作者
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