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一个CPU可以同时作为三个PCIE从端吗

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1#
 楼主| 发表于 2025-9-18 17:57 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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1.CPU的PCIE一般当作主用(RC),或者当一个从设备(EP)应该也可以,没有用过一个cpu作为三个PCIE的从端(EP),上游连接三个主进行通信。

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建議戶名將「」字改為「」!^_^  发表于 2025-9-22 08:29

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发表于 2025-9-20 09:25 | 只看该作者
huo_xing 发表于 2025-9-19 20:33
! P) ~% B+ i8 c" I5 m7 n  ?我没记错pcie工作不可以不用同时钟的。时钟可以在数据信号中提取,这是所有高速串行总线的基本功能。

4 S% c4 b7 j0 M! ]$ f3 r高速串行信号有2个时钟域,第一级是从串行的Serdes中用CDR恢复时钟来采样串行数据 第二级要把串行的数据转为并行的32或者64位
  ]/ g4 m% V7 l这2级时钟是会有一定相位差的。 在PCIE 中最简单的方式就是使用对面提供的100Mhz来同步整个链路3 @( Y# D6 l' p! j- T6 Z0 X
) ^: z+ v. L8 k$ e5 M2 j
如果使用其他的本地时钟或者 全用恢复时钟, 那么要仔细考虑这个后果。
% {  l2 k2 b7 v$ r4 `/ m

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同源肯定更好,但PCIE规范当中也可以用异步时钟  详情 回复 发表于 2025-9-20 14:40

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 楼主| 发表于 2025-9-20 14:39 | 只看该作者
myiccdream 发表于 2025-9-19 17:116 B3 }' Z: b3 i; r
传统的X86 或者 CPU 估计是有困难的。
$ y+ t# g# q& z. k$ v按照PCIE 的架构。 下游端口需要 锁定上游的 100MHZ时钟 来同步数据 ...

0 ?% a2 P" L8 f: p# b1.时钟的话cpu这边有三个PCIE控制器,可以接入外部给进来的三个100MHZ时钟,
4 B5 E' @6 o) ~7 z9 {0 k0 _2.rst应该没问题,我只要ep端,CPU提前启动,准备好就行了
5 t; A- j  d3 }0 i% j! j7 x3.FPGA要高端才能有多个PCIE硬核,K7这样的FPGA只能接一个PCIE,成本高
1 v/ N" U0 F3 s  y  o# g" m0 o

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发表于 2025-9-21 11:36 | 只看该作者
本帖最后由 超級狗 于 2025-9-21 22:29 编辑 6 ~. |0 ]. D/ ~6 L8 o( F2 o! H
' _6 s0 W4 R; V; U6 h  t
PCIe Swicth 支援 Multi-Host 的重要條件
: `7 I% D; O8 ?0 A& Y' V) ^
  • Non-Transparent Port (NT Port)
  • Multi-Root I/O Virtualization (MR-IOV) 非必要
  • Non-Transparent Bridge (NTB)# r3 `4 e7 E1 ]7 Q$ j5 G

% v+ E' Y1 c' i" Z4 I: n& V市售支援 Multi-Host 的 PCIe Switch8 o# p+ b- x# s/ f
  • Broadcom (原 PLX) , C5 h0 z& |9 Y3 |, Z5 z( ^
    PEX9700PEX9700APEX9700B
  • Microchip (原 IDT)$ \2 ]5 W, v) d$ m
    PFXPSXPAX 系列; H/ S: }8 E# Q  ?# T3 H
' n" X$ c) r2 J" M2 g0 }6 [
/ q" p' I; z7 P- j4 m7 {
8 G8 s4 `% O) v4 H' t

* A4 V6 E# O5 e/ D0 x: Z

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厉害,这是给得想当完备了。 大家就像楼主的幕僚,提供了全面的信息和多样化的建议。 旁人从这些高见中,都可以学习到很多知识和了解PCIe的规范。  详情 回复 发表于 2025-9-21 12:59

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5#
发表于 2025-9-18 18:56 | 只看该作者
不行。用pcie Switch

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交换机也只有一个上游端口啊,他要求是三个上游  详情 回复 发表于 2025-9-19 11:17
switch怎么个用法,上游三端口,下游一端口的switch这样吗,有这种用法吗  详情 回复 发表于 2025-9-19 09:51
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    奋斗
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    6#
    发表于 2025-9-18 22:50 | 只看该作者
    想法想当的奇特呀,cpu就是主啊,让他做从,是迫不得已,方便一时所需,现在不但要做从,还一仆三主,真是让人迷惑啊

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    注释一下:CPU这边是多个PCIE控制器,本质还是RC->EP,一对一,只不过三个EP是一个处理器而已  详情 回复 发表于 2025-9-22 10:12
    这有什么迷惑的呢,cpu跟cpu的通信和高速数据传输啊,只是没这样用过  详情 回复 发表于 2025-9-19 09:52

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    7#
    发表于 2025-9-19 07:28 | 只看该作者
    Root Complex (RC) + Multiple Root Port* M% D' m6 h  H- t: G4 Z: D
    某些 SoC/CPU 本身有多個 Root Port,CPU 晶片內建多個獨立通道。
    " {4 ~6 }( ]- [& U( d

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    8#
     楼主| 发表于 2025-9-19 09:51 | 只看该作者
    huo_xing 发表于 2025-9-18 18:569 L% M& H) J$ F/ H
    不行。用pcie Switch
    9 ^# E' l2 j; M; \6 A
    switch怎么个用法,上游三端口,下游一端口的switch这样吗,有这种用法吗
    ' z2 {2 c. \+ X3 ^0 p

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    和你家里的路由器一样。只是功能强大的价格估计比你cpu还贵,还有都是国外牌子  详情 回复 发表于 2025-9-19 10:23

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    超級狗 + 5 自己挖的坑要自己填!

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    9#
     楼主| 发表于 2025-9-19 09:52 | 只看该作者
    Dcpc086397900 发表于 2025-9-18 22:503 t  d7 P  W' d* t2 _( P( e
    想法想当的奇特呀,cpu就是主啊,让他做从,是迫不得已,方便一时所需,现在不但要做从,还一仆三主,真是 ...

    ) R9 A7 J; d8 W% ]; x0 J这有什么迷惑的呢,cpu跟cpu的通信和高速数据传输啊,只是没这样用过4 M; p' ?8 j, ]  M3 W( Y

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    PCIe Switch 應用方塊圖  详情 回复 发表于 2025-9-19 13:16
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    10#
    发表于 2025-9-19 10:17 | 只看该作者
    当设计使用多CPU的时候,其实通信就是类PCIe总线,具体细节没有研究过。

    该用户从未签到

    11#
    发表于 2025-9-19 10:23 | 只看该作者
    狂羁青马 发表于 2025-9-19 09:51- X# W/ l/ g5 E2 m" A# ?
    switch怎么个用法,上游三端口,下游一端口的switch这样吗,有这种用法吗
    0 ?9 ^, {" H% V4 y5 J
    和你家里的路由器一样。只是功能强大的价格估计比你cpu还贵,还有都是国外牌子
    8 @  I" H+ ^8 i

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    PEX8619可行吗  详情 回复 发表于 2025-9-19 16:06
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    开心
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    12#
    发表于 2025-9-19 11:17 | 只看该作者
    huo_xing 发表于 2025-9-18 18:56* g* K. [5 A" t" C' s
    不行。用pcie Switch

    $ v# l2 `5 h( @1 i' u1 Y$ G交换机也只有一个上游端口啊,他要求是三个上游
    ! G' G7 i) r$ B3 j9 j' k& B' P8 t: j* q2 P

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    知识该更新了。wan和lan区分是老古董了,现在的路由器所有口都是一样。  详情 回复 发表于 2025-9-19 13:59
    PCIe Switch for Cross Link Architecture  详情 回复 发表于 2025-9-19 13:25

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    13#
    发表于 2025-9-19 13:16 | 只看该作者
    狂羁青马 发表于 2025-9-19 09:521 P. R- x( u. o  n, t; w
    这有什么迷惑的呢,cpu跟cpu的通信和高速数据传输啊,只是没这样用过
    ! O1 n9 Z+ v- m- k0 J' L# Z0 x3 t
    PCIe Switch 應用方塊圖
      I$ T' n) `4 G7 R1 p" V
    9 ?! Z. @5 j# y- r3 R
    8 f( g0 `5 h) N3 o( l3 f9 P' B- e

    PCIe Switch.jpg (23.65 KB, 下载次数: 2729)

    PCIe Switch.jpg

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    这不还是一个主端口吗  详情 回复 发表于 2025-9-19 16:05

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    14#
    发表于 2025-9-19 13:25 | 只看该作者
    kuokuo250 发表于 2025-9-19 11:17& ]6 \% Z9 M& K! \
    交换机也只有一个上游端口啊,他要求是三个上游
    1 M: F4 v+ L; w0 Y/ K- i' K; V  n
    PCIe Switch for Cross Link Architecture
    % F/ s* Z7 ?1 u
    6 a$ j- K# W( K9 B, \" m
    0 J# q7 _; K  Y1 t/ r; ~/ c3 ]

    PCIe Switch for Cross Link Architecture.jpg (49.67 KB, 下载次数: 2723)

    PCIe Switch for Cross Link Architecture.jpg

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    補充資料: Multi-Host System and Intelligent I/O Design with PCI Express  详情 回复 发表于 2025-9-19 22:42
    補充資料: Multi-Host Sharing of NVMe Drives and GPUs Using PCIe Fabrics  详情 回复 发表于 2025-9-19 22:38
    用这种方案的成本不是一般酸爽。当时我们项目上要ssd和wifi6(pcie),开始也想搞Switch。最后放弃了,ssd改成sata3.0  发表于 2025-9-19 14:02

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    15#
    发表于 2025-9-19 13:59 | 只看该作者
    kuokuo250 发表于 2025-9-19 11:175 U+ o3 c7 h( m  l) X! {2 _! }( j5 g
    交换机也只有一个上游端口啊,他要求是三个上游
    ! M& q( `0 f4 ~0 p/ e- }
    知识该更新了。wan和lan区分是老古董了,现在的路由器所有口都是一样。
    / o, K- t. O! n9 I' M

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    沒辦法!他就設計了一個多主單從的爽架構。^_^  发表于 2025-9-19 17:40

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    16#
     楼主| 发表于 2025-9-19 16:05 | 只看该作者
    超級狗 发表于 2025-9-19 13:168 O/ ?- h$ n, Z; }! k
    PCIe Switch 應用方塊圖

    ; r0 e7 Q6 N/ C1 d这不还是一个主端口吗

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    参与人数 1威望 +5 收起 理由
    超級狗 + 5 是的!下一帖馬上神救援。

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    17#
     楼主| 发表于 2025-9-19 16:06 | 只看该作者
    huo_xing 发表于 2025-9-19 10:234 y2 A+ Q; }" n# o+ [9 w. a  K8 O
    和你家里的路由器一样。只是功能强大的价格估计比你cpu还贵,还有都是国外牌子
    5 g7 O" Z# P/ {6 J. T
    PEX8619可行吗
    6 y* V. q7 a0 @

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    大哥,抓重点啊。不是应该去和你们领导询问项目成本吗? 把这个switch很高的信息告诉领导,说不定你从这个坑爬出来了。一个高级点的成本估计1k+美刀。便宜的也要上百  详情 回复 发表于 2025-9-19 20:32
    十多年前用过,肯定不行。  详情 回复 发表于 2025-9-19 17:10
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    2025-11-21 15:00
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    18#
    发表于 2025-9-19 17:10 | 只看该作者
    狂羁青马 发表于 2025-9-19 16:06, N% a; E* _  H9 k
    PEX8619可行吗

    8 _+ w. x) x5 N1 W十多年前用过,肯定不行。
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