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生成网表出错

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发表于 2011-9-17 19:19 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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看了于博士的视频,想把某一页的原件快速放到pcb上,添加page 参数,设置page参数,按照视频上的 ,设置输出网表参数。/ J+ n2 c6 H- t  y
出错了。
# p( t, T% y+ z& h  s# T7 I   以前能够正常输出网表。  那个大侠能帮忙啊
3 M+ w; c) E( S9 e. _7 t9 P& O7 F   session log的内容如下:: |8 W+ t( I% s" v+ l# `) y( H4 p
Design Name:- i. l! ?4 N8 u5 q* D* C4 L$ r$ l9 G7 B
G:\lianxi\DSP\dsp.dsn# w4 ~# w$ h. {( H( h& S) ^# E. ?- D) _
Netlist Directory:& T1 D. Q# {0 q: i* t
G:\LIANXI\DSP\allegro_PAGE' ?0 W0 i5 d# A! Z7 n6 V2 a
Configuration File:/ b. w- O( r% m
D:\cadence\SPB_16.3\tools\capture\allegro.cfg$ w5 d) n! O% Z: }

& X3 Y5 g1 F$ C0 a% ?% FSpawning... "D:\Cadence\SPB_16.3\tools\capture\pstswp.exe" -pst -d "G:\lianxi\dsp\dsp.dsn" -n "G:\LIANXI\DSP\ALLEGRO_PAGE" -c "D:\Cadence\SPB_16.3\tools\capture\allegro.cfg" -v 3   -l 31 -s "" -j "PCB Footprint"
% `$ }/ O' j% X1 T8 Z  j" D' @#1 Warning [ALG0051] Pin "GND" is renamed to "GND#1" as visible power pin of same name already exists in Package AUDIO_RJ , J6: SCHEMATIC1, OPA_BUF (360.68, 53.34).
6 \  o$ c1 C# f# T' A& d4 W7 W7 V#2 Warning [ALG0051] Pin "GND" is renamed to "GND#6" as visible power pin of same name already exists in Package AUDIO_RJ , J6: SCHEMATIC1, OPA_BUF (360.68, 53.34).
. b5 }$ [4 A- R6 X( n( j#3 Warning [ALG0016] Part Name "SW PUSHBUTTON-DPST_RESET_DSP-RESET" is renamed to "SW PUSHBUTTON-DPST_RESET_DSP-RE".5 ]; n- g  m5 t# t4 |
#4 Warning [ALG0016] Part Name "TMS320C6713GDP_BGA272DSP_TMS320C6713GDP" is renamed to "TMS320C6713GDP_BGA272DSP_TMS320".
4 k& U; ~2 H3 W- {#5 Error   [ALG0013] Conflicting values of following Component Instance properties found on different sections of U6.! i+ Y# D- S/ _3 q
              PAGE7 D& N+ ?5 a1 Y7 p5 t( L( v9 c+ ?
#6 Error   [ALG0013] Conflicting values of following Component Instance properties found on different sections of U6.) T/ n; {$ d. u
              PAGE9 C$ ~% M/ \8 g$ M7 O3 i/ u. e
#7 Aborting Netlisting... Please correct the above errors and retry.6 e/ c. {0 N. t3 K2 s3 M8 ]' P- z
$ e0 r2 |; f# M6 a5 p
Exiting... "D:\Cadence\SPB_16.3\tools\capture\pstswp.exe" -pst -d "G:\lianxi\dsp\dsp.dsn" -n "G:\LIANXI\DSP\ALLEGRO_PAGE" -c "D:\Cadence\SPB_16.3\tools\capture\allegro.cfg" -v 3   -l 31 -s "" -j "PCB Footprint"
- y' K$ v0 D1 z, I* x- f: M7 G) v# |

; f4 _# \5 W% F4 _*** Done ***/ ^3 V( M; z+ L1 E2 S

该用户从未签到

2#
发表于 2011-9-17 19:45 | 只看该作者
U6不同部分发现相互冲突的元件实例属性?
( }' F* {; M& N7 \5 a# \2 G  H大概你是层次设计的吧?8 }8 J/ q2 y6 i- x' A9 `! e! w
我没用过层次设计,不大了解啊。
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