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楼主: dzwinner
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有没有人设计过4片DDR的?

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61#
发表于 2012-11-12 21:40 | 只看该作者
上八段 与下八段 中抽头

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62#
发表于 2012-11-12 21:45 | 只看该作者
原则性问题是先CLK 再数据 最后地址 有4块AM 原则上是最少孔数的 CLK优先级最高 两组与两级间误差因该不能超过DATASHEET手册数 否则想象下你左脚长右脚短 如果用在视频产品上就会出现严重的马赛克 以前画板时硬体工程师偏要那样要求 结果搞出来的PCB做出来就有这个问题 报废了100块板子

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63#
发表于 2012-11-13 14:56 | 只看该作者
我也在进行LPDDR2 PCB LAYOUT,学习。

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64#
发表于 2012-12-21 13:56 | 只看该作者
留名; % ?; q* u6 j$ t9 R; A5 x
  论坛里哪位老师,能开个关于DDR方面的课啊; / e, P2 z3 Z+ ^1 k- H9 [
那时应该会很火的喽,

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65#
发表于 2013-1-10 20:59 | 只看该作者
装B的人特别多,DDR走对称树叉型大把人知道,问题现在数码产品方案都用四层板,板子还特别小,知道怎么做也要有空间做再说吧!!地址线多点拓扑还要导什么狗P表格,PADS本来就能像ALLEGRO那样做到指定引脚对等长,不懂多学学去吧

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66#
发表于 2013-1-11 09:30 | 只看该作者
这个帖子的讨论很有分量,对新手有很大帮组

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67#
发表于 2013-1-11 10:10 | 只看该作者
学习了...
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