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楼主: dzwinner
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有没有人设计过4片DDR的?

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16#
发表于 2011-8-22 16:15 | 只看该作者
毒女 发表于 2011-8-22 14:57
; H$ ?+ c% k" m. O( i* J3 D: s我看到4个DDR  地址线走成是这样 就笑了.
$ ~& }9 W( d7 L) y3 W: l
啥意思?{:soso_e132:}

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17#
发表于 2011-8-22 17:03 | 只看该作者

# j4 w7 q" ^/ I: t. e 我借用上楼上的图,  大家不要看数字, 4个DDR 等长不是这样等长,要么在2个DDR 之间少一个过孔,要么就是多一个过孔. 我用了少一个过孔的方法,描述了4个DDR 同一根网的等长.  因图是借用上面的图,,所以大家不要看数字,看颜色就好啦$ r( ]% Y1 p0 N# e
) d4 D5 d5 b* ~/ Q
最左边的DDR长度等于:红色高亮+天蓝色长度+橘黄色
) u$ m- d4 I, ^9 A最左边的第2个DDR长度等于:红色高亮+天蓝色长度+草绿色                               
5 j6 L# k0 s4 i最上最的第4个DDR长度等于:红色高亮+粉红色长度+浅蓝长度               
' H9 i  g. ^8 F% u第3个DDR长度等于:红色高亮+粉红色长度+白色长度                                1 S( H! Z& ^( {$ v, {

点评

呵呵。。毒女不一般啊!我们是按照这种方式来走线的!方案公司也是这么要求的,说是要保证4颗DDR的平衡,在两两(DDR)之间要求尽量等长,那样可以同时到达CPU!  发表于 2011-9-5 09:37

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18#
发表于 2011-8-22 17:25 | 只看该作者
毒女 发表于 2011-8-22 17:03 6 [' o3 j# i( d8 h) |8 L# j
我借用上楼上的图,  大家不要看数字, 4个DDR 等长不是这样等长,要么在2个DDR 之间少一个过孔,要么就是多 ...

  v8 _6 C3 k, i0 \正解,要是再详细说下设置规则就完美了!!!

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19#
 楼主| 发表于 2011-8-22 18:03 | 只看该作者
毒女 发表于 2011-8-22 17:03
3 P1 ]: a" A2 a- c/ N我借用上楼上的图,  大家不要看数字, 4个DDR 等长不是这样等长,要么在2个DDR 之间少一个过孔,要么就是多 ...

1 j2 c9 h+ k4 Z" _& m这个我理解!不过在PADS里面涉及这样的等长很麻烦。特别是这一根和另一根等长的时候就更难搞!我现在在学candence 那个软件处理这个就方便多了,可以设置T点,长度也好控制。验证了那句话,PADS只适合中低端。高速电路板还是candence好用。

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20#
发表于 2011-8-22 23:55 | 只看该作者
dzwinner 发表于 2011-8-22 18:03
1 o: K4 O: |6 u这个我理解!不过在PADS里面涉及这样的等长很麻烦。特别是这一根和另一根等长的时候就更难搞!我现在在学 ...

9 |8 Z7 O5 o, L* x, o$ L9 M& S/ i好讽刺哦
: c# n1 D0 [6 |! Y6 c; u6 l( E 你既然理解,怎么还有那样的图呢 ; g6 A8 p# l8 G. v0 |- {
% A4 p) y' J& ~2 c/ }5 n! A: U
长度麻烦 那是走线的时候,没走好才会出现管脚对不是你想查的, 就算F5不好查,在ROUT里面 也有查走线 线断。 可以综合表格来,表格这个东西你懂吧填个数据自动求和,。无非就是地址线和控制线比较难测,也没有多少根, DDR 导表格 用半天时间也不过份吧。 也是对产品认真负责。

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21#
发表于 2011-8-23 09:58 | 只看该作者
长时间工作,这块4片DDR3的板子不出问题,就是奇迹,至于你信不信,我反正信了。

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22#
发表于 2011-8-23 10:39 | 只看该作者
lxizj 发表于 2011-8-16 16:24
+ d7 X& T$ Z( R& n+ m. Z2 y1.地址线你可以考虑做成 T+菊链的形式。我最近画的四片DDR的板子,就是这么做的。DDR1-DDR2-CPU-DDR3-DDR4。 ...
9 i7 J; j, n7 K* F6 }" f# S4 e
你这好像是telechips的demo。

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23#
发表于 2011-8-23 12:36 | 只看该作者
caiyongsheng 发表于 2011-8-23 09:58 - [& U9 w2 ~2 a7 {9 i8 ]8 C
长时间工作,这块4片DDR3的板子不出问题,就是奇迹,至于你信不信,我反正信了。

7 n# ]6 t, }6 Y. N- h8 B3 C呵,想知道这位朋友基于什么理由,判断这个片子长时间工作会出问题呢?
8 z6 R2 a7 y. g3 s是指拓扑结构吗?{:soso_e132:}

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24#
发表于 2011-8-23 12:40 | 只看该作者
毒女 发表于 2011-8-22 17:03
# H7 Z; I& ^. i& z& u; e# j我借用上楼上的图,  大家不要看数字, 4个DDR 等长不是这样等长,要么在2个DDR 之间少一个过孔,要么就是多 ...
9 \) ?- `0 \; d/ O, e, ]6 ]
看毒女解释时图片的打过孔位置,你画多片DDR用的是这种拓扑结构吗?7 U1 U  t1 S6 y0 o/ [: N% z

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25#
发表于 2011-8-24 09:31 | 只看该作者
lxizj 发表于 2011-8-23 12:36 $ Z; _* K4 I  i( \$ a& A
呵,想知道这位朋友基于什么理由,判断这个片子长时间工作会出问题呢?
, Q. X6 G* A9 I5 B2 Y是指拓扑结构吗?

" Y$ M; ^% ]! }$ [$ y* v: f是的,做DDR3,不要再停留在做DDR2的思想上了,原则性问题。

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26#
发表于 2011-8-24 19:55 | 只看该作者
设计过,星型布线

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27#
发表于 2011-8-25 09:28 | 只看该作者
caiyongsheng 发表于 2011-8-24 09:31 $ Z; _" `! v; o0 `7 o
是的,做DDR3,不要再停留在做DDR2的思想上了,原则性问题。

$ R5 e* S- L: H6 Ncaiyongsheng,我想请教两个问题。- d5 d' c5 e  U
1.  如下图的fly-by拓扑,在layout的时候,1.2.3.4部分分支线应该是尽可能的短是吗?# t7 q. T3 W! n0 W
2.  5.6.7三部分有没什么要求,比如等长之类的?
( q4 v/ g$ e* i8 }

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28#
发表于 2011-8-25 09:59 | 只看该作者
楼上7 X/ P# t$ n- Q* r. C# N
1,最好不要出现1,2,3,走线经过M1,M2,M3的焊盘最好。, u# u- r  r- I3 L
2,5,6,7当然要做等长,最好控制在100mil以内,元件到元件的线长最好不超过1inch。

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29#
发表于 2011-8-26 09:58 | 只看该作者
caiyongsheng 发表于 2011-8-25 09:59 * x# b# ^8 P7 ?0 U
楼上
/ }1 f# F& x7 O3 E1,最好不要出现1,2,3,走线经过M1,M2,M3的焊盘最好。) d& S& A) _6 Y% P3 d0 t. r: _  |, d
2,5,6,7当然要做等长,最好控制在100m ...
" w! P  Y$ R; j3 W. O4 F/ o  L* i9 }
受教了,有空我把板子改一版试试看性能,方便的话能不能帮我看看?

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30#
发表于 2011-8-27 00:38 | 只看该作者
楼上,OK
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