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楼主: liuyian2011
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关于多层板50欧姆及100欧姆阻抗结构设计!

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该用户从未签到

241#
发表于 2011-9-6 20:38 | 只看该作者
多谢分享~~

该用户从未签到

242#
发表于 2011-9-6 20:55 | 只看该作者
楼主, 多谢你的帮助. 附件是我要的10层板, 总的厚度希望是1.6mm.
9 s* i0 o: ]- p8 ]% y0 Y信号层有差分100ohm, 和单端50ohm,  因为有比较密的BGA, 所以我
, m+ u1 M7 h/ Q. M7 U* m& U  差分走线宽度4mil, 间距5mil.
; \5 s# A' x# ]* I$ E2 h; n   单端线宽4mil.4 Q5 n' @" N! a! l5 P3 @( }
这样的情况应该怎么叠比较好?   供应商给的建议都是间距比较大的, 这样在BGA里没法走线.8 x: J% Y# v; G) h) Z& h1 J

3 ^6 Y  \. F8 p. w! _- g  n另: 我用的材料都是FR4, 据说FR4会因为厚度不一样, 而介电常数不一样, 是这样的吗?$ v8 V& v" O6 ?( {0 ^
那介电常数该那么决定?

该用户从未签到

243#
发表于 2011-9-6 22:32 | 只看该作者
楼主还想请教一个问题, 在多层板中, 有些地方用core, 有些地方用p片, 这个有什么讲究吗?) S- }9 n: ?4 M% S4 @
比如上面图片的10层板, 1, 2层用core, 还是2, 3用core, 这个有什么不同?
; D, J8 @' L+ }" R6 [1 r5 c- F
+ H2 ]/ a1 x: m+ c2 g: S我的理解是, 比如1, 2层用core, 那么1, 2层之间的介质厚度是稳定的, 压合之前和压合之后介质厚度变化不大;
3 G9 m; f% l; ]1 F如果1, 2层之间用p片, 假如 2层是信号, 铜不多, 压合之后介质厚度可能变薄;
+ P# p2 Z7 l  |/ N7 O4 m, }( O我这样理解对吗?

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244#
 楼主| 发表于 2011-9-6 23:20 | 只看该作者
本帖最后由 liuyian2011 于 2011-9-6 23:26 编辑 " S6 F* ], [; p7 v. d
lmila 发表于 2011-9-6 20:55
4 ^: N* ^9 ~8 S; b楼主, 多谢你的帮助. 附件是我要的10层板, 总的厚度希望是1.6mm.
2 M7 S5 W; f( |, S9 n7 |/ Z信号层有差分100ohm, 和单端50ohm,  因为 ...

7 `& p2 W# D& W9 H
% G. ?) G$ D( m. X7 w5 C请问你这个10层板有哪些层需要控制50欧姆单端阻抗和100欧姆差分阻抗?一般普通FR-4的介电常数为:4.2-4.6 ,计算阻抗时通常认为PP的介电常数为:4.2,Core的介电常数为:4.5,不过介电常数对阻抗的影响比较小,介电常数为:4.2和4.5,其阻抗仅相差1欧姆左右.

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245#
 楼主| 发表于 2011-9-6 23:38 | 只看该作者
lmila 发表于 2011-9-6 22:32
, c2 {: ?% q" ^# T; E* \  |- p楼主还想请教一个问题, 在多层板中, 有些地方用core, 有些地方用p片, 这个有什么讲究吗?2 w$ W5 S: L$ e6 }( |9 U* l' K8 m) e
比如上面图片的10 ...

' w4 x; r% c5 C. a2 J/ F这是一个关于多层板压合的问题,多层板一般都是通过PP和Core叠压在一起.第一:如果第一,二层间采用PP,其所用的Core是4张;第二:如果第一,二层间采用Core,其所用的Core是5张. 这两种压合方式中第二种成本较高,所以PCB生产厂商一般都会采用第一种方案. 只是如果在板子有盲埋孔设计时才不得以采用第二种方案来压合。

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246#
发表于 2011-9-7 12:46 | 只看该作者
多谢!/ E# t- r3 h. n' f
) X" W) X* T( h# _( Y, E# B. Z
差分线在L3, L5, L6;
- X& e7 f+ b% s) P单端Top, L3, L5, L6, Bottom都有;8 F8 c- ~6 z" g* g' K
0 W& s6 h' S  O5 P1 O: {
搂住你太热心了。

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247#
发表于 2011-9-7 14:11 | 只看该作者
谢谢,非常好,学习下

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248#
发表于 2011-9-7 14:46 | 只看该作者
强烈建议楼主把6层HDI板阻抗图给出来。

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249#
 楼主| 发表于 2011-9-7 15:05 | 只看该作者
Shan 发表于 2011-9-7 14:46 2 {+ z1 P' O8 [- w$ Z
强烈建议楼主把6层HDI板阻抗图给出来。

! e( H+ F" q  b0 n# C6 w没有问题啊,有空我把6层一阶和二阶HDI板阻抗设计及结构方案给大家总结出来吧!

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250#
发表于 2011-9-7 21:07 | 只看该作者
谢谢!

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251#
发表于 2011-9-8 08:28 | 只看该作者
多谢分享, 学习了

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252#
发表于 2011-9-8 14:33 | 只看该作者
今天第一次发了个六层板到工厂,人家问我做不做阻抗?我说不用,会不会有问题呢?

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253#
 楼主| 发表于 2011-9-8 15:21 | 只看该作者
dddlllyyy 发表于 2011-9-8 14:33
. {8 n% Y5 [. g  z" `  j4 c: v( t今天第一次发了个六层板到工厂,人家问我做不做阻抗?我说不用,会不会有问题呢?
5 b) ~; q0 f0 |$ e- a
很可能有问题,因为你没有阻抗和层压结构的要求,人家会随意弄一个层压结构给你,可不一定符合你的阻抗设计喔!

该用户从未签到

254#
发表于 2011-9-8 16:03 | 只看该作者
看看

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255#
发表于 2011-9-9 18:05 | 只看该作者
电源层呢?
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