DDR地址线创建port时，报错

wux · 发表于 2021-8-24 15:10

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在用POWER SI工具进行频域仿真时，产生如下问题，在此求教。
1.地址线后端有上拉电阻时输出port时报错？错误见图片。(此处只选择了两根地址线，错误应该是和上拉电阻有关）

2.对下图中的DDR时钟线如何建立port?

mellifluous · 发表于 2021-8-24 17:23

1、上拉电阻的问题

diff · 发表于 2022-4-21 15:06

电阻赋值，接电源的加port

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