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2017年7月19日公益PCB评审报告节选

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1#
发表于 2017-7-20 08:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.  音频模拟线加粗走类差分.! [0 i7 c0 D/ p; C' @
4 H0 m5 ~9 H0 f- p

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发表于 2017-7-25 09:28 | 只看该作者
junieya 发表于 2017-7-24 16:32
# z" S, @' S0 o. ?7 P3 g请问这条如何理解? pcb小白求教
9 I1 l: R( \) J$ h; F0 }$ o
1.平面铜只有一个VIA,肯定的说这块铜没有作用.
0 `. h5 n1 K0 o' s2.电源被VIA隔小了,电源通路太细.

, F& h+ W" g3 Z4 Z/ Q# P( C) ^. Z- }, i

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发表于 2017-7-24 16:32 | 只看该作者
EDA365QA 发表于 2017-7-20 08:58) Q) y0 I  w; l. T$ N' V
10.  平面铜只有一个VIA,电源被VIA隔小了.

& I2 C: f( y% B% \请问这条如何理解? pcb小白求教
  J% z7 _( G/ G& \: ]4 q) a

点评

pcb
1.平面铜只有一个VIA,肯定的说这块铜没有作用. 2.电源被VIA隔小了,电源通路太细.[/backcolor]  详情 回复 发表于 2017-7-25 09:28

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 楼主| 发表于 2017-7-20 08:56 | 只看该作者
7.  天线部分加粗控50OHM,陶瓷天下要挖空按DATASHEET处理.
; x4 }8 k9 M% O: r: Y 8 m$ u: X7 k0 w5 t5 o! Z8 N

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2#
 楼主| 发表于 2017-7-20 08:52 | 只看该作者
2.  信号线应走阻抗线.3 _* s4 ~9 z: _' Q0 j; h- |
0 ?0 {  O9 \9 h9 d4 E5 T2 k, u) A

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3#
 楼主| 发表于 2017-7-20 08:53 | 只看该作者
3.  ESD应靠近接口.' ]' \2 N  P6 W

) p9 X7 a$ a; ?( Y5 |

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4#
 楼主| 发表于 2017-7-20 08:54 | 只看该作者
4.  电源PIN脚加宽.9 G& M1 D( M8 z; P
) t$ `) j1 {- L& ^$ u& }/ a+ ^! ]8 O

该用户从未签到

5#
 楼主| 发表于 2017-7-20 08:55 | 只看该作者
5.  带变压器的网口下挖空处理.
0 |& {8 Y4 i  }' K " ^- e2 N: B. B7 H' B

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6#
 楼主| 发表于 2017-7-20 08:55 | 只看该作者
6.  晶体电容不要放后面出现残端.
* Q8 a! a, S( {9 |
( C7 O  \3 }; m5 n$ Q7 V

点评

啥意思?没看懂  详情 回复 发表于 2017-11-4 11:27

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8#
 楼主| 发表于 2017-7-20 08:57 | 只看该作者
8.  升压电路应缩小回流路径.
/ r0 J/ l4 r( o( f
( S5 f' P1 J* V1 m

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9#
 楼主| 发表于 2017-7-20 08:57 | 只看该作者
9.  有线在挖空区.! R7 `7 b$ U/ m  `& Q' e0 W
2 S. ]' _; @$ \: P$ G9 s

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10#
 楼主| 发表于 2017-7-20 08:58 | 只看该作者
10.  平面铜只有一个VIA,电源被VIA隔小了.1 `( w4 h: [7 d4 h+ f% d

  t( P/ ^) T; c) j4 @) ]4 l

点评

请问这条如何理解? pcb小白求教  详情 回复 发表于 2017-7-24 16:32

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13#
发表于 2017-7-20 17:47 | 只看该作者
厉害,啥时候才能有QA的水平啊# X! {2 Z  d) _: h: J7 E
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