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allegro 16.6 导入网表,PSM/PAD/DRA文件齐全,仍然提示一下错误

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发表于 2015-4-15 20:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 fangxiaoyan 于 2015-4-16 20:34 编辑
) t; H, q2 m6 S" a
& O, Z5 ]5 T1 m( K4 S$ R如题,allegro  16.6 导入网表出错,调用别人的封装,错误信息如图1.
- |+ B3 C& H" S/ _! u  l# L; o+ J: E
: N. j  `2 b" U; @- b  提示封装的引脚缺失,共有10个元件的封装: W  x0 ?% P5 }# U3 ^8 v
0 L8 I7 A" }6 I6 ]+ `3 ~0 z
打开其中一个DRA文件,发现缺少引脚,如图2所示* C' D! S3 x0 Z9 T: @7 c# j; p
! s: J7 D. j" p* K: l. Z4 y# d
& m7 v9 o3 `# L
这个封装文件在别人的电脑上可用,不缺引脚,而且PSM/PAD/DRA文件齐全,为啥调用过来出现这种错误?# U' H  D/ [& N! l8 V; o, p
) y# g, O9 ^2 E) z& u1 R2 L, B

' u$ K2 _9 |& n2 W5 @2 g6 Y; B, R请问除了重画封装,补上引脚,有没有其他方法?
& y4 w3 T/ Q( @" v; v

DST导入网表报错.png (25.14 KB, 下载次数: 15)

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DRA引脚缺失.jpg (55.36 KB, 下载次数: 20)

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 楼主| 发表于 2015-4-17 18:11 | 只看该作者
dzkcool 发表于 2015-4-17 09:26
# L& s9 Q" J9 \, s4 Gdra文件里面要有焊盘才行。1 `* m5 U. O0 [) B( \( G2 q
你从别人的板子上导出封装之前,把封装库路径(尤其是PadPath)设置到板子所在目 ...
4 p! p  `- H( [# c/ E3 Z" q
导出封装成功,可以看到FPC_10_0_5M  正常 ,图1.
& p, \4 Y" k6 Z) P
- W8 l; m' K  F2 s  _回看原理图这个元件,图2,图1和图2引脚一致,
; E# T/ e' _. a6 o& z- W1 |) ]+ Z; Y0 g3 Z) E$ g" G( {

# x* T0 G' H  y" \4 a9 v" @& w但导入网表时提示[size=14.3999996185303px]FPC_10_0_5M[size=14.3999996185303px] 缺少引脚,图3
* }9 @/ Q' W# ^[size=14.3999996185303px]
' z5 Y& Y/ E6 t5 t4 L- o- P2 R$ A5 J5 i$ z
[size=14.3999996185303px]8 [/ y  q0 @. K# }! ?0 q# p

2 f1 A' c9 ?9 h& U' @* ^" H[size=14.3999996185303px]编辑原理图的这个元件,并没有看'UART'脚。
' P5 D( m/ ]2 E! }
) h* g' q0 j) r1 `; J4 }0 b# k9 c3 L' q1 H# R  }: M
封装重画,原理图这个元件重画,仍然有这个错误。1 M& o2 L+ r. u4 n/ f( {8 L4 p: N

" G: I1 `. n) @/ b0 P) h7 v; N& i" z5 p; D
求教!
( ]. `4 _: l( M0 O5 P, Q3 T: U

导出封装FPC.png (7.49 KB, 下载次数: 20)

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原理图FPC.png (21.46 KB, 下载次数: 15)

原理图FPC.png

NET错.png (16.01 KB, 下载次数: 15)

NET错.png

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 楼主| 发表于 2015-4-21 17:32 | 只看该作者
dzkcool 发表于 2015-4-21 13:059 H3 ]5 @- ]7 K# P+ R7 t
我没做任何改动,只是导入了一下网表,没发现什么问题。

  ?' I- z0 t: z. ]6 N- a: c我这边生成网表无错,导入的时候提示上述ERROR 。以OTHER的方式导入,ERROR中涉及的3个PART不能放置到板框内,其他的元件可以放置。: E& B1 e: o5 d) C+ t9 ]% w

) n* H" K" n- ?4 j  K2 y跟生产网表/导入网表的设置有关么?
) l! I: V) }: c7 H( y, L* @6 W$ R

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我直接用第一方导入,没任何问题。  详情 回复 发表于 2015-4-21 17:53
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    发表于 2015-4-22 10:37 | 只看该作者
    fangxiaoyan 发表于 2015-4-22 09:439 @1 j, m, A! G) z+ r% O8 V& e
    现在是不是可以一个个排除   1.生成网表时的选项有关  2电脑的环境。pads 与allegro 可以共存啊。奇怪了 ...
    1 B8 j  O3 W7 p* U
    估计跟1、2有关。% }4 @0 M; t7 d4 }" h$ G4 h7 M
    实在看不下去了,大哥,你才是楼主,不要老是称呼我是楼主
    + l% G9 V9 K5 G5 Z+ N! h6 h9 |1 q* o$ a

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    恩,学习了。“楼主”是女子。刚毕业,做项目管理。不懂的很多,别见怪哈。  详情 回复 发表于 2015-4-22 13:45

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    2#
     楼主| 发表于 2015-4-16 20:32 | 只看该作者
    没人知道么,还是问题太幼稚了?
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    3#
    发表于 2015-4-17 09:26 | 只看该作者
    dra文件里面要有焊盘才行。
    2 v# X6 Q$ D1 U0 V你从别人的板子上导出封装之前,把封装库路径(尤其是PadPath)设置到板子所在目录下,然后再导出封装。

    点评

    导出封装成功,可以看到FPC_10_0_5M 正常 ,图1. 回看原理图这个元件,图2,图1和图2引脚一致, 但导入网表时提示FPC_10_0_5M 缺少引脚,图3 编辑原理图的这个元件,并没有看'UART'脚。 封装  详情 回复 发表于 2015-4-17 18:11
    同事直接发的封装文件。现在打算重新从同事的板子导出,再试下。  详情 回复 发表于 2015-4-17 10:35

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    4#
     楼主| 发表于 2015-4-17 10:35 | 只看该作者
    dzkcool 发表于 2015-4-17 09:26
    8 M, K4 |1 C# {5 z& b4 r' Sdra文件里面要有焊盘才行。
    ! {$ W- h, _9 K; L* Q: o你从别人的板子上导出封装之前,把封装库路径(尤其是PadPath)设置到板子所在目 ...
    9 B& C; Z3 T+ F, Q) L! H0 l& K, W
    同事直接发的封装文件。现在打算重新从同事的板子导出,再试下。" R6 T6 d( g. k- v. }$ H
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    6#
    发表于 2015-4-21 08:26 | 只看该作者
    原理图上有其他元件用到FPC_10_0_5M这个封装吗?每个都要看下。% C" k2 w% u$ r
    如果没问题,把原理图和封装放上来看看吧。

    点评

    检查完毕,没有其他元件用到这个封装  详情 回复 发表于 2015-4-21 10:15

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    7#
     楼主| 发表于 2015-4-21 10:15 | 只看该作者
    dzkcool 发表于 2015-4-21 08:26' o: N+ B/ I7 n- |/ k! ~
    原理图上有其他元件用到FPC_10_0_5M这个封装吗?每个都要看下。
    9 l8 z$ c# g" `6 i3 w如果没问题,把原理图和封装放上来看看吧 ...

    ( o& I' ^( J% V检查完毕,没有其他元件用到这个封装- k1 s, N+ d- w

    DEBUG_BOARD_0523P1.rar

    30.08 KB, 下载次数: 6, 下载积分: 威望 -5

    原理图

    FT232.rar

    19.47 KB, 下载次数: 5, 下载积分: 威望 -5

    BRD文件

    lib.rar

    257.69 KB, 下载次数: 5, 下载积分: 威望 -5

    库文件

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    我没做任何改动,只是导入了一下网表,没发现什么问题。  详情 回复 发表于 2015-4-21 13:05
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    发表于 2015-4-21 13:05 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 10:15
      T0 Q3 `- ^0 N& t# K; M0 }9 x检查完毕,没有其他元件用到这个封装
    ( p/ D4 ]/ m8 P+ g
    我没做任何改动,只是导入了一下网表,没发现什么问题。  X1 \. a  C" u* D- T
    FT232-eda365.rar (43.18 KB, 下载次数: 2) - P. \6 r3 Z- v! x# `2 ^  [

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    我这边生成网表无错,导入的时候提示上述ERROR 。以OTHER的方式导入,ERROR中涉及的3个PART不能放置到板框内,其他的元件可以放置。 跟生产网表/导入网表的设置有关么?  详情 回复 发表于 2015-4-21 17:32
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    发表于 2015-4-21 17:53 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 17:32
    ) E$ W& `$ J8 Z0 s2 `5 q& T6 Y我这边生成网表无错,导入的时候提示上述ERROR 。以OTHER的方式导入,ERROR中涉及的3个PART不能放置到板 ...

    , F( k$ |/ K/ N! n2 B我直接用第一方导入,没任何问题。7 P/ M3 C9 j( F3 e5 O- k

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    那找不出问题的原因了。  详情 回复 发表于 2015-4-21 19:06

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    11#
     楼主| 发表于 2015-4-21 19:06 | 只看该作者
    dzkcool 发表于 2015-4-21 17:53$ B3 X. K+ q4 x; [1 W$ y
    我直接用第一方导入,没任何问题。

    . J& T1 G" W7 H+ B& e: |那找不出问题的原因了。( H/ _/ ?" i* a$ @! j% a" ~7 T  z

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    你在我导入的PCB上再重新导入一下网表呢?  详情 回复 发表于 2015-4-21 19:08
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    发表于 2015-4-21 19:08 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 19:06
    ! [, |/ \  P, u0 @+ E那找不出问题的原因了。
    + Z( i4 g# i) E) M4 U5 R
    你在我导入的PCB上再重新导入一下网表呢?6 d$ |- O& p! _& }) z9 w3 a

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    导入的选项如图1, 导入报错如图2,  详情 回复 发表于 2015-4-21 19:21
    需要先导出网表,再重新导入网表?  详情 回复 发表于 2015-4-21 19:15

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    13#
     楼主| 发表于 2015-4-21 19:15 | 只看该作者
    dzkcool 发表于 2015-4-21 19:08) v. k3 r, J* r
    你在我导入的PCB上再重新导入一下网表呢?
    ( v0 L. X; l. C0 l9 o
    需要先导出网表,再重新导入网表?

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    先从你的原理图中导出网表,再用我的brd导入网表。  详情 回复 发表于 2015-4-21 19:17
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    发表于 2015-4-21 19:17 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 19:15* |# H9 p2 \% d$ X: ^. [3 N
    需要先导出网表,再重新导入网表?

      g$ W/ |. i: z" a( y先从你的原理图中导出网表,再用我的brd导入网表。: i: z* f) I& Y) T# T: ^

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    楼主,以第三方的方式导入你的PCB,OK.  详情 回复 发表于 2015-4-21 19:24

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    15#
     楼主| 发表于 2015-4-21 19:21 | 只看该作者
    dzkcool 发表于 2015-4-21 19:08
    9 A8 D* w* i- e) o; `你在我导入的PCB上再重新导入一下网表呢?

    $ n( p8 Y% `- r6 R. ]: U1 Z8 i导入的选项如图1,2 X6 B1 f: b/ \% j( v+ X& ?

    4 k& o1 S0 s: ^" o* p& K2 ]! L导入报错如图2,
    6 b* A' c6 I$ S& |/ w

    导入配置.png (55.33 KB, 下载次数: 15)

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    导入报错.png (23.8 KB, 下载次数: 24)

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    太诡异了,我出的网表中根本就没有你截图的这个device信息。  详情 回复 发表于 2015-4-21 19:53
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