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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › allegro 16.6 导入网表,PSM/PAD/DRA文件齐全，仍然提示 ...
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allegro 16.6 导入网表,PSM/PAD/DRA文件齐全，仍然提示一下错误

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fangxiaoyan

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发表于 2015-4-15 20:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 fangxiaoyan 于 2015-4-16 20:34 编辑
9 _9 ~/ X4 Q  V. H1 O  {$ t
1 a/ J  Z4 ~  T3 f2 F# `* I如题，allegro  16.6 导入网表出错，调用别人的封装，错误信息如图1.$ V) |0 f  Y! K# {" b5 ^
$ g) j8 R9 ?8 ?
  提示封装的引脚缺失，共有10个元件的封装
9 C9 O' F$ T8 S% ^( P
1 {0 R, k& @7 H6 S& z; L打开其中一个DRA文件，发现缺少引脚，如图2所示
2 q$ L4 R; {5 S+ x- `3 y+ H( F$ d) [- w( i5 O! i: I" q
! u: A3 I1 o, p# W; F: S' s# C) z
这个封装文件在别人的电脑上可用，不缺引脚，而且PSM/PAD/DRA文件齐全，为啥调用过来出现这种错误？
& u$ |! O; p" O6 B7 K, J
) x) ^8 R. J% b6 d4 t' e: o0 y& E0 O) ^" a6 ~7 B
请问除了重画封装，补上引脚，有没有其他方法？  H& v$ J' P2 U3 V

DST导入网表报错.png (25.14 KB, 下载次数: 3)

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DRA引脚缺失.jpg (55.36 KB, 下载次数: 8)

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 楼主| 发表于 2015-4-17 18:11 | 只看该作者
dzkcool 发表于 2015-4-17 09:269 m2 L5 |" d4 J% ^
dra文件里面要有焊盘才行。2 g, Q0 m) @8 ^2 O$ J4 p
你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目 ...
1 b& C! h; L9 |
导出封装成功，可以看到FPC_10_0_5M  正常 ，图1.
5 i7 r5 Y, W- }6 W. k
$ n7 d2 i: Y" i+ x. l回看原理图这个元件，图2，图1和图2引脚一致，* z0 _1 {! r: _8 e. S# Y2 O

5 _1 {+ a. f8 r" h7 t. z$ i
: J, O. f# H3 B2 e9 Q3 k, U. H但导入网表时提示[size=14.3999996185303px]FPC_10_0_5M[size=14.3999996185303px] 缺少引脚，图3
# n8 I4 i& U: U% V1 D% G  Y[size=14.3999996185303px]. K: K( d/ C! `3 S

" _5 U& {3 g1 O[size=14.3999996185303px]1 _" ]0 C* y2 n! X

  N  P" q* \7 H0 W9 E) i) B[size=14.3999996185303px]编辑原理图的这个元件，并没有看'UART'脚。
  C8 @2 U3 Z2 V" F- s- d  H1 p4 {7 V$ ?/ {3 }- l

. r* B8 W8 f% W8 |" w封装重画，原理图这个元件重画，仍然有这个错误。' W% U$ a& q* G( p% b

/ }; `7 ?5 V+ n, n; A( r3 o/ i
' k$ Q/ O& p% F4 k  N求教！2 R& d! `4 a0 d9 h; O/ Y, g: \

导出封装FPC.png (7.49 KB, 下载次数: 9)

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原理图FPC.png (21.46 KB, 下载次数: 3)

原理图FPC.png

NET错.png (16.01 KB, 下载次数: 2)

NET错.png

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 楼主| 发表于 2015-4-21 17:32 | 只看该作者
dzkcool 发表于 2015-4-21 13:05
! V6 C% T; X! k( P0 |我没做任何改动，只是导入了一下网表，没发现什么问题。
. o2 [+ ~- y, \: K; g+ T
我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板框内，其他的元件可以放置。8 Y0 C- }" i' Q( i& P
  I, x# Q# N; I& K1 \. v; \
跟生产网表/导入网表的设置有关么？
  O! d" V+ `9 V( R- H

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dzkcool
我直接用第一方导入，没任何问题。  详情 回复 发表于 2015-4-21 17:53

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    发表于 2015-4-22 10:37 | 只看该作者
    fangxiaoyan 发表于 2015-4-22 09:43+ c# K/ [+ i0 U. d: Q+ K6 e* }
    现在是不是可以一个个排除   1.生成网表时的选项有关  2电脑的环境。pads 与allegro 可以共存啊。奇怪了 ...

      T5 u* |- e1 k0 l+ @+ P/ E2 a估计跟1、2有关。
    % e. D, m2 f- Y& w实在看不下去了，大哥，你才是楼主，不要老是称呼我是楼主% M+ R- Q/ J% f' t# u

    ) p% O# D$ ]3 g4 k8 \. O7 P

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    fangxiaoyan
    恩，学习了。“楼主”是女子。刚毕业，做项目管理。不懂的很多，别见怪哈。  详情 回复 发表于 2015-4-22 13:45

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    fangxiaoyan

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    2#
     楼主| 发表于 2015-4-16 20:32 | 只看该作者
    没人知道么，还是问题太幼稚了？

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    [LV.8]以坛为家I
    3#
    发表于 2015-4-17 09:26 | 只看该作者
    dra文件里面要有焊盘才行。7 }' y& l: z+ R, ^% L9 V8 C! [
    你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目录下，然后再导出封装。

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    fangxiaoyan
    导出封装成功，可以看到FPC_10_0_5M 正常 ，图1. 回看原理图这个元件，图2，图1和图2引脚一致， 但导入网表时提示FPC_10_0_5M 缺少引脚，图3 编辑原理图的这个元件，并没有看'UART'脚。 封装  详情 回复 发表于 2015-4-17 18:11
    fangxiaoyan
    同事直接发的封装文件。现在打算重新从同事的板子导出，再试下。  详情 回复 发表于 2015-4-17 10:35

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    4#
     楼主| 发表于 2015-4-17 10:35 | 只看该作者
    dzkcool 发表于 2015-4-17 09:26" Y7 O) q. A7 ^" u0 A! b: H
    dra文件里面要有焊盘才行。* u$ g, \0 o4 [/ E) j% x5 g
    你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目 ...

    . x% G0 D* y# ^8 R  t( B同事直接发的封装文件。现在打算重新从同事的板子导出，再试下。
    : S& K) D2 o; _5 I6 D! k

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    6#
    发表于 2015-4-21 08:26 | 只看该作者
    原理图上有其他元件用到FPC_10_0_5M这个封装吗？每个都要看下。% e4 Y" `9 J  R0 v
    如果没问题，把原理图和封装放上来看看吧。

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    fangxiaoyan
    检查完毕，没有其他元件用到这个封装  详情 回复 发表于 2015-4-21 10:15

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    7#
     楼主| 发表于 2015-4-21 10:15 | 只看该作者
    dzkcool 发表于 2015-4-21 08:26
      N8 J* M# _; H* x! @2 \原理图上有其他元件用到FPC_10_0_5M这个封装吗？每个都要看下。  h# X+ r& \( u2 c
    如果没问题，把原理图和封装放上来看看吧 ...
    5 P5 |5 v& y$ [. t* W
    检查完毕，没有其他元件用到这个封装! j9 s  C- P! C+ i! @1 v/ L

    DEBUG_BOARD_0523P1.rar

    30.08 KB, 下载次数: 6, 下载积分: 威望 -5

    原理图

    FT232.rar

    19.47 KB, 下载次数: 5, 下载积分: 威望 -5

    BRD文件

    lib.rar

    257.69 KB, 下载次数: 5, 下载积分: 威望 -5

    库文件

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    我没做任何改动，只是导入了一下网表，没发现什么问题。  详情 回复 发表于 2015-4-21 13:05

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    发表于 2015-4-21 13:05 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 10:15
    . g' l8 U- K% C" }- z5 h检查完毕，没有其他元件用到这个封装
    6 s: K- g- J6 d6 Z; t7 ~0 T3 \, O
    我没做任何改动，只是导入了一下网表，没发现什么问题。
    + ^3 X) O' ~: N+ H& P FT232-eda365.rar (43.18 KB, 下载次数: 2) " c* A+ ^; N3 y

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    我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板框内，其他的元件可以放置。 跟生产网表/导入网表的设置有关么？  详情 回复 发表于 2015-4-21 17:32

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    发表于 2015-4-21 17:53 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 17:322 o* z8 m, v2 t
    我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板 ...

    ; ~- D4 c, ?" m我直接用第一方导入，没任何问题。9 K% E& g; M# g

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    fangxiaoyan
    那找不出问题的原因了。  详情 回复 发表于 2015-4-21 19:06

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     楼主| 发表于 2015-4-21 19:06 | 只看该作者
    dzkcool 发表于 2015-4-21 17:53
    % K8 r5 R0 o2 C$ e% Q6 R2 b4 r我直接用第一方导入，没任何问题。

    & p  T* E9 i: l0 \3 z1 ]. R那找不出问题的原因了。. O" I+ n/ f/ T5 W3 \" Y

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    dzkcool
    你在我导入的PCB上再重新导入一下网表呢？  详情 回复 发表于 2015-4-21 19:08

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    发表于 2015-4-21 19:08 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 19:063 z0 m* I; j% }* Z. F! w. r) s3 w
    那找不出问题的原因了。
    ( l, Z& s! c: W' D" n
    你在我导入的PCB上再重新导入一下网表呢？; a! C  B8 @# B5 `7 x9 Z( c

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    fangxiaoyan
    导入的选项如图1， 导入报错如图2，  详情 回复 发表于 2015-4-21 19:21
    fangxiaoyan
    需要先导出网表，再重新导入网表？  详情 回复 发表于 2015-4-21 19:15

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     楼主| 发表于 2015-4-21 19:15 | 只看该作者
    dzkcool 发表于 2015-4-21 19:08! D2 q* t% ?1 J/ {" o7 h' B8 ]
    你在我导入的PCB上再重新导入一下网表呢？

    . W4 r0 ~' o2 f, b- b7 B% B6 }需要先导出网表，再重新导入网表？

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    dzkcool
    先从你的原理图中导出网表，再用我的brd导入网表。  详情 回复 发表于 2015-4-21 19:17

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    发表于 2015-4-21 19:17 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 19:15
    2 o' D6 }0 P/ Y9 ^" Q需要先导出网表，再重新导入网表？

    6 `/ @+ L% \# {% k先从你的原理图中导出网表，再用我的brd导入网表。% |' n) u( x% W- P

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    fangxiaoyan
    楼主，以第三方的方式导入你的PCB，OK.  详情 回复 发表于 2015-4-21 19:24

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    fangxiaoyan

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    15#
     楼主| 发表于 2015-4-21 19:21 | 只看该作者
    dzkcool 发表于 2015-4-21 19:08
    1 Y' Y" u* g6 Y: l你在我导入的PCB上再重新导入一下网表呢？
    2 c9 a7 x0 y& ]
    导入的选项如图1，
    * ?8 C* z4 L9 P6 d
    * y! \+ p. E6 n" ~, o导入报错如图2，
    7 ]0 S1 |) l' }

    导入配置.png (55.33 KB, 下载次数: 4)

    1

    1

    导入报错.png (23.8 KB, 下载次数: 12)

    2

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    dzkcool
    太诡异了，我出的网表中根本就没有你截图的这个device信息。  详情 回复 发表于 2015-4-21 19:53

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