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ARM+DDR六层PCB,附件是原图,请高手前来指点!!

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发表于 2014-8-2 22:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 w5555456 于 2014-8-2 22:32 编辑 9 q. |/ X: Z' c: [
' n3 a" Z( _+ i! Y. M" |- o& F" m
描述:: i8 F! l+ f1 K1 G
        1、数据线和DQS均走在TOP和Mid1。长度误差150Mil。" a+ J1 _' g; S! L$ H* Q; [  b
        2、地址和控制线走在TOP、Mid2、Bottom,拓扑结构为T形分支等长,CPU分别到两片DDR的长度误差300mil。
( l  v2 g- L% E& e1 a/ X        3、时钟线从TOP换到Mid1,阻抗100欧。' k  ?' U- a& ?( ]3 Q
        4、DDR的1.8V走在了Mid2,VCC层主要铺3.3V(给Mid2层的信号提供返回路径)。3 v6 T8 P/ r0 @
        5、信号线宽4mil,间距3mil(BGA区域)/4mil(其他区域),BGA区域内的信号线都采用盲孔设计。  s" S1 y  |6 t% |7 j: ]
        6、PCB中大部分无关的电路我都删了,CPU还有几个电源没有布,不过DDR相关的基本都弄完了。+ F/ Z  [' {' O, D+ A$ F! O2 {
        7、所用软件,altium Designer 10.0

" L) c8 [+ i4 s$ L& ^) m7 ?8 l5 j- ?) q# V5 ^) M0 {; o
PS:CPU的引脚间距是0.5mm的,过孔用的6/11.8mil,而且到焊盘的距离只有3mil,这样做出来板子焊接时是否会导致短路?有没有改善措施?
. E4 X% q( E! j7 ?5 o
) p# b1 x% R  H6 J9 q# r

# s/ e* i* Q5 z* k  b热烈欢迎各路高手前来指导!谢谢!!!

DDR_XXX.zip

8.97 MB, 阅读权限: 9, 下载次数: 909, 下载积分: 威望 -5

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 楼主| 发表于 2014-8-18 21:40 | 只看该作者
本帖最后由 w5555456 于 2014-8-18 21:42 编辑 5 H- F* T9 x) v5 Z. g' w" z  @
kangguolong 发表于 2014-8-18 16:48( l; A0 x$ r1 [6 a
这个板子还有需要优化的地方,板子可以不用盲埋孔工艺,这样加工成本会成倍的增加,差分等长绕的有问题,需 ...

) n& q  n* M# r% ?! N! J5 C* k5 D3 h' D4 p$ U8 p, X, E8 U
非常感谢这位兄台的点评!" [: |' C* X1 N2 v* h) O
1、盲埋孔已经去掉了,直接6层的通孔,勉强画出来了,不过电源走的不大好(用盲孔的话总成本会增加大概60%的样子,而且制作难度大了很多)。9 w4 `$ ^. _" I: Y% h4 l$ c, B- G
2、差分时钟线绕成了下图所示:
+ O/ @- n+ J2 J' d# S: W) I 6 |" T% U9 D3 b& u, j) C
3、差分阻抗控制100欧左右,3.5/9.5mil。据我的了解,差分对紧密耦合是为了提高抗干扰能力,如果太过紧密,两根线之间的相互耦合会对信号边沿产生影响,所以选了这个间距。某些芯片厂商的Layout Guide也建议间距不要过小。
& y% S' M) b, a6 F) d" B) h4、数据线我基本都走在了Midlayer1,我用的1W原则,3W空间不够。
# M$ c! `/ t5 X7 p; h; s8 o
+ D& Z4 S% q3 l; i
! }. ^3 E$ E$ I
- O5 _: D2 ~7 _8 A8 e+ D) [  D
, t- J# W, c% d. g
/ d; C) R  d2 |* m$ T. N

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 楼主| 发表于 2014-8-18 21:24 | 只看该作者
本帖最后由 w5555456 于 2014-8-19 21:45 编辑 / @7 D6 U- v; S
zgq800712 发表于 2014-8-17 11:161 t( N5 [1 D4 `0 N* ~
这个板子 走线进BGA 0.083mm,其他线0.102mm。过孔 0.152mm/0.3mm) \; U7 ^1 u6 a" a% c- S
2 ?" x; H4 u4 A1 V" k/ T
这个板子要什么工艺?打样贵吗?

6 w& p6 _( e4 p0 ], n7 v- q
# o3 s- K3 G6 o9 v一般的工艺就能做出来,6mil的孔是可以不用激光打的。0 U& a. y1 g' b' y- J
今天刚投的板,大概240*180的板子,六层,打样3000左右,五块。
3 s8 G) g) I; _1 E5 j" W4 J5 X在深圳迅捷兴做的,有需要我给你他们销售的联系方式。

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发表于 2014-8-18 16:48 | 只看该作者
这个板子还有需要优化的地方,板子可以不用盲埋孔工艺,这样加工成本会成倍的增加,差分等长绕的有问题,需要调整,不知道差分有没有做阻抗控制,差分线间距过大!另外数据线每一组走线应该遵循同组同层的走法,线 与 线的部分区域间距还是不够3W!还有一些其它的小问题,还需优化。

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2#
 楼主| 发表于 2014-8-4 21:24 | 只看该作者
帖子都好几天了,各路好汉都去哪了???:Q:Q

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3#
发表于 2014-8-5 13:19 | 只看该作者
打开了,看不到东西

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4#
 楼主| 发表于 2014-8-5 21:52 | 只看该作者
zgq800712 发表于 2014-8-5 13:19) p4 w0 ?  b* k) @- X( q# e) N6 [
打开了,看不到东西
5 \$ s+ T- w% w+ t0 v
我的软件版本是AD10.0,应该09及以上的打开都没有问题。- V% Z5 x* v/ J/ }; b
试试工具栏的View—Fit Board功能,快捷键V+F

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6#
发表于 2014-8-6 08:46 | 只看该作者
走得挺漂亮,但是感觉线走得有点多,我看到过,在DDR之间打规则过孔的做法,比较清洁

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7#
 楼主| 发表于 2014-8-7 22:50 | 只看该作者
沙漠风铃 发表于 2014-8-6 08:46
; V7 h/ I; M- n6 q! J3 C5 D* @走得挺漂亮,但是感觉线走得有点多,我看到过,在DDR之间打规则过孔的做法,比较清洁

6 T/ N  m% r7 f( b2 n4 e# o- D呃,,多谢这位仁兄!- M  `. }" t$ M, f" Y( d* o! h$ Y
话说我这板子有没有致命的地方?或者亟需改进的?

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8#
发表于 2014-8-11 22:01 | 只看该作者
打开了,看不到东西

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9#
 楼主| 发表于 2014-8-12 23:23 | 只看该作者
ROBERTZHANG 发表于 2014-8-11 22:01" r, C, ]( a: `# q) X! T/ E3 |6 s
打开了,看不到东西

" G. x& c* e. I我的软件版本是AD10.02 p( r0 c8 ]. l, E$ A; ^2 n! P* [
试试工具栏的View—Fit Board功能,快捷键V+F

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10#
发表于 2014-8-17 11:16 | 只看该作者
这个板子 走线进BGA 0.083mm,其他线0.102mm。过孔 0.152mm/0.3mm; M0 s. O5 _! r4 M6 u
1 f! O& B/ \& ~: m* X5 ?- v
这个板子要什么工艺?打样贵吗?

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11#
发表于 2014-8-17 21:35 | 只看该作者
AD的文件就不去看了

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12#
发表于 2014-8-18 09:28 | 只看该作者
3mil 是不是有点太近了,加工会很困难,一般3.5mil以上还好一点,3mil以上能做的加工厂不多

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15#
 楼主| 发表于 2014-8-18 21:26 | 只看该作者
hb_ben 发表于 2014-8-18 09:28
/ ^  o3 l6 M2 k" n# N3mil 是不是有点太近了,加工会很困难,一般3.5mil以上还好一点,3mil以上能做的加工厂不多

5 E# W! @$ r2 n2 d, C没办法啊,BGA下面的焊盘间距20mil,焊盘占掉了10mil........
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