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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › allegro 16.6 导入网表,PSM/PAD/DRA文件齐全，仍然提示 ...
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allegro 16.6 导入网表,PSM/PAD/DRA文件齐全，仍然提示一下错误

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fangxiaoyan

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发表于 2015-4-15 20:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 fangxiaoyan 于 2015-4-16 20:34 编辑
6 i4 u, \' _8 @% z2 R/ J. n+ \. Q: b6 `  d+ t6 r8 S$ y) l
如题，allegro  16.6 导入网表出错，调用别人的封装，错误信息如图1.& d3 S7 e& q  E! e% J5 T

/ }4 `2 Z5 I3 i0 ]4 G; R3 q3 E* Z0 [  提示封装的引脚缺失，共有10个元件的封装3 k+ B# ^! ?3 b" ~# r3 F0 B

- b' m5 p- W, y3 o+ b打开其中一个DRA文件，发现缺少引脚，如图2所示
  i" y, u2 \* {- Z( J5 F# a! T# ]5 r; I) K& U$ ]
( v% P4 C3 d7 A# k' d/ L; ?
这个封装文件在别人的电脑上可用，不缺引脚，而且PSM/PAD/DRA文件齐全，为啥调用过来出现这种错误？
5 m5 D$ d! l+ c! E; h3 v$ H: O: d5 C# R4 e: F4 r
% M. R/ L+ H% `$ V) ~
请问除了重画封装，补上引脚，有没有其他方法？
! B7 Y9 B% z% ?  Z$ e# Z! ]

DST导入网表报错.png (25.14 KB, 下载次数: 12)

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DRA引脚缺失.jpg (55.36 KB, 下载次数: 17)

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 楼主| 发表于 2015-4-17 18:11 | 只看该作者
dzkcool 发表于 2015-4-17 09:26# e, R% u/ a8 s8 u% k
dra文件里面要有焊盘才行。7 r$ z) h% [# q+ \7 g
你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目 ...
: `' V8 I3 L, t" O
导出封装成功，可以看到FPC_10_0_5M  正常 ，图1.
; N: I: G9 D  P# D; M- ?- |& s# ^/ F2 |0 u) M6 G: k
回看原理图这个元件，图2，图1和图2引脚一致，
+ d$ h/ D" q$ E) w! s3 c, W; `& A' Y  x3 Q& T0 {
* X1 J/ u; k$ s4 @; W% c
但导入网表时提示[size=14.3999996185303px]FPC_10_0_5M[size=14.3999996185303px] 缺少引脚，图38 n+ F, k9 S8 N9 K
[size=14.3999996185303px], |) j. b, \) Z# P" }8 d
- A2 w7 _7 |  {- z$ ]# _  Q& B1 `' ~
[size=14.3999996185303px]
4 _! b% I% B; d# z/ T; R
" i; m  f+ X6 d/ I[size=14.3999996185303px]编辑原理图的这个元件，并没有看'UART'脚。' B! h+ y4 g1 b4 |
% r& h2 s5 [! k: s5 H' m# N# z
5 i) ^( C3 N7 t0 K5 Y8 H
封装重画，原理图这个元件重画，仍然有这个错误。
0 F* n6 k; P! ~5 m, {. c9 k8 N* x( E% Y+ Z* D3 _

) e$ |* o% r! B" g# Y求教！
& I6 U. ^1 z$ T$ Y; j9 O" y& ], ^5 x* S

导出封装FPC.png (7.49 KB, 下载次数: 18)

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原理图FPC.png (21.46 KB, 下载次数: 13)

原理图FPC.png

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 楼主| 发表于 2015-4-21 17:32 | 只看该作者
dzkcool 发表于 2015-4-21 13:052 t3 _# _* ?" p) O2 i, V0 v
我没做任何改动，只是导入了一下网表，没发现什么问题。

7 ^  C* y; [* n+ r+ N+ Q我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板框内，其他的元件可以放置。
" t& F1 Z% I$ Z4 i) c
6 b4 G9 e& O! D: `4 s跟生产网表/导入网表的设置有关么？
) s9 ]2 i, k( Q& R3 Y: h, t8 x7 @

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dzkcool
我直接用第一方导入，没任何问题。  详情 回复 发表于 2015-4-21 17:53

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    发表于 2015-4-22 10:37 | 只看该作者
    fangxiaoyan 发表于 2015-4-22 09:43, r! O; H' K: M9 m" Z
    现在是不是可以一个个排除   1.生成网表时的选项有关  2电脑的环境。pads 与allegro 可以共存啊。奇怪了 ...

    1 n2 F! b# s! X估计跟1、2有关。9 ?' w( f# n2 Y) d9 U, [$ a5 k+ q& I9 k
    实在看不下去了，大哥，你才是楼主，不要老是称呼我是楼主' h: Y0 q. v5 N: d6 v; B# a
    4 M7 o+ o7 w( A2 l, v: {' j* @

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    fangxiaoyan
    恩，学习了。“楼主”是女子。刚毕业，做项目管理。不懂的很多，别见怪哈。  详情 回复 发表于 2015-4-22 13:45

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    fangxiaoyan

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    2#
     楼主| 发表于 2015-4-16 20:32 | 只看该作者
    没人知道么，还是问题太幼稚了？

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    [LV.8]以坛为家I
    3#
    发表于 2015-4-17 09:26 | 只看该作者
    dra文件里面要有焊盘才行。* `5 f* W% d( |% \0 U! V
    你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目录下，然后再导出封装。

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    fangxiaoyan
    导出封装成功，可以看到FPC_10_0_5M 正常 ，图1. 回看原理图这个元件，图2，图1和图2引脚一致， 但导入网表时提示FPC_10_0_5M 缺少引脚，图3 编辑原理图的这个元件，并没有看'UART'脚。 封装  详情 回复 发表于 2015-4-17 18:11
    fangxiaoyan
    同事直接发的封装文件。现在打算重新从同事的板子导出，再试下。  详情 回复 发表于 2015-4-17 10:35

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    4#
     楼主| 发表于 2015-4-17 10:35 | 只看该作者
    dzkcool 发表于 2015-4-17 09:26
    : m/ x2 s% v! O, r6 Hdra文件里面要有焊盘才行。4 L1 P* s% y" J
    你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目 ...

      C. ?" S) @9 A3 c0 @" M) }同事直接发的封装文件。现在打算重新从同事的板子导出，再试下。
    ) m/ |" i! m) F# q9 E& i; c

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    6#
    发表于 2015-4-21 08:26 | 只看该作者
    原理图上有其他元件用到FPC_10_0_5M这个封装吗？每个都要看下。! |( ?/ B; Y% S' ]% ~
    如果没问题，把原理图和封装放上来看看吧。

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    fangxiaoyan
    检查完毕，没有其他元件用到这个封装  详情 回复 发表于 2015-4-21 10:15

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    7#
     楼主| 发表于 2015-4-21 10:15 | 只看该作者
    dzkcool 发表于 2015-4-21 08:26
    $ ?- [* B6 u/ V: E6 e: g# b5 e原理图上有其他元件用到FPC_10_0_5M这个封装吗？每个都要看下。
    7 a6 b( |# W% M, h& K& _! q如果没问题，把原理图和封装放上来看看吧 ...
    1 U" T# R& L, g* ]( Z( b1 L
    检查完毕，没有其他元件用到这个封装. [; D/ L; u3 ?) @) Z2 @& e

    DEBUG_BOARD_0523P1.rar

    30.08 KB, 下载次数: 6, 下载积分: 威望 -5

    原理图

    FT232.rar

    19.47 KB, 下载次数: 5, 下载积分: 威望 -5

    BRD文件

    lib.rar

    257.69 KB, 下载次数: 5, 下载积分: 威望 -5

    库文件

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    我没做任何改动，只是导入了一下网表，没发现什么问题。  详情 回复 发表于 2015-4-21 13:05

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    fangxiaoyan 发表于 2015-4-21 10:15* e" y5 e2 a/ Z5 h' e* O
    检查完毕，没有其他元件用到这个封装

    " k1 I8 O6 c$ X! ^( S我没做任何改动，只是导入了一下网表，没发现什么问题。
    8 ^+ C, _8 ]" z: w$ d FT232-eda365.rar (43.18 KB, 下载次数: 2)
    % A+ V# A, }) d0 L

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    fangxiaoyan
    我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板框内，其他的元件可以放置。 跟生产网表/导入网表的设置有关么？  详情 回复 发表于 2015-4-21 17:32

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    发表于 2015-4-21 17:53 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 17:321 M: h. v4 Z* \4 x
    我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板 ...

    * ]: {: ^  d+ T* L" Z1 n我直接用第一方导入，没任何问题。
    2 v5 J6 j  d6 a/ F+ U+ e

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    fangxiaoyan
    那找不出问题的原因了。  详情 回复 发表于 2015-4-21 19:06

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     楼主| 发表于 2015-4-21 19:06 | 只看该作者
    dzkcool 发表于 2015-4-21 17:53( ~' F  Y8 z. ?+ t
    我直接用第一方导入，没任何问题。

    8 ?  c8 _5 K5 z7 _那找不出问题的原因了。
    ) [& [/ w; i+ p4 b$ n

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    dzkcool
    你在我导入的PCB上再重新导入一下网表呢？  详情 回复 发表于 2015-4-21 19:08

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    12#
    发表于 2015-4-21 19:08 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 19:06
      @- U( V4 H! ]: v  }4 F( v: z$ Z! c$ t那找不出问题的原因了。
    $ k7 A9 f* o- f3 c
    你在我导入的PCB上再重新导入一下网表呢？" B; u! H, b9 w& N2 a' j2 Y0 v

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    fangxiaoyan
    导入的选项如图1， 导入报错如图2，  详情 回复 发表于 2015-4-21 19:21
    fangxiaoyan
    需要先导出网表，再重新导入网表？  详情 回复 发表于 2015-4-21 19:15

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     楼主| 发表于 2015-4-21 19:15 | 只看该作者
    dzkcool 发表于 2015-4-21 19:084 J* u# r7 Z$ R+ `/ `
    你在我导入的PCB上再重新导入一下网表呢？
    2 H; m* o) l. f
    需要先导出网表，再重新导入网表？

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    dzkcool
    先从你的原理图中导出网表，再用我的brd导入网表。  详情 回复 发表于 2015-4-21 19:17

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    发表于 2015-4-21 19:17 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 19:15  w  I' w& S5 b- t. I8 p
    需要先导出网表，再重新导入网表？

    : H$ K3 q* {+ E" ~4 y. p1 w先从你的原理图中导出网表，再用我的brd导入网表。" t5 Z4 U  c. Q. a9 x

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    fangxiaoyan
    楼主，以第三方的方式导入你的PCB，OK.  详情 回复 发表于 2015-4-21 19:24

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    fangxiaoyan

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    15#
     楼主| 发表于 2015-4-21 19:21 | 只看该作者
    dzkcool 发表于 2015-4-21 19:089 U$ B& {, G" F4 R
    你在我导入的PCB上再重新导入一下网表呢？

    " m5 r& u4 l. H  D) `导入的选项如图1，
    - q5 r+ U% c  X$ o5 Y
    / L" y; y& M% _' B. m! D/ \导入报错如图2，& f' V+ g1 d4 H8 o

    导入配置.png (55.33 KB, 下载次数: 13)

    1

    1

    导入报错.png (23.8 KB, 下载次数: 22)

    2

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    dzkcool
    太诡异了，我出的网表中根本就没有你截图的这个device信息。  详情 回复 发表于 2015-4-21 19:53

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