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Net wire has multiple net name

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1#
发表于 2014-7-19 21:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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在使用AD10的时候出现以下编译错误
, x( n1 O' L( b$ l; V7 QNet wire has multiple net name(Net label SRAM_A0. Sheet Entry U_SRAM_InteRFace SRAM_A0(passive)). o, [3 w" E& P: u+ ^5 I
Wire SRAM_A0
- K( x6 \2 x8 n2 N! DNet label SRAM_A04 B+ T8 T7 f" |* h
Sheet Entry U_SRAM-Interface SRAM_A0(passive)
( ^. t; @& {7 _: C* T( H2 r3 b- X7 i; L1 C) O
sheet symbol的图纸
* h+ V+ m& N7 S; J7 V& l9 c: e
( }% {' g5 [2 t6 q! K6 u& N
1 i6 b& @9 ]5 x( ^6 Y4 Z6 R. _$ Z7 f总的sheet的图纸
1 C# D6 S) c5 I. m  y, y
3 R! I2 t2 E/ P0 i2 U* K- }9 @" q6 b% a# |4 M9 ~) [$ ?
为什么我所有的net name都是sram_a0,他还是说我在一根线上有多个net name。而且仅仅是wARM,导入到PCB还是sram_a0, 不影响PCB layout( U1 @& o5 q$ N, B5 L  a. ^
很纠结,因为一编译message满是这种错误,也不知该如何解决。很烦

该用户从未签到

2#
 楼主| 发表于 2014-7-19 21:37 | 只看该作者
仅当我将project->project option中的Net identifier scope更改为8 _. T6 t1 y7 j
Global (net label and port global)9 W4 _6 {/ X, D. q, A! a+ i
编译错误会没有,但是这非我所愿,很纠结
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