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Net wire has multiple net name

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1#
发表于 2014-7-19 21:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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在使用AD10的时候出现以下编译错误
+ k: h7 H4 o6 R, Z  ~1 hNet wire has multiple net name(Net label SRAM_A0. Sheet Entry U_SRAM_InteRFace SRAM_A0(passive))* V6 S, W0 X7 o# V
Wire SRAM_A0, I# I2 S8 P1 w* U: u* u) h0 Z
Net label SRAM_A0  h2 f* C/ [* R  m8 j7 l
Sheet Entry U_SRAM-Interface SRAM_A0(passive)) A3 q+ U. c5 Q  W" Y2 d& I
' B! h& S" z/ J- h" n& C% u
sheet symbol的图纸3 `/ I6 _& T  `( @+ |$ \8 Q& `# {

  n8 o( d) F) E, t7 K* g3 Q+ P* @0 u; e0 Y$ r  q5 z
总的sheet的图纸1 t: w, J# X) B. Q4 f
  R$ y, p' T$ x% U8 D

/ M+ Z4 W2 O; J4 r1 J/ h为什么我所有的net name都是sram_a0,他还是说我在一根线上有多个net name。而且仅仅是wARM,导入到PCB还是sram_a0, 不影响PCB layout2 U3 g: m2 x# O. \% @( W. @
很纠结,因为一编译message满是这种错误,也不知该如何解决。很烦

该用户从未签到

2#
 楼主| 发表于 2014-7-19 21:37 | 只看该作者
仅当我将project->project option中的Net identifier scope更改为
" Z; c# k1 l0 n1 R$ }! b$ B* QGlobal (net label and port global)& _1 ?1 X% }( h! I9 j6 n+ S4 b5 z' h
编译错误会没有,但是这非我所愿,很纠结
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