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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › Artwork creat with warring in V16.6
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Artwork creat with warring in V16.6

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benson_Liu

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1#
发表于 2014-4-17 01:09 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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請問這個轉GERBER的photoplot.log 中.! @+ a/ M: e4 j; ?3 |+ R- z( l
在V15.7完全沒問題.! k4 _- B& C) a7 L( M" R9 d/ P) ^% u
但是在V16.3就出現一大堆Warring.& [8 V, r2 z: c- U- s7 I0 u

# P3 B( A6 h; v2 W可以幫忙看一下是什麼問題嗎?& v% s  u1 J) K) A
另外,除了DB check以外$ S; _" B$ x+ C3 u: i, ~- G1 z* E
還需要那些動作
, e1 q4 x6 J( p* t/ s4 w1 J1 p; p比較不會有問題.(Shape的部分).
' I! m* b* ~$ |+ _; C9 @9 B
+ u' ?  P2 P6 D) Y

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