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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › Simulation is failed!
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[Cadence Sigrity] Simulation is failed!

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Dandy_15

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1#
发表于 2013-11-12 14:24 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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同样文件，同样的操作方法，在ASI16.62中能仿真，在ASI16.61中就不行，为什么呢？9 v2 |6 r9 m( \
ASI16.62:64bit WIN73 n8 P9 A8 i/ ^6 ]  O7 I5 d5 |2 P' s
ASI16.61:32bit XP
' |) ~! y; [7 y' E4 e( r8 l4 H! J. x" N1 E
提示：" n3 u4 j/ O. A3 I9 w
Simulation is failed!$ U- B( Z9 X1 R' P$ a
: a2 r. r* J* X0 i9 L* R0 O: z
NET Simulation Error:. K9 F" n" r4 K- \0 F
Error 2029: "File" not specified for IBIS model "BEAD.EndPartialCkt"$ _, ~: C: a1 ~( ~2 K% [4 u5 p2 T

" {2 R4 o; L; h- Y' w

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Dandy_15

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2#
 楼主| 发表于 2013-11-13 16:28 | 只看该作者

' w) [) w+ D0 `6 r1 l  a! ^! q问题已经解决了，用TXT格式打开.sdp文件，修改网表。
5 v" [) T) ^) j# I3 u将BEAD.EndPartialCkt改为.EndPartialCkt就可以了

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