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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › Simulation is failed!
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[Cadence Sigrity] Simulation is failed!

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Dandy_15

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1#
发表于 2013-11-12 14:24 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
同样文件，同样的操作方法，在ASI16.62中能仿真，在ASI16.61中就不行，为什么呢？1 \6 d3 I! j; t1 B  T
ASI16.62:64bit WIN7% K( n6 E% o1 j+ `/ B+ Y, I
ASI16.61:32bit XP
4 \/ E1 y- X* R( I* ]! z
& B6 O- T: m% L: {. g# f3 n+ J5 v提示：/ M0 Y1 @/ I# Q: d6 F
Simulation is failed!* n6 z, w8 x$ ]

# r- o. W) W% N/ N- ~NET Simulation Error:
# B& N/ \. E* ?8 a2 j$ Y3 QError 2029: "File" not specified for IBIS model "BEAD.EndPartialCkt"
* F% c- U  I  G3 z5 ?
% O2 l8 k) e, F9 D# y9 Z

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Dandy_15

该用户从未签到
2#
 楼主| 发表于 2013-11-13 16:28 | 只看该作者
5 g* E  v' z6 h1 _
问题已经解决了，用TXT格式打开.sdp文件，修改网表。+ K6 D- K! \% H5 ^/ A  R
将BEAD.EndPartialCkt改为.EndPartialCkt就可以了

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