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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › Simulation is failed!
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[Cadence Sigrity] Simulation is failed!

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Dandy_15

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1#
发表于 2013-11-12 14:24 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
同样文件，同样的操作方法，在ASI16.62中能仿真，在ASI16.61中就不行，为什么呢？7 D% J5 i" [: X6 b+ u( b1 B4 c& G/ R
ASI16.62:64bit WIN75 q6 y4 y' i7 y3 ^
ASI16.61:32bit XP1 D/ _# r, b0 v! k3 e2 R4 c1 @) n
) Y# E, k: r6 ^; m2 W
提示：+ t8 ?+ l! D6 U! }& L9 u" ~
Simulation is failed!
+ b, l/ ]4 v/ R# }6 J" z. N. ?- G# t+ h$ D, Y2 [
NET Simulation Error:: @/ [: ?, W3 h4 i6 K8 u
Error 2029: "File" not specified for IBIS model "BEAD.EndPartialCkt"/ y  L8 i% _/ p8 R

7 b5 W& K' R7 `+ I3 h7 e. V0 ^

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Dandy_15

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2#
 楼主| 发表于 2013-11-13 16:28 | 只看该作者
0 g. x# h7 e/ S; `5 H
问题已经解决了，用TXT格式打开.sdp文件，修改网表。- C/ |1 W+ n7 p* W! R. p
将BEAD.EndPartialCkt改为.EndPartialCkt就可以了

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