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两片DDR布线T型疑问

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1#
发表于 2013-10-29 11:05 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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我使用的是PAD9.3R ,在论坛看到JIMMY老师说两个DDR布地址T型线时,过孔以元件的方式加入,这样好做等长,我让工程师加了过孔,导入网表过,为什么有的过孔只显示到一边呢,是不是原理图接的方式不一样啊,还有,我做了PIN PAIR后,还要不要做NET等长啊?还是只做PIN PAIR,希望JIMMY老师能给个详细回复一下呀?谢谢!2 w/ \1 ?3 T& h5 g, L: L  n
图A是可以孔到两片DDR,图B是孔只到一片DDR
6 x% w( d  g% v, y$ G. f8 l1 }
+ g; u) U/ x9 i

A.jpg (11.18 KB, 下载次数: 1)

A.jpg

B.jpg (8.89 KB, 下载次数: 0)

B.jpg

该用户从未签到

2#
发表于 2013-10-29 17:14 | 只看该作者
无图(PCB)无真相
; _5 P3 V* x- F( x! I
$ V. L& ~) h8 C, ~可以只做CPU到T点之间的等长就行。
  • TA的每日心情
    开心
    2020-7-7 15:30
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    [LV.3]偶尔看看II

    3#
    发表于 2013-10-30 09:08 | 只看该作者
    那T点到DDR之间不用等长吗?
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    2020-7-7 15:30
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    [LV.3]偶尔看看II

    4#
    发表于 2013-10-30 09:10 | 只看该作者
    这个问题可以重复走T点的线,然后点pin pairs2个DDR都可以选就ok了,我处理的方式就是这样

    该用户从未签到

    5#
    发表于 2013-10-30 09:27 | 只看该作者
    SPOONY 发表于 2013-10-30 09:08! l) i4 V; _+ [+ [$ r$ |6 E
    那T点到DDR之间不用等长吗?
    ) y" t) m5 `5 T. L
    T点到DDR不用做等长。因为T点到DDR之间的误差在芯片允许的范围内。
    7 S" V) W4 a1 M# w# L
    , y1 L# O1 A; T8 j/ W将CPU到T点的误差控制严格一点就行。
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    2021-3-9 15:11
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    [LV.1]初来乍到

    6#
    发表于 2013-10-30 09:31 | 只看该作者
    这个问题可以重复走T点的线,然后点pin pairs2个DDR都可以选就ok了,我处理的方式就是这样

    评分

    参与人数 1贡献 -10 收起 理由
    Sam_sen5 -10

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    该用户从未签到

    7#
     楼主| 发表于 2013-10-31 14:56 | 只看该作者
    T点到DDR不用做等长啊,将CPU到T点的误差控制严格一点就行,那这个是做选PIN pairs监控器还是NET监控器啊?

    该用户从未签到

    8#
    发表于 2013-10-31 15:48 | 只看该作者
    PIN pairs长度监视器
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    [LV.3]偶尔看看II

    9#
    发表于 2013-11-1 09:52 | 只看该作者
    多宝258 发表于 2013-10-30 09:31
      x( m, y9 ^2 S' {这个问题可以重复走T点的线,然后点pin pairs2个DDR都可以选就ok了,我处理的方式就是这样

    5 C: b( z& @7 K* |为啥扣我分,本来就可以这样处理
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    2020-7-7 15:30
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    [LV.3]偶尔看看II

    10#
    发表于 2013-11-1 09:54 | 只看该作者
    多宝258 发表于 2013-10-30 09:314 H  q9 E$ }4 z( h
    这个问题可以重复走T点的线,然后点pin pairs2个DDR都可以选就ok了,我处理的方式就是这样

    5 c' S3 U/ m3 s) E2 v6 M- B看错了,对不起哦,还以为扣我的分呢,实在不好意思
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    [LV.3]偶尔看看II

    11#
    发表于 2013-11-1 10:04 | 只看该作者
    高手让我茅塞顿开呀,谢谢!

    该用户从未签到

    12#
     楼主| 发表于 2013-11-1 10:06 | 只看该作者
    谢谢JIMMY老师及楼上各位的耐心解答,等这个板画好后我就发给老师点评一下,刚开始学DDR走线,很多问题都不懂,对BGA和DDR出线没有掌握好规律,感觉拉得好乱……好不容易走通了,BOSS要求总NET再短一点,再短一点,唉,几个晚上没睡好了……4 b# W9 e+ ~) x! ?+ e  |2 b- ]
    下面是我的六层板走线,分别是L1\L3/L5的DDR线8 ?  N3 L8 G+ k2 ?

    : }6 a+ e1 u  r% ^& F" g

    L1.jpg (282.25 KB, 下载次数: 6)

    L1.jpg

    L3.jpg (192.61 KB, 下载次数: 6)

    L3.jpg

    L5.jpg (115.37 KB, 下载次数: 6)

    L5.jpg
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