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pcb做完后进行验证设计,在制造验证的时候出现这个头疼的错误,请教下大家!!

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1#
发表于 2013-8-30 08:58 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 fanweilin201314 于 2013-8-30 11:29 编辑
7 R3 ^. q( R8 X3 S0 V
" e( z9 y# K# L6 j9 h; }. ^6 M点确定后出现很多DFF错误
  A. B, ^% W) y7 M

QASAWD.jpg (50.44 KB, 下载次数: 2)

QASAWD.jpg

11111.jpg (231.29 KB, 下载次数: 0)

11111.jpg

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2#
发表于 2013-8-30 11:20 | 只看该作者
把错误标记的图片发上来看看

该用户从未签到

3#
 楼主| 发表于 2013-8-30 11:28 | 只看该作者
苹果花儿 发表于 2013-8-30 11:20
9 \! M2 u( o8 E$ M' `, e* t' G把错误标记的图片发上来看看

( O/ l6 w7 z  ]6 v+ j麻烦你了

11111.jpg (231.29 KB, 下载次数: 0)

11111.jpg

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4#
发表于 2013-8-30 14:25 | 只看该作者
这个我也不清楚,不过问了我公司的高手,说这项一般都不用检查。

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5#
 楼主| 发表于 2013-8-30 14:56 | 只看该作者
苹果花儿 发表于 2013-8-30 14:25
" K8 [2 f# c3 e6 M这个我也不清楚,不过问了我公司的高手,说这项一般都不用检查。

) o8 b$ D7 D- h$ p& v0 M但是 生成平面层GERBER的时候要报错啊

该用户从未签到

6#
发表于 2013-8-30 15:38 | 只看该作者
我看了之前公司的板子,8层2片DDR的,这项检查也有报错,但出GERBER没有报错哦,你那个出gerber报错是什么情况。
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