DDR3差分时钟端接问题

godgyan · 发表于 2019-4-18 13:43

毛豆盛宴发表于 2018-11-6 11:268 p9 N/ p( @; G( t& k( Q6 }! M
看这里

非常感谢

xiaoxiaoya · 发表于 2019-4-24 15:59

看看

tanch100 · 发表于 2020-7-10 10:52

毛豆盛宴发表于 2018-11-6 11:26
/ J+ X( g( A3 t. I u9 c% o2 l# j5 I看这里

感谢分享！！

kannin · 发表于 2020-7-21 10:09

毛豆盛宴发表于 2018-8-10 10:184 u: D5 L% Q7 z2 h; y' n
规范要求查分电容是2.2PF，靠近源端

感谢分享

刘中洋 · 发表于 2020-12-3 13:41

感谢分享感谢分享感谢分享感谢分享

一影之歌 · 发表于 2021-4-1 23:31

学习了

xiaochangyu · 发表于 2021-4-19 11:38

学习一下，看看

小昌鱼 · 发表于 2022-7-19 15:32

毛豆盛宴发表于 2018-11-6 11:26' c. F2 z6 o B9 G+ J
看这里

支持一下，下载来看看

zw06024123 · 发表于 2024-9-2 10:52

毛豆盛宴发表于 2018-11-6 11:26
7 T' v4 H5 {* k7 i看这里

受教了，多谢分享

zw06024123 · 发表于 2024-9-2 10:52

也有此疑问，一起学习！！

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[仿真讨论] DDR3差分时钟端接问题