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padslayout连通性校验出错

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1#
发表于 2013-8-21 13:38 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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求教,如图,敷铜后作连通性检查,明明焊盘连上了GND,却还是出错。不知什么原因,特请教。
& J. C; o7 ~$ R, m- O; U
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  • TA的每日心情

    2019-11-20 15:11
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    [LV.1]初来乍到

    2#
    发表于 2013-8-21 15:15 | 只看该作者
    请上传PCB文件找错误。这种问题多数是封装问题

    该用户从未签到

    3#
    发表于 2013-8-21 15:18 | 只看该作者
    第二条的地方呢?

    该用户从未签到

    4#
     楼主| 发表于 2013-8-21 15:40 | 只看该作者
    第二条的在这里6 v& F- M% c! T( |9 C! \9 U* @

    / E  ~) N7 _8 X9 \2 R' H. Z
    - @6 C* W8 i, F& }! y5 X$ ~, e' u
      r6 p& C- f6 L7 o+ |2 q文件在这里
    ( a( x0 w  }, {! ]) ^0 p7 E- D6 K  I0 z/ V5 o9 [

    Demo1.rar

    105.01 KB, 下载次数: 14, 下载积分: 威望 -5

    该用户从未签到

    5#
    发表于 2013-8-21 15:47 | 只看该作者
    你的这个焊盘没有连

    QQ图片20130821154639.jpg (27.87 KB, 下载次数: 0)

    QQ图片20130821154639.jpg

    该用户从未签到

    6#
    发表于 2013-8-21 15:49 | 只看该作者
    xxg2962 发表于 2013-8-21 15:40
    , R2 |: n' |: M) e5 S* }1 P第二条的在这里
    1 U7 M) A& n3 L! o7 h! r0 U' J6 a
    不是焊盘, 也不是封装问题.
    7 _9 n' p& o. Q2 p& }是这个区域是孤立的.( L8 ~* {' ]3 E( t% K. \  |" q9 _

    / o9 Q0 n9 H0 X: p6 Z# d1 a
    : U# L. Q$ R% o, d' JPS: 为什么不打过孔到中间的地层呢?

    该用户从未签到

    7#
    发表于 2013-8-21 16:32 | 只看该作者
    6楼正解吧.这种连通性报错,就是铜皮没有连接到一起.试试多打些缝合地孔.能有效解决这类问题

    该用户从未签到

    8#
     楼主| 发表于 2013-8-21 18:08 | 只看该作者
    谢谢楼上热心的朋友,问题解决.
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