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1#
发表于 2008-8-14 10:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请问高手:我现在画得板,硬件设计工程师将一个地网络A换成了另一个名字B,导入网表,这些地原来连的线和孔都变成了无网络的,所以会出很多间距错误。当我铺B的铜皮,那些线和孔就赋予了网络B,错误也消失了,但当查连通性时,B这个网络都没连上,必须删掉重新连,或者动一动这些线才能连通,这是为什么?如何解决?太多了一个个连太费时间了,大家遇到过吗,请指点!!

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2#
发表于 2008-8-14 10:54 | 只看该作者
个人认为啊    你用CHANGE(改变宽度什么的都不勾选)来框一下有DRC错误的线,应该会消失。

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3#
发表于 2008-8-14 10:57 | 只看该作者
把网络名 B 改回 A 来不行吗?, {( Y. }% d# D: z3 U
重新导入一下网络表应该可以解决这个问题

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4#
发表于 2008-8-14 11:01 | 只看该作者
硬件工程师好象会发火。。。。

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5#
 楼主| 发表于 2008-8-14 11:04 | 只看该作者
这招有效果比原来快了点 -------------------------------------------------------大家还有没有更好的方法说说啊!
3 n, A2 B3 R" H. j但是我的线宽不全一致还是的分批点。谢谢楼上,看来楼上也遇到过啊。: s5 P! f  G. r0 z6 \+ j
我还想问这是怎么回事,可不可以在哪里设置避免这种情况发生,还是原理设计要注意些什么?

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6#
 楼主| 发表于 2008-8-14 11:06 | 只看该作者
原帖由 lt169 于 2008-8-14 10:57 发表
" @( C: x" J3 ~4 ~把网络名 B 改回 A 来不行吗?
$ G/ P  v, l+ B$ _重新导入一下网络表应该可以解决这个问题
! v6 {2 |2 v/ H
8 O9 g" ~- l; A# Z6 n- z
他可能不完全改,所以这样不行,再说原理设计是人家的意图我画图的不能改啊!

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7#
发表于 2008-8-14 11:12 | 只看该作者
线宽不一直没关系的啊 你前面把改变线宽度的不勾选整板change一下就可以了啊 你可以弄个实验的板子去尝试一下,快的可不是一点点啊

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deargds + 5 感谢分享

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该用户从未签到

8#
发表于 2008-8-14 11:16 | 只看该作者
这个DRC我还不知道怎么能去掉,好象就是网表更改带来的误显示,希望有知道的高手能指点一下,这样的错误我都是先UPDATE DRC一下,还有就整板change 一下,就想模块copy一样替换完也这样操作一下DRC就没了 不过铜皮还是要重新附一下属性的   个人观点 :handshake )

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小小 + 2 非常感谢!!(因为没有权限,本想给你加10 ...

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