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弱弱的问一句,SDRAM,DDR,DDR3等,时钟走线,走在TOP或BOTTOM层,能过EMC?

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发表于 2013-6-29 10:59 | 只看该作者回帖奖励

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如题:
   在论坛上看了很多大神的pads档案,DDR.DDR3等.走CLOCK差分线都是走在表面上的.请问,这样走线能过EMC吗?
   因为我原来做过SDRAM(两片),4层板.走CLOCK线在表层,怎么搞都过不了EMC.最后没办法,换内层才过.
   所以,在这里看见很多大神走CLOCK线走在表层很迷惑.

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2^#

发表于 2013-6-29 11:02 | 只看该作者

可以啊，4层板我们都是走表层。。。

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3^#

楼主| 发表于 2013-6-29 11:51 | 只看该作者

hui_hui0228 发表于 2013-6-29 11:02 6 l$ G+ T" V& u4 y
可以啊，4层板我们都是走表层。。。

有加屏蔽罩什么的吗?

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4^#

发表于 2013-6-29 11:53 | 只看该作者

q444709812 发表于 2013-6-29 11:51
4 K" A3 u# S5 Y# k$ U( w: [有加屏蔽罩什么的吗?

不用加，两层板都能过。

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5^#

楼主| 发表于 2013-6-29 12:36 | 只看该作者

rx_78gp02a 发表于 2013-6-29 11:53 3 A1 j6 s; T, z& O
不用加，两层板都能过。

请问走线有做阻抗吗?

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6^#

发表于 2013-6-29 12:48 | 只看该作者

q444709812 发表于 2013-6-29 12:36
6 x4 R1 ~3 P( ]请问走线有做阻抗吗?

包地，无等长，线尽量短，地址串联75R电阻

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7^#

发表于 2013-7-1 09:00 | 只看该作者

q444709812 发表于 2013-6-29 11:51 * @# `7 ` {2 g( I1 y$ b
有加屏蔽罩什么的吗?

没有加，线尽量做到最短，每组之间隔离包地，

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8^#

发表于 2013-8-2 16:56 | 只看该作者

没有加，线尽量做到最短，每组之间隔离包地，

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