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主频无法通过EMC检测

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WANGXINRAN2006

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1#
发表于 2013-5-11 11:25 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
各位好：5 r1 t4 ~# B1 y5 `2 }- Y( [
  我做了一款BCM7231的播放板，此板采用4颗8位的DDR3，采用菊花脸结构布线，4层板，TOP和BOT走线，控制，地址和时钟都有阻抗匹配电阻。当主控设置DDR速度为667M时，EMC就667M超标，设置DDR速度为800M时，EMC就800M超标，都是10dB左右。请问这种情况该如何处理，有哪些地方要着重注意？请指教！

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lap

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2#
发表于 2013-5-11 13:21 | 只看该作者
发个截图上来瞧瞧

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WANGXINRAN2006

该用户从未签到
3#
 楼主| 发表于 2013-5-11 14:09 | 只看该作者
lap 发表于 2013-5-11 13:21
5 P; k0 k+ w7 U& S发个截图上来瞧瞧

. M* e* \# y! f2 K# A4 O% f9 n2 ?.....

QQ截图20130511141147.png (231.73 KB, 下载次数: 34)

QQ截图20130511141147.png

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Aubrey

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4#
发表于 2013-5-22 20:01 | 只看该作者
横着摆啊 第一次见

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henrykaka00

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5#
发表于 2013-5-23 09:42 | 只看该作者
机壳的屏蔽效果如何?可能是机构漏出去的

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cousins

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6#
发表于 2013-6-1 11:56 | 只看该作者
BCM的CPU走DDR bus采用菊花链的话  要特别注意Vtt网络的走线宽度，ADDR bus的端接( Q4 q. Y1 [/ j. ?" V  Y
3W rule
+ K# A$ p( G7 d8 ?( {还有 看截图  你这种布局真不像是菊花链结构  环路拉的太远了

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4cwebber

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7#
发表于 2013-6-16 19:27 | 只看该作者
楼主是不是没加屏蔽罩？加了屏蔽罩后刮开PCB上的铜皮接地试试

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sshgz123

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8#
发表于 2013-7-17 20:32 | 只看该作者
DDR还能这样摆啊！长见识了！clk有跳层么？参考地完整不？与其他net间距拉开了么？图上看不出来，没法具体分析！

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clp783

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9#
发表于 2013-7-17 21:26 | 只看该作者
我也正在做这个板子，还没到做EMC这一步

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qfhuangjian

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10#
发表于 2013-7-23 14:46 | 只看该作者
话说你这最好DDR正反贴两片，同时注意走线！

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hqg

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11#
发表于 2013-7-25 09:00 | 只看该作者
滤波电容太少了，尽量靠近IC管脚滤波。目测，DDR区域没几个电容啊！& v, ?% y8 u7 F9 g* o2 Q
另外一个猜测就是DDR高速区域拉的太大，考虑是否在容易干扰的区域电源和地都隔离一下，需要看整板电路是否有相互影响的。* o8 c) w1 d, U( }
EMC，我也没实验测试过，只是做过一些板子，个人建议哈。

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part99

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12#
发表于 2013-7-30 09:35 | 只看该作者
时钟有没有做termination？感觉不到有VTT，的确太省电容了，应该每个电源口放一个

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