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一般做封装时要做Assembly_top吗?

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1#
发表于 2013-3-19 10:59 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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; F, ~& d. k4 A. g+ o* \如上图,一般你们做封装时会做Assembly_top吗?/ i6 o; T6 f+ b( R  H7 {
还是只做以下两个就OK了?
, @- R+ r" Y* K* z8 D : i2 N( c6 Q: Z

点评

建议做上去!  发表于 2013-3-19 11:03
  • TA的每日心情

    2021-8-2 15:01
  • 签到天数: 37 天

    [LV.5]常住居民I

    2#
    发表于 2013-3-19 11:39 | 只看该作者
    Assembly_top是实体大小
    6 S: e% [5 p: X3 O可用来给机构确认或是标示极性脚位用
    : U  ~; f( P  E8 D' X我目前遇见的此层是必要的

    该用户从未签到

    3#
     楼主| 发表于 2013-3-19 11:58 | 只看该作者
    必要?

    该用户从未签到

    4#
     楼主| 发表于 2013-3-19 12:27 | 只看该作者
    Assembly_top这个出gerber时貌似用不上啊,还是只是设计时方便做一些标示?

    该用户从未签到

    5#
    发表于 2013-3-19 12:32 | 只看该作者
    看公司大小,如果是大公司,有流程,这层必须保留,如果是小公司,有无均可

    该用户从未签到

    6#
     楼主| 发表于 2013-3-19 13:15 | 只看该作者
    inspiron1501 发表于 2013-3-19 12:32 ; R% Y6 }# ~( R# m9 c' Q0 N5 e6 D
    看公司大小,如果是大公司,有流程,这层必须保留,如果是小公司,有无均可

    & n$ D4 N, v- k" ]+ I- |0 s' ~那按正规流程走,这层应该画什么东西?

    该用户从未签到

    7#
    发表于 2013-3-19 13:19 | 只看该作者
    本帖最后由 幸福万岁 于 2013-3-19 13:27 编辑
    2 t, e& G0 T3 s) ?" j& D; O( O8 T8 k0 c5 \% h( w
    装配层    比如有些需要外接器件可以多画个place_bound_top; J: Q! f$ c/ Y$ F
    貌似一样 7 h0 U  N7 V# @) b
    这一层 我从来不画

    该用户从未签到

    8#
    发表于 2013-3-19 14:29 | 只看该作者
    我一般画原件实际外框

    该用户从未签到

    9#
     楼主| 发表于 2013-3-19 14:54 | 只看该作者
    我认为必须画的两个.1,place-bound-top
    * a( e5 X% b6 k  Z! g                            2,silkscreen-top
    0 u2 `$ A. ^3 y; \这两个画了就OK了,有不同见解的吗?

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    10#
    发表于 2013-3-19 22:14 | 只看该作者
    没有必要,但是画上去的话,可以用assembly层出装配文件给装配人员,毕竟有一些板子器件密度太高,用丝印层很难看清楚。

    该用户从未签到

    11#
    发表于 2013-3-20 14:18 | 只看该作者
    有总比不没有好,等你需要用到这层的时侯,再修改就麻烦了。
    3 d3 p, [$ R1 e9 n, x3 N
    ) m5 W1 b- A/ d- j- E所以尽量都加上,一般是器件形状,方向和其它一些注脚.
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