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CPU不工作

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1#
发表于 2012-12-24 23:12 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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CPU与FPGA的公共电源为1.8VIO,由一路开关电源供电。FPGA还有一个CORE电压为1.1V。
7 c& f# S' u, J8 ^& L8 o. y现在的情况是CORE必须后于1.8V的IO上电FPGA才可以正常工作。于是在CORE上面加了个延时,50ms吧,于是系统开始正常跑了。频繁断电上电后,会出现CPU不工作的情况,测量电压输出正常。再加大延时,100ms吧,比50ms的情况好多,但是频繁上电以后还是出现同样现象。' g- T- f# k1 A
CPU采用PMIC,FPGA CORE用PWM,他们的source是一样的。
& V0 P" v, |* G! ^8 _5 v( i. b延时电路是用FDS4395加上RC延时撘的。电流需要流过PMOS。
9 t7 ^9 v7 @* m. X8 S9 W当CPU不工作以后,将FPGA CORE的1.1V取下,CPU马上正常工作. Z! S. I: T( V8 t5 _
现在的疑问是,FPGA的与CPU仅仅是电源的输入是一样的,怎么FPGA会影响CPU呢,奇怪。
- _, w; L; `# G3 y5 \也请大家指点。
0 T0 C6 ^/ [5 l; x2 Q; e0 w: k3 `谢谢先

该用户从未签到

2#
发表于 2012-12-25 07:43 | 只看该作者
"频繁的断电上电" =>不知道中間的間隔的時間夠不夠使 CPU 所有电压放到 0.7V 以下? 怕是速度太快,造成開機的 RESET 失效。用示波器看一下 RESET 信號的電平正不正確?可能要設計一個關機的時候加速放電的電路。/ O! S4 O* n2 x0 y4 }7 m2 U3 s) N
3 V7 d# L* B: r- }
"FPGA的与CPU仅仅是电源的输入是一样的,怎么FPGA会影响CPU呢"  =>  FPGA 可能是有漏電行為,造成 CPU 開機的 RESET 失效。或是 CPU 軟件在等待  FPGA 回答,所以拖住  CPU  動作。
% z( y8 ~# Z  U# P. ~

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3#
发表于 2012-12-25 09:29 | 只看该作者
验证下,如果不进行频繁的上下电,是否工作正常,或是上下电间隔时间大一点会不会出现相同现象?

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4#
 楼主| 发表于 2012-12-25 14:34 | 只看该作者
jacklee_47pn 发表于 2012-12-25 07:43
- [" W1 }1 g! b) I% C- Z9 W3 B"频繁的断电上电" =>不知道中間的間隔的時間夠不夠使 CPU 所有电压放到 0.7V 以下? 怕是速度太快,造成開機 ...
! {5 T9 ~: {: M, Q& d/ @7 m6 d- L; \
间隔时间是有个1~2秒,你说的CPU电压到0.7V以下reset正常有什么参考理论吗,我想知道下他的原理。( s, J# O2 z* u2 u: b3 o  ?- F& I
FPGA的漏电行为一般是什么原因造成的呢,
! z& V: n! @3 b; g  X: ?- a这个系统CPU的启动与FPGA无瓜葛,FPGA基本上相当于一个NOR flash,我CPU按时去读他的数据就可以了。
) G, h* _1 @; M. S0 q还有一个现象是,我不给FPGA加CORE电源,那么CPU每次都是正常启动的。
头像被屏蔽

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5#
发表于 2012-12-25 14:42 | 只看该作者
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6#
 楼主| 发表于 2012-12-25 14:54 | 只看该作者
edajf 发表于 2012-12-25 14:42 " B& F4 [+ H& ?/ c% A# I# U
FPGA哪里接了大电容么?如果接了大电容,开机关机电还没放完,导致上电时序又变了,上电时序可能导致CPU起不 ...
% P$ o) v5 Y& u% r" t; `0 |+ W8 N2 H
因为FPGA的CORE必须要晚于IO上电,CPU才可以起来,所以在CORE的输入上飞了一个延时电路,用RC控制PMOS通路慢慢打开,电容10uF,电阻1M,(最初是100K,300k,820k,1M 以为感觉延时大点CPU就不那么容易当掉)。9 s: `4 N3 ^; C9 z; o: \
现在又想起另外一个关键的地方,为什么FPGA的CORE晚于IO(也是CPU的DDR电源),CPU就会起不来呢。目前还没有做一个仔细的测量,仔细测量一下再与大家讨论@~@

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7#
发表于 2012-12-25 15:10 | 只看该作者
legendarrow 发表于 2012-12-25 14:34   [4 }0 ]: o* G! x
间隔时间是有个1~2秒,你说的CPU电压到0.7V以下reset正常有什么参考理论吗,我想知道下他的原理。9 Q# k2 O, K/ D. G7 z" m
FPGA的 ...
' X  r! M; q6 B
0.7V 這是經驗值,真正要看你的 CPU 和 RESET 電路來決定。% y/ g9 C5 n) @: _2 b

% S5 t  Z, P5 E5 a( B如果 CPU 只使用 RC 來做開機 RESET,一些單晶片 (例如 8751) ,你可以試試看,開機關機速度過快 CPU 會不動,甚至於會發燙。因為矽半導體的電位差最小是 0.7V。當 CPU 沒有放電乾淨並且 RESET 失效的時候,Program Counter  (PC 寄存器) 是不會乖乖地從 RESET 指定地址開始 (我不說從 0x0000H,是因為不是所有的 CPU 都是 0x0000H 開始)。開機如果不是從 RESET 指定地址開始,有機會進到不對的無窮迴圈,或是造成機器錯誤的動作。
4 p0 x0 I* T, {5 R# F. X
* S& X4 g" }4 H1 ^如果 CPU 有使用專屬的 RESET IC ,那就要看 RESET IC 的特性。除了開機 RESET 之外,是不是有監看電壓瞬間掉落到某程度,然後會重新發出 RESET 信號。而這個監看電壓掉落的值是多少? 當你快速開機關機,有沒有低於這個監看電壓?7 a* W7 `; @7 S: b

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8#
 楼主| 发表于 2013-1-5 17:30 | 只看该作者
jacklee_47pn 发表于 2012-12-25 07:43 # |2 T' |6 E  u( T( A' J* H
"频繁的断电上电" =>不知道中間的間隔的時間夠不夠使 CPU 所有电压放到 0.7V 以下? 怕是速度太快,造成開機 ...

, C. c; d! ^/ j0 H5 W确认是放电未放完导致的,只要掉电与上电的时间很短,CPU就无法启动,稍微长点(2s左右)就没有问题了。
  g/ h* K$ e+ K现在在想做一个加速放电电路,没什么思路,有经验的还请指导下。

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发表于 2013-1-6 11:31 | 只看该作者
jacklee_47pn 发表于 2012-12-25 07:43
6 Q- V0 O3 z( Y- M, {  L; ~"频繁的断电上电" =>不知道中間的間隔的時間夠不夠使 CPU 所有电压放到 0.7V 以下? 怕是速度太快,造成開機 ...

3 M: X, t* w* F$ l" E+ ]5 R# |- _又学习了。。

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10#
发表于 2013-1-6 12:24 | 只看该作者
问题解决了没,要不你把延时再加大

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11#
发表于 2013-2-18 13:09 | 只看该作者
保险起见,电容搞小一些吧

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12#
发表于 2013-2-19 16:19 | 只看该作者
在电容上并个二极管试试。
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