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之前做过ddr2的等长,由于对pads软件使用不是很通透,遂转到a软件调等长。
6 I E% q+ ]3 p& g1 v方法如下:( F$ X& m- b, ?8 r
1:pads导出asii,版本选3.0 o- f4 O6 J$ q
2:allegro用15.5导入,之后就是按要求调完等长。
W, M7 V5 H: Q% O1 N; C b6 `, ?' O3:用AD导入brd文件然后导出asii
2 f2 m) \7 \7 B! q4:新建pads文件导入asii,输出调整好的器件和等长线模块) z3 d0 D; j/ p! n
5:打开正在设计的pads文件进入ECO模式,删除要导入的器件和走线模块(对应第4步导出部分),还是在ECO模式下add reuse第4步的导出模块
- [. f, V" {. s( p6:以上5步做完再导下网表同步一下设计( a+ {7 X a) G
以上是自己转换的操作,由高手指点如上操作哪些还有待优化或者更简单的办法。相互交流彼此进步。( G$ w" m; `/ c
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