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等长时要不要考虑过孔长度

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  • TA的每日心情

    2019-11-20 15:36
  • 签到天数: 1 天

    [LV.1]初来乍到

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    1#
     楼主| 发表于 2025-3-12 20:30 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    请教一下
    ! ~9 h1 e& Y2 j* n5 c& d做等长时,要不要计算过孔的长度呢

    点评

    要, 但 allegro 給你選擇 叫 "ViaZ".  发表于 2025-3-12 21:00
  • TA的每日心情
    奋斗
    2025-3-20 15:46
  • 签到天数: 233 天

    [LV.7]常住居民III

    推荐
    发表于 2025-3-13 10:11 | 只看该作者
    flywinder 发表于 2025-3-13 08:50' x- z+ l/ e2 O/ p# U/ U
    @aarom  那岂不是先要把层叠各层厚度设置好
      L$ O" h: w+ k
    需要的,根据板厚,铜厚,层数,介质厚度设置好参数,这样via Z计算的长度更准确,
    ' Z4 _5 f9 E6 v: A但模拟计算和实际生产参数会有不同,但不会差太多。一般要考虑via Z/pin delay的信号类型基本都需要同组同层,或者尽量布线在相邻的几个布线层内,这样VIA Z相差不也就不会太大。

    点评

    当然不是所有信号类型等长时都要考虑VIA Z,时序误差要求不严格的也可不考虑,具体看信号类型以及要求吧。  详情 回复 发表于 2025-3-13 10:19
  • TA的每日心情

    2019-11-20 15:36
  • 签到天数: 1 天

    [LV.1]初来乍到

    3#
     楼主| 发表于 2025-3-13 08:50 | 只看该作者
    @aarom  那岂不是先要把层叠各层厚度设置好
    / t  x' J/ `( V

    点评

    需要的,根据板厚,铜厚,层数,介质厚度设置好参数,这样via Z计算的长度更准确, 但模拟计算和实际生产参数会有不同,但不会差太多。一般要考虑via Z/pin delay的信号类型基本都需要同组同层,或者尽量布线在相邻  详情 回复 发表于 2025-3-13 10:11
  • TA的每日心情
    奋斗
    2025-3-20 15:46
  • 签到天数: 233 天

    [LV.7]常住居民III

    4#
    发表于 2025-3-13 10:19 | 只看该作者
    EDA520 发表于 2025-3-13 10:11
    % r- G7 B! z! A% D2 Z2 h需要的,根据板厚,铜厚,层数,介质厚度设置好参数,这样via Z计算的长度更准确,
    6 ]9 K  w2 h6 ^3 J: s但模拟计算和实际生 ...

    3 S9 Y' W( ~0 v当然不是所有信号类型等长时都要考虑VIA Z,时序误差要求不严格的也可不考虑,具体看信号类型以及要求吧。/ j, K3 ]+ l+ R3 y; \$ a# O
  • TA的每日心情
    开心
    2025-7-3 15:21
  • 签到天数: 171 天

    [LV.7]常住居民III

    5#
    发表于 2025-3-13 15:23 | 只看该作者
    等长要求严格时需要,因为via的长度也会产生时延,根据板材可算信号速度,根据叠层可算via长度,长度/速度=时延
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