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: q# g& r: i% P1 N! Z; e/ a
! C/ g. R3 J/ g% G1 P( L了解 DDR 的各个信号功能与网络名。- l5 n- y$ f/ A
与 DDR 相比,DDR2/3 最大差别多了功能 OTD 与 OCD。
9 d0 v" p! e2 g* l# R; f( r重要信号线
; V. p$ ^. P3 @; o1.DQS 信号:
3 t, I% X2 j) PDQS 是 DDR SDRAM 中的重要功能,它的功能主要用来在一个时钟周期内准2 K. B' L+ B4 r: W8 ~8 y
确的区分出每个传输周期,并便于接收方准确接收数据。每一颗芯片都有一个- B n' U3 Q( u9 N S4 z" U2 s3 t. ~1 G
DQS 信号线,它是双向的,在写入时它用来传送由北桥发来的 DQS 信号,读
6 J0 i! m4 d6 H" C5 q) b取时,则由芯片生成 DQS 向北桥发送。完全可以说,它就是数据的同步信号
: x/ [8 Z1 O" ^/ s3 h" [9 o; n; u4 }2.CLK 信号:
" g3 [" @# l! J( ^DDR SDRAM 对时钟的精确性有着很高的要求,而 DDR SDRAM 有两个时5 Y( o+ b& q1 l# L
钟,一个是外部的总线时钟,一个是内部的工作时钟,在理论上 DDR SDRAM 3 L8 c+ Y& X5 Q$ [
这两个时钟应该是同步的。7 U# ` P' q8 m
二.分组设定+ l# a( h2 S% Q! y2 X
数据组的分组应该以每个字节通道来划分,DM0、DQS0 以及 DQ0~DQ7 为第* L C V+ N! \9 l
1 字节通道,DM1、DQS1 以及 DQ8~DQ15 为第 2 字节通道,以此类推。每个: q6 _4 g; j% m2 a* k) _) g
字节通道内有严格的长度匹配关系。其他信号走线长度应按照组为单位来进行
w$ m. {0 }3 ~$ y- ~( n' J: g+ E匹配,每组内信号长度差应该严格控制在一定范围内。不同组的信号间虽然不- O* y1 i" h8 G
像组内信号那样要求严格,但不同组长度差同样也有一定要求;数据信号组的0 k' _: K. T# E
布线优先级是所有信号组中最高的,因为它工作在 2 倍时钟频率下,它的信号( L+ m4 f- h' d8 s! z& J. t
完整性要求是最高的。另外,数据信号组是所有这些信号组中占最大部分内存
3 N5 T; p5 A; V, x. ^$ |总线位宽的部分,也是最主要的走线长度匹配有要求的信号组。8 D; D% G5 b6 j7 W+ O
& b1 Q2 R& N4 ]! _% J6 }0 J7 ~
DDR3.pdf
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$ c2 @+ Q V& c: n4 {1 p" l" ~3 Q
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