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[Ansys仿真] 封装电路板Q3D参数提取电容过大怎么办

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 楼主| 发表于 2024-8-3 15:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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两根走线都是4000um左右,线宽线距都是30um。. u4 J+ r- m; R
一个是直线,两边都是包地,旁边还额外打了2个对地孔, 第二层跨了5个电源和地平面。
/ x/ Q3 y( m$ }一个是弧线,两边也是包地,旁边没有对地孔,  第二层跨了3个电源和地平面。
7 P7 b& e# j+ s' o9 P  E0 ]  E- {6 K, r  \3 n: L7 N- d

, m0 K2 ]; w. U8 l1 @4 T为什么仿真出来直线的电容 0.8(自容)大于弧线 0.6 (单位好像是pF)?  怎么减小电容?
8 @- f2 L% u7 ^- S6 Y, s: R- @9 @* Z  Y9 p8 K
  K: y  H. a2 E' T

该用户从未签到

2#
发表于 2024-8-6 10:54 | 只看该作者
通过综合考虑布局、材料、屏蔽技术和仿真优化,可以解决封装电路板Q3D参数提取中电容过大的问题
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