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[Ansys仿真] 封装电路板Q3D参数提取电容过大怎么办

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 楼主| 发表于 2024-8-3 15:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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两根走线都是4000um左右,线宽线距都是30um。4 L) u+ ~7 J0 ?3 c/ y- B
一个是直线,两边都是包地,旁边还额外打了2个对地孔, 第二层跨了5个电源和地平面。) U. Q9 E9 p' m
一个是弧线,两边也是包地,旁边没有对地孔,  第二层跨了3个电源和地平面。, _, i) K" g, o2 p" ?5 ~5 @3 T
6 E* E1 g4 U; e+ b! s  q7 ?! ?
) }( K! J$ ]' a/ T) d. H  f
为什么仿真出来直线的电容 0.8(自容)大于弧线 0.6 (单位好像是pF)?  怎么减小电容?
9 n  [) m9 t: m! y$ }" n) p0 [2 R$ T* p
$ N$ ]/ M  o! j7 m% \% w2 B, C
+ K2 w# z5 g/ y, k! a9 Y3 d: t0 V

该用户从未签到

2#
发表于 2024-8-6 10:54 | 只看该作者
通过综合考虑布局、材料、屏蔽技术和仿真优化,可以解决封装电路板Q3D参数提取中电容过大的问题
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