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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › sigrity仿真提示 no valid pin mapping
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[Cadence Sigrity] sigrity仿真提示 no valid pin mapping

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soyabean

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1#
 楼主| 发表于 2024-7-18 16:29 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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使用sigrity的speed仿真，导入BRD文件(能直接打开BRD文件)，使能网络后，给主芯片制定IBIS模型后，发现不能映射引脚，请问怎么处理？其他的例如FLASH等都可以分配模型。我注意到在分配IBIS模型时，能成功分配的模型是能识别layoutpinname的，不知道为什么主芯片没有。( j! M) |  f1 C, z+ y/ t
主芯片的IBIS模型是官方网站下载的。
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tyantson

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2#
发表于 2024-7-18 16:45 | 只看该作者
检查IBIS文件的PIN MAPPING 部分，看看是否正确？

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soyabean
感谢你的回复。我看看！  详情 回复 发表于 2024-7-18 20:52

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soyabean

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3#
 楼主| 发表于 2024-7-18 20:52 | 只看该作者
tyantson 发表于 2024-7-18 16:45
) |# }+ Q6 C# A2 ~4 B0 J, y检查IBIS文件的PIN MAPPING 部分，看看是否正确？
* ~# t0 p: b3 ]5 a
感谢你的回复。我看看！# D. O' O' A1 R% w8 X2 U6 B& G8 h

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cailiu
  • TA的每日心情
    开心
    2025-9-25 15:29

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    [LV.6]常住居民II
    4#
    发表于 2024-7-19 09:08 | 只看该作者
    使用sigrity的speed仿真，导入BRD文件(能直接打开BRD文件)，使能网络后，给主芯片制定IBIS模型后，发现不能映射引脚，请问怎么处理？其他的例如FLASH等都可以分配模型。我注意到在分配IBIS模型时，能成功分配的模型是能识别layoutpinname的，不知道为什么主芯片没有。

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    canghaimurong

    该用户从未签到
    5#
    发表于 2024-9-14 12:02 | 只看该作者
    模型里没有，需要手动把需要仿真的网络 添加上power&GND

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