TA的每日心情 | 无聊 2024-3-31 15:52 |
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签到天数: 12 天 [LV.3]偶尔看看II
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: L7 D' c! F! c5 O8 p) z前言; w+ J, b6 h5 V. _; V0 J
当capture完成原理图绘制,生成网络表并导入allegro PCB 文件时,出现封装存在但是无法放置元器件的情况,并出现如下提示:
# O$ E' k6 W5 C0 ` c' E) F3 `
E- Cannot load symbol 'HDMI-19CKT'
& L/ }& s# f7 l/ I. e8 T$ b8 `1 ~* u. ~8 c( r6 p* J
E- because WARNING(SPMHUT-127): Could not find padstack SMD_12X104_RECT.- n# s) m6 m" @9 ^* c( l }
" m2 ~$ V8 I8 DCommand框提示:因为找不到焊盘文件,没法加载元件符号。
- p; t1 X# v! m, M; J5 S N% E3 i( [4 q; n( j+ g* L4 j
出现此类原因主要有两种。
$ I3 p J! w9 c. Z2 n [
" t( G* \* U; t& ?4 L8 w% P7 QAllegro中设置的路径中无法找到焊盘文件
: N4 Y7 p# @! {9 {5 X1 s) Q- }解决方法:在padstack文件拷贝到对应路径的文件夹中来,或者在设置中加入该焊盘所在的路径。
# l9 [6 C+ D! Q3 O9 O
$ F- u& U5 y rSetup->user preference editor->path->library-padpath; e& W, k( @( x
4 ?/ n D! @4 q! x' j3 |) @ P
* }( W" |+ o; E2 C
# {+ c5 g# F+ B- p# k$ M2 W
缺少焊盘文件
6 g/ V9 I3 R+ C; S7 l" p) h) F由于使用了在线的cadence cis系统(关于共享元器件信息系统cis,可查看我前期的内容,免费提供用户测试账号登录使用。),在原理图设计进行元器件选取时能已预览到元器件符号和封装,如图所示,所有封装文件是存在的。因此我们需要从封装文件库中提取pad文件。- }9 i$ j) v: J$ i/ e: k1 L. A
" n) Q+ Y: Y+ [- u. h
6 ?* w; r& x2 x7 e$ e
) u6 m% {! s: w, J解决方法
3 h7 d, _9 `2 @) e. O对于不同的封装,我一般采用如下三种方法。$ R9 n/ H: c4 s1 G8 W
/ k, V% U/ o i& [% j: m规则焊盘
$ i& D+ _2 T2 [0 A0 w5 J3 f u规则焊盘包括circle圆形,square方形,oblong椭圆形,rectangle矩形,octagon八边形五种焊盘。对于这种规则的焊盘,可采用如下方式生成pad文件。
$ x- }, U4 _( M0 K1 a
: g; w1 z6 x. A0 h9 ?, C) K用PCB editor或者package editor打开元器件封装dra文件,tools-padstack-modify design padstack,选中焊盘文件 edit 在pad design中打开,重新保存相同名字的焊盘文件至设置的焊盘路径即可。, ~7 L( y( I5 m( C4 Z
1 X- _4 f3 A8 k' w: Y. R) ]/ ^7 Z
不规则焊盘
) F. W6 e2 R( H用PCB editor打开元器件封装dra文件,file-export library,设置好路径后,点击export,将会导出对应焊盘文件、shape文件,然后将导出的文件分别拷贝到allegro路径下设置的文件夹。其中pad文件为焊盘文件,ssm和dra文件为shape文件,需放置到psmpath对应路径的文件夹中。) B/ G/ U% F% {1 h4 Q
& j; C' c; N# X8 ~* M
/ V1 R( u( d& V) u2 d1 o8 ~/ G8 @ b. P- B: B8 V( U1 r
多个封装焊盘缺失
' a f2 U+ `& Q! ^* y关于多个封装库中均存在焊盘缺失的情况,我们可以采用批处理脚本结合生成脚本的方式来完成。这部分内容我将在下一章节进行展示。关注我,硬件石头哥,欲知后事如何,请听下回分解。
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