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[Cadence Sigrity] Sigrity组件中SPEED2000仿真DDR3报错

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 楼主| 发表于 2023-12-20 21:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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求助用Sigrity中的SPEED2000仿真DDR3报错如下错误" @, A! C  M% s( P0 ]
Error 4040: X_pin defined in circuit SpeedXP_auto_XC7K325TFFG900_FFG900_(S1+S2+S3+S4+S5+S6+S7+S8+S9+S10+S11+S12+S13+S14+S15+S16+S17+S18+S19+S20+S21+S22+S23)_XC7K325TFFG900_XC7K325TFFG900_KINTEX7 has 3 nodes, subckt PinModel_U21_U21 has 9 nodes.
' o3 L/ x' [  d( \5 RSimulation failed.6 q+ g+ T' m, M( y/ x. f  J; z- x
2 C6 b1 E" g' i6 n' _4 ]
想请教一下这是什么原因,应该从哪些地方排查
2 f9 c; f, v+ u7 k& d3 {; [3 P, S8 c
, e5 ]% V8 l0 O5 A

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2#
发表于 2023-12-21 10:00 | 只看该作者
可以分享一下你的K7模型吗,邮箱xinbadawork@163.com

点评

不知道是不是我的模型不对导致这个地方报错  详情 回复 发表于 2023-12-21 10:09

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3#
发表于 2023-12-21 10:01 | 只看该作者
感觉是net没匹配起来

点评

是我选择的net吗?我为了验证只选择了三条net  详情 回复 发表于 2023-12-21 10:11

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4#
 楼主| 发表于 2023-12-21 10:09 | 只看该作者
狂羁青马 发表于 2023-12-21 10:00
5 T3 }# Q/ ^% V: b; _* u. E可以分享一下你的K7模型吗,邮箱

7 g+ [5 K) Y* k2 D不知道是不是我的模型不对导致这个地方报错

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5#
 楼主| 发表于 2023-12-21 10:11 | 只看该作者
狂羁青马 发表于 2023-12-21 10:01# N( Y& t7 I* T- t# T5 B
感觉是net没匹配起来

$ s9 Q& w! r) F4 ^/ v# Y是我选择的net吗?我为了验证只选择了三条net7 X$ e/ }7 |# |' q; F

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6#
发表于 2024-4-9 16:32 | 只看该作者
哈哈哈哈,Mark一下
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