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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › 提取S参数时，Port 设置失败
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[Cadence Sigrity] 提取S参数时，Port 设置失败

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maimengyongcun

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1#
 楼主| 发表于 2023-11-3 18:37 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 maimengyongcun 于 2023-11-3 18:40 编辑 . F4 S1 }$ `7 n8 w4 z, B6 O* u
( h7 }# y9 @5 {8 p( B
使用Sigrity PI 在提取共模电感到IC的传输线的s参数时，走到生成端口这一步时，发现共模电感的四个端口，无法自动生成port，报错如图
! l5 u) g* M6 S5 Q
% u, j9 l% R2 ^% k手动设置后，也因为没有Negative Terminal 无法 enable Ports
. V" U0 `6 Z( @9 ?
4 M% o5 n& O6 S% \5 D. ?$ r求教如何解决这个问题; I! c4 `  y9 b( @7 p3 P& A

9 o8 W; `% ?$ @3 @8 @. A

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maimengyongcun

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2#
 楼主| 发表于 2023-11-3 18:38 | 只看该作者
本帖最后由 maimengyongcun 于 2023-11-3 18:40 编辑 - {5 o8 y9 }! |" g8 i! Z& j
4 ^4 P1 z% C* Z. l7 X7 P( I4 M
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bingshuihuo

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3#
发表于 2023-11-3 18:40 | 只看该作者
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maimengyongcun
请问具体怎么操作呀，尝试在PIN Based界面上操作但是还是添加不上  详情 回复 发表于 2023-11-3 18:42

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maimengyongcun

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4#
 楼主| 发表于 2023-11-3 18:42 | 只看该作者
bingshuihuo 发表于 2023-11-3 18:401 g# A( U+ Q& |5 N" ^: V
要加一个参考ref

6 {; E4 T. M$ l请问具体怎么操作呀，尝试在PIN Based界面上操作但是还是添加不上
  Z9 v% r2 \' v% R, l7 \+ @

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hhh虎次郎

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5#
发表于 2023-11-4 11:08 | 只看该作者
你这创建port没有参考啊，没勾选GND网络吧

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30_hao
  • TA的每日心情
    无聊
    2023-11-6 15:17

    • 签到天数: 7 天

    [LV.3]偶尔看看II
    6#
    发表于 2023-11-6 15:14 | 只看该作者
    拆差分-> 合并线->做差分->赋器件模型->生成port

    点评

    Jenny_mia
    请问这个操作在哪个环境下操作设置呢，谢谢  详情 回复 发表于 2023-11-15 14:22

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    Jenny_mia
  • TA的每日心情
    开心
    2025-9-29 15:44

    • 签到天数: 1 天

    [LV.1]初来乍到
    7#
    发表于 2023-11-15 14:22 | 只看该作者
    30_hao 发表于 2023-11-6 15:14
    # P( X5 p+ N+ `: \& _4 E拆差分-> 合并线->做差分->赋器件模型->生成port
    . S& |% E* x7 ]
    请问这个操作在哪个环境下操作设置呢，谢谢
    7 E$ P7 p  F* [: B$ X

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