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楼主: jimmy
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★★★ 大家一起评审PCB ★★★

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该用户从未签到

151#
发表于 2013-7-14 18:28 | 只看该作者
提示: 作者被禁止或删除 内容自动屏蔽
  • TA的每日心情

    2019-11-20 15:11
  • 签到天数: 1 天

    [LV.1]初来乍到

    152#
    发表于 2013-7-22 15:07 | 只看该作者
    本帖最后由 jimmy 于 2013-8-1 11:12 编辑
    * r1 j6 r9 K6 f$ R" P: _
    ( M! o8 P, _5 G) P* K0 c你好,JIMMY大哥,这版是我走的第一块6层DDR3全部,请帮我评审一下吧。PS:您有空的时候。出于公司机密问题,密码我会发送到您的站内信。谢谢您了!由于机密问题,无法共享给大家,请谅解。

    该用户从未签到

    153#
    发表于 2013-7-29 18:15 | 只看该作者
    flywinder 发表于 2012-12-13 11:19
    7 G6 `$ n, g+ ]% `jimmy,请教下,76楼的板子,走线下图哪种比较好呢

    . G+ d; n( @$ K+ F6 K4 z+ R' ?我也认为第二种会更好,但是不知道为什么,请版主讲解下。谢谢!
    头像被屏蔽

    该用户从未签到

    154#
    发表于 2013-7-30 14:03 | 只看该作者
    提示: 作者被禁止或删除 内容自动屏蔽

    该用户从未签到

    155#
    发表于 2013-8-9 23:40 | 只看该作者
    这里反映了自己好多问题,,,努力改正~~!
    : H* c$ t4 M+ [# M1 ]5 {1 H& ?

    该用户从未签到

    156#
    发表于 2013-8-10 13:40 | 只看该作者
    JIMMY您好,有空时请帮忙评审下此板,由于公司保密问题,不能共享给出来,密码发送到您的站内信。多谢!

    PCB.rar

    583.18 KB, 阅读权限: 60, 下载次数: 2, 下载积分: 威望 -5

    该用户从未签到

    157#
    发表于 2013-8-30 10:09 | 只看该作者
    您好,请帮忙评审一下PCB,这个四层板,分割了电源层,用的是plane Area分割的,为什么内电层还要覆铜,不然DRC就报错呢,附件是PCB和原理图
    ! n! N0 c6 k9 a3 j+ _谢谢!

    PCB和原理图.zip

    270.74 KB, 下载次数: 51, 下载积分: 威望 -5

    点评

    板上有18个开路。不符合本贴的评审规则。此文件不作评审。  发表于 2013-10-29 09:20

    该用户从未签到

    159#
    发表于 2013-8-30 10:11 | 只看该作者
    您好,请帮忙评审PCB

    PCB和原理图.zip

    270.74 KB, 下载次数: 39, 下载积分: 威望 -5

    该用户从未签到

    160#
    发表于 2013-8-30 10:13 | 只看该作者
    请帮忙评审

    PCB和原理图.zip

    270.74 KB, 下载次数: 39, 下载积分: 威望 -5

    该用户从未签到

    161#
    发表于 2013-8-30 10:16 | 只看该作者
    非常抱歉,我这个发了好几次都发不上去,我用plane Area分割的内电层,我这个在层叠设置的时候选择的是内电层,但是为什么还得灌铜呢,不然DRC就会检查出未连接,请指教,谢谢
  • TA的每日心情
    无聊
    2024-6-29 15:49
  • 签到天数: 5 天

    [LV.2]偶尔看看I

    162#
    发表于 2013-9-2 11:44 | 只看该作者
    有个建议,以后的PCB可不可以导出低版本的ASC文档,像我们这些还用07版的看不了啊

    该用户从未签到

    163#
    发表于 2013-9-6 14:06 | 只看该作者
    导出低版本的ASC文档,支持,这样方便交流!!

    该用户从未签到

    164#
    发表于 2013-9-11 15:25 | 只看该作者
    jimmy 发表于 2013-6-22 13:247 ?. o# j. T% x. D
    BOST 电源板评审意见:

    6 _5 ?/ e( i; O6 q! |1 }字字珠玑
  • TA的每日心情

    2019-11-19 16:12
  • 签到天数: 1 天

    [LV.1]初来乍到

    165#
    发表于 2013-10-12 15:22 | 只看该作者
    附件中的PCB文件是在论坛上下载一位楼主的4颗DDR2的文件,由于之前只整过1颗DDR2的,所以对4颗的比较感兴趣,就自己给所以的设置删除,重新布局、拉线的。附件中文件是9.3版本,asc文件时2007版本。(还望高人多多指点)
    8 S' `$ [6 W; t5 w如图中所示,我将ABCD4颗DDR2的高低数据线分成了以下几个group:, Z0 p: Y$ N  v- l% f7 T
    A:Group1长度控制在710--760mil;. }" A$ a% G" b3 n
         Group2长度控制在980--1030mil;
    + }& s; V. u: j. r% f7 dB:Group3长度控制在960--1100mil(此处设置有误,应该是1010mil,长度未改);
    , X; U# w0 w/ O- a' ~) ^5 h5 }     Group4长度控制在750--800mil;: D  D& s5 p  p- h. K2 c
    C:Group5长度控制在560--610mil;- P: r8 M  p$ W  m
         Group6长度控制在830--880mil;
    ) }2 g8 S1 p' x2 G- Y1 B/ ^D:Group7长度控制在750--800mil;! e" n$ @/ j$ M" H8 t3 N
         Group8长度控制在740--790mil;. y3 Q& U  f9 d6 c- Q
    地址、控制线走的是T点结构,长度暂时还不清楚怎么控制,需要控制在多少范围内?

    2B.JPG (157.61 KB, 下载次数: 7)

    2B.JPG

    DDR2_4.rar

    270.25 KB, 下载次数: 61, 下载积分: 威望 -5

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