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本帖最后由 fa888 于 2023-9-25 09:00 编辑
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•为了避免高速信号线出现信号完整性问题， & _' k+ X4 O1 k# g4 |
•PCB走线时要避免走线跨在planevoid上， $ h' @, z! m: [) X8 r9 v- k
•可执行allegro菜单-》Display-》Segmentsover Voids 命令，
9 M" U. Z3 f( ^•当走线跨过内层之antipads,split plane gaps ' E; ^# }: Q/ v7 Z) V" D2 t
•或手动挖空Void区域时，则会Highlight高亮显示. , P4 Y, m; Y% ?4 {" ^! j, L% r/ G
•并产生其相关的报表。
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发表于 2023-9-21 15:08