找回密码
 注册
关于网站域名变更的通知
查看: 853|回复: 4
打印 上一主题 下一主题

[ADS仿真] 去耦半径:die-pack-pcb不同层级用什么量级电容来去耦

[复制链接]

该用户从未签到

跳转到指定楼层
1#
发表于 2023-6-8 17:05 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您登录!

您需要 登录 才可以下载或查看,没有帐号?注册

x
去耦半径:包含die-pack-pcb不同层级用什么量级电容来去耦,怎么选择,选择依据是啥?
* f) w  T9 V2 t% z& u$ h1 O" [' D

该用户从未签到

2#
发表于 2023-6-8 18:51 | 只看该作者
一、容量不同:' d8 l% D2 L$ o9 X
: A9 [2 Z: ~  }4 P0 ~
1、小电容容量小到可以达到几P。
6 G" `# _2 O) H0 b3 f( L- s* v
) o" n+ U5 T' a2 C8 i3 S; B2、大电容容量大到可以达到1万μf。- z& A! `; L( |$ P, q! h6 W. ~
. s4 T+ O( F8 d9 W$ d) q
二、用途不同:
, h& z; v. R- ~. T/ s
2 z3 Y) g: [' i. j$ }( Z1、大容量的电容可以做电源滤波电容。
9 k6 o+ j% o# @& s* L8 ?( s/ B: i: @7 T6 c9 s& e
2、小容量的电容可以做高频谐振电容。9 e( F* s" Y& T" n

2 a" u5 w' w( ^; o7 a
" M) w7 u8 B. D. ~5 ^% X) [$ C
  • TA的每日心情
    慵懒
    2022-12-12 15:57
  • 签到天数: 6 天

    [LV.2]偶尔看看I

    3#
    发表于 2023-6-9 14:28 | 只看该作者
    die的就不用选了芯片晶体管设计的事,基板和PCB上的可以通过仿真优化电容参数得出符合要求的曲线。

    该用户从未签到

    4#
    发表于 2023-6-9 15:30 | 只看该作者
    die上是门电路的栅极电容,这个和芯片的面积有关系,pf-nf级别;pkg不增加poser的情况下,封装本身的寄生电容很小,设计封装的要点是减小L,根据增加poser的尺寸,封装电容可以到uf;pcb上就是体电容,中频电容等,从几百uf到pf不等,主要选择的依据是芯片要求的纹波,一切都是为了die,满足die的纹波要求
    您需要登录后才可以回帖 登录 | 注册

    本版积分规则

    关闭

    推荐内容上一条 /1 下一条

    EDA365公众号

    关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

    GMT+8, 2025-8-31 03:37 , Processed in 0.109375 second(s), 23 queries , Gzip On.

    深圳市墨知创新科技有限公司

    地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

    快速回复 返回顶部 返回列表