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寻求电路板层叠结构,阻抗计算,参数指标的行家帮助

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1#
发表于 2012-4-6 12:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
本帖最后由 zengeronline 于 2012-4-9 21:51 编辑
: t$ o3 H& U+ t) n8 ?" m2 l  g, k$ Q5 g+ B
大家好,我需要设计一个板厚为1.6mm,层叠结构为top-ground-signal-signal-power-bottom的六层板.
% Y+ m: {) U4 p) w0 `我用allegro以经把线都差不多链完了,只剩一些需要绕等长的地方的一些器件地没链.
, l$ W) ~# b' y现在需要先做阻抗设计/ O& Y) q3 t. \/ {6 w( s) j
单端50ohm,差分100ohm
1 q# J4 N( b* M9 n+ G% Q在做的时候参考了本论坛的贴子,但是还是有一些疑问,希望得到行家的帮组4 p$ a; w- m* h0 D. V, f
因为疑问比较零碎,不好在论坛上提,所以希望热心的朋友加我的qq,15831****,谢谢! m. s1 ^2 q) D8 }0 j, ]

4 o8 i/ x3 }9 E6 R2 ]- G2 x4 w
' ^# o$ q. \& ^/ f比如有个疑问就是( F- N5 u% J5 v- h
下面的这个层叠制版厂能否制作,有什么样的问题,和一般的六层板层叠结构制作收费上有什么差异
& `% X- B7 l  V  l' m* j* H$ Z- @8 R4 V( W0 l1 |6 m! @8 u

/ u3 r/ y% n8 s' Y4 M9 }7 csilkscreen top      : ()[]3 c/ M9 u! N" W8 B" |
soldermask top      : ()[]
8 o& Y+ D0 \1 N. _3 G; zpaskmask top        : ()[]* F! L/ G; x; Z' r" k+ @. w

& r% s( u) P; N/ Gtop                 : 0.6   
% @& z# N6 i. ?1 k5 i7 u( R: x-- core             : 4     (0.10MM H/HOZ)[]
; q1 a3 I# P3 W2 h/ Qground              : 0.6   
9 L/ A: ]2 |' j  O9 C# Z3 q; \# M-- prepreg          : 6     ()[2116+106]
) v( }- k5 h% z, I$ |7 X* o* g3 ]signal3             : 1.2   % [: _8 t; M7 L
-- core             : 32.63 (0.9MM 1/1OZ)[]% ]6 T$ _  F; V% U
signal4             : 1.2   
: E/ N) o6 V- v) e6 j, i-- prepreg          : 6     ()[2116+106]
2 F: i+ w% W$ Y# j3 W3 V* opower               : 0.6   
7 `* ~( Z. Q* s7 Y2 L-- core             : 4     (0.10MM H/HOZ)[]
) e) _; x  x1 }bottom              : 0.6   
% n+ N. _& }4 j$ b
  @, ?0 ]/ R) ~% V$ C. kpastmask bottom     : ()[]+ w: r& `) u4 A# e, ^, h$ Q
soldermask bottom   : ()[]1 M; w/ M) a  k7 ^6 f
silkscreen bottom   : ()[]+ [, W; L, D1 j5 a- }7 |

7 V( o: f% A& ~3 r& dtotal               : 62(57.43)4 v: I/ D+ ]0 u  x. u. B
4 C. V) `/ z- D* U
  P/ k% y7 R, u. r; Y  t3 Z
ps:201204009,抹掉qq
1 M: ^2 g1 _2 a2 F) G' h" a' i0 t& l8 U  W

9 g3 w" P& a3 L

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2#
发表于 2012-4-6 13:07 | 只看该作者
:Q:Q:Q

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3#
发表于 2012-4-6 13:22 | 只看该作者
楼主,你的这个叠层好像不太对,一般是两块芯板加pp,你这个需要3个core加pp。0 q5 d* ?, A1 h6 R

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4#
发表于 2012-4-6 13:27 | 只看该作者
这种结构通常被厂家称为"假8层",按照8层板收费.3-4层之间往往需要增加一个core

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5#
发表于 2012-4-6 13:48 | 只看该作者
如果使用你自己这个层叠方式,就是所谓的“core层叠”加工法,应该是特殊工艺了。

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6#
 楼主| 发表于 2012-4-6 15:04 | 只看该作者
哈哈,我问到了 liuyian2011 大哥,他说我的这个结构没有问题,
3 M* }5 m$ \" n8 V0 Y. z% gcore# M- h) b- r" g, y
pp8 H, n7 s4 ?! l  o# V
core7 v- {* w6 S) x% `: f# C
pp
, r7 }6 L  M/ kcore
* c* ~  V" C/ Q0 ]9 Z叠起来成为 top-ground-signal-signal-power-bottom, }4 u8 @' i# p9 w4 K: W
我也是想到了上下的两个core板在叠板之前只刻蚀一面,叠好后再处理外层,不知道这样行不行就上来问了,也问了在制作上是否要另加钱, liuyian2011 说他们厂是一样的价格! i* T& ]" c1 P
两个core加外层的话在1.6mm的情况下阻抗不好搞,线太粗了,不然就弄成假8层

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7#
发表于 2012-4-6 20:48 | 只看该作者
plane layer 有点薄。

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8#
 楼主| 发表于 2012-4-9 13:39 | 只看该作者
chengang0103 发表于 2012-4-6 20:48 - W2 v9 I  j/ b- E6 E
plane layer 有点薄。
" U, c' W& P$ s" M( k; W. V7 g* E! y
) \) T2 Y/ m9 F* H) j( ?& o+ O
呵呵,我已经从新计算后修改为下面的层叠关系了) P- e) L  {2 m$ u, E8 ^3 _

2 P& @7 }1 ]# H+ S2 y! B8 |9 G1 e. ~0 u: J9 f" [

' `+ i) J* G" H. x( m- |7 Q/ O3 u; X: G1 D6 b+ @9 `/ `
silkscreen top      : ()[]
* C. F: \- a  ]/ M  F: _0 r5 Asoldermask top      : ()[]
5 C* Q+ m; D- Xpaskmask top        : ()[]
  W9 \; I) {, w; @' m. P* E2 p3 Q3 M% w- T$ c7 _! }
top                 : 1.7   
" t2 G; g0 p3 Y; E-- core             : 4     (0.10MM 1/1OZ)
' J9 x6 Q, c# J) d. bground              : 1.2   6 M6 @; E! V% r9 ^& K8 L3 C4 s# {
-- prepreg          : 5     [1080*2]" O$ |# r" f  S0 }
signal3             : 1.2   
3 X5 |" Q: e% g0 F  Z-- core             : 32.63 (0.9MM 1/1OZ)
7 y9 ^0 i9 e3 ]$ R; }signal4             : 1.2     V9 f; T* _6 S. g  {! ~5 B
-- prepreg          : 5     [1080*2]1 H9 D$ m( I7 I
power               : 1.2   
! D; X$ p9 _6 a! Q6 ^% U- M-- core             : 4     (0.10MM 1/1OZ)# q8 I- y, _, n! T6 V" F! {
bottom              : 1.7   
. I9 W# |9 w8 E; D8 K% J! B% _
$ f$ Z# Q! C1 f$ Vpastmask bottom     : ()[]; e% P  {7 X& g8 |8 _9 Q
soldermask bottom   : ()[]
- v: |7 O" |/ T# i$ V' Bsilkscreen bottom   : ()[]
: a* ]7 p# }2 I# O: B
/ h( r) E6 K2 Y9 z1 @: Vtotal               : 63(58.83)
0 |6 b; _" R% Q! p% r* E6 J% \

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9#
发表于 2012-4-9 14:51 | 只看该作者

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10#
发表于 2012-4-9 18:50 | 只看该作者
top bottom镀铜,加锡后的在铜面只增加0.5mil,不知道这样控制有没有难度了。) B4 M; S9 N, R( i
! Q0 t9 k$ z% i2 [
如果板子有重要的信号,还是问下工厂你这样的处理行否,看看阻抗的变化范围。' O0 G5 l7 U$ s; G7 ^
) l) j$ \1 O& i8 [. P8 D

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11#
 楼主| 发表于 2012-4-9 21:35 | 只看该作者
chengang0103 发表于 2012-4-9 18:50
' q4 G5 V4 C& ?top bottom镀铜,加锡后的在铜面只增加0.5mil,不知道这样控制有没有难度了。
" i" N' O8 g/ J  ~
$ o1 x3 W- C- z3 `2 C- W! J如果板子有重要的信号,还 ...
9 `7 z% p) x3 ]/ ]; F! [
我上面写的那些参数都来自于网络,实际上也不清楚是否就是这样子的,8 |, X  Z' |" |, P; }; U
据你所知1oz的top层在所有的工艺都处理完后一般会有多厚啊,或者增加多厚?; h. n8 E, W8 {( i: m2 [, [4 ?
表层有一些重要的信号,底层没有什么线,大部分都走在3,4层,6 {, B9 O( w" a# _
我在算阻抗的时候,在polar里面表层是按照1.7mil的厚度来计算的

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12#
发表于 2012-4-10 13:20 | 只看该作者
内层铜厚为0.5OZ和1OZ,内层铜厚基铜也就是成品的铜厚,因为内层不存在电镀铜,而外层一般情况下如果基铜是0.5OZ,则成品铜厚就是1OZ,因为外层存在电镀铜厚.按此类推如果外层一般情况下基铜是1OZ,则成品铜厚就是1.5OZ,当然也可以加镀至2OZ. 基铜是指基材的铜厚,也被称为下料铜厚,而成品铜厚是指最终成品的铜厚.大家在计算阻抗时Polar软件里的铜厚均为成品铜厚.
& R0 Q- e/ h) M1 }1 x; @( R# n

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13#
 楼主| 发表于 2012-4-10 15:09 | 只看该作者
飘小北 发表于 2012-4-10 14:49 . m# U' }7 i2 i1 d& h
就是所谓的“core层叠”加工法,应该是特殊工艺了   感觉不错吧
0 Y8 F8 e7 L" g( I% O
{:soso_e127:} ,好恐怖的皮卡丘

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14#
 楼主| 发表于 2012-4-10 15:18 | 只看该作者
liuyian2011 发表于 2012-4-10 13:20
) T' `6 {# D( C1 c4 {内层铜厚为0.5OZ和1OZ,内层铜厚基铜也就是成品的铜厚,因为内层不存在电镀铜,而外层一般情况下如果基铜是0. ...
' J7 @  p: b  M. w
哈哈,很高兴见到你啊,之前向你打电话请教的时候已经告诉我了的,呵呵
6 o' ]1 S' A6 R4 f上面的朋友怀疑1oz的基铜(1.2mil)电镀后只增加 0.5mil(最后1.7mil) 这个问题,就回问了一下
# l8 _2 w$ w3 g! ]5 a* v3 `从你的回答来看是没有错的

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15#
发表于 2012-4-10 16:59 | 只看该作者
zengeronline 发表于 2012-4-10 15:18
$ J7 v- q+ p, {- L4 T哈哈,很高兴见到你啊,之前向你打电话请教的时候已经告诉我了的,呵呵) l$ V7 a& t9 Z: u: ]- d
上面的朋友怀疑1oz的基铜(1.2mil)电 ...
, J0 u& W8 c8 Y- w
要让大家都明白清楚那就好了啊.{:soso_e100:}
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