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DDR4 的CKE、CS、ODT为什么需要加上下拉电阻

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1#
发表于 2023-4-10 18:17 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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在做DDR4电路设计时,一般一个controller 带2片颗粒,Fly-by走线,都会省去VTT电路;+ @1 R" T6 U9 N# E5 L. Q
但是看到很多设计即使其他AC信号省掉了VTT,CKE、ODT、CS信号还是加了上下拉电阻,应该是做戴维南端接;
- A3 D4 L5 p! R) \/ m$ U  v% X* T) E' Y2 Y/ Y. n( }9 c  S$ z
请教一下,CKE、ODT、CS为什么要特殊处理?而其他AC信号可以不做处理?
0 a/ G' K) F$ v+ t8 p  z/ R8 ]

点评

仔细看下图纸。这三个信号接的不是VTT电源。  发表于 2023-4-12 14:44

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来自 2#
 楼主| 发表于 2023-6-26 08:55 | 只看该作者
DDR 地址信号有1T和2T模式,1T是1/2速率,2T是1/4速率,2T模式下不接VTT 眼宽也能满足,但是CS、ODT、CKE控制信号还是1T模式

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发表于 2023-4-11 13:48 | 只看该作者
DDR4的地址信号用的POD驱动模型吧,都是内部做了temination的(VTT),为啥还要外接?是不是为了调整终端电阻才接的,要看上拉电阻是多少ohm

点评

那是DATA信号吧 AC信号还是没有ODT,DDR5好像AC也有了  详情 回复 发表于 2023-4-11 17:42

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 楼主| 发表于 2023-4-11 17:42 | 只看该作者
嚼出西哈范 发表于 2023-4-11 13:487 o! }, v  R' u5 {  [. v; U
DDR4的地址信号用的POD驱动模型吧,都是内部做了temination的(VTT),为啥还要外接?是不是为了调整终端电 ...

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, K& D5 N$ h8 e1 Y' b

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 楼主| 发表于 2023-4-11 08:51 | 只看该作者
ad_gao 发表于 2023-4-10 18:463 z6 F7 k4 g" B+ G0 u+ J9 V  ~, c9 k; f
这个你直接参考DATASHEET,上面的电路和接法都是厂家提供的典型电路。
: F1 W- C( l1 g$ M6 j6 @
就这三个使能型的信号做端接,不是很奇怪吗?/ b4 w0 P  H3 _9 i- N9 `  `# c
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    2023-5-15 15:25
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    [LV.1]初来乍到

    6#
    发表于 2023-4-10 18:46 | 只看该作者
    这个你直接参考DATASHEET,上面的电路和接法都是厂家提供的典型电路。

    点评

    就这三个使能型的信号做端接,不是很奇怪吗?  详情 回复 发表于 2023-4-11 08:51
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    2024-4-29 15:07
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    [LV.9]以坛为家II

    7#
    发表于 2023-4-10 19:02 | 只看该作者
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    2024-4-29 15:07
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    [LV.9]以坛为家II

    8#
    发表于 2023-4-11 08:13 | 只看该作者
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    2023-4-13 15:06
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    [LV.1]初来乍到

    9#
    发表于 2023-4-11 09:24 | 只看该作者
    顶一个,学习
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    2023-3-22 15:02
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    [LV.1]初来乍到

    10#
    发表于 2023-4-11 10:48 | 只看该作者
    主要是參考公版線路吧
  • TA的每日心情
    开心
    2024-4-29 15:07
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    [LV.9]以坛为家II

    11#
    发表于 2023-4-12 08:01 | 只看该作者
    :hug::hug::hug::hug:

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    12#
    发表于 2023-4-12 12:03 | 只看该作者
    顶一下,学习学习
    ; R% U+ P6 o$ y) n, o
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