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MIPI trace上的bypass电容是否有要求?

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1#
发表于 2023-1-29 10:13 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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MIPI trace上的bypass电容是否有要求?
5 a0 B9 |- s* U- B. d* {! B8 c

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2#
发表于 2023-1-29 10:54 | 只看该作者
MIPI trace上的bypass cap最多47 pF。。。

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3#
发表于 2023-1-29 13:18 | 只看该作者
去耦电容和旁路电容都是起到抗干扰的作用,电容所处的位置不同,称呼就不一样了

该用户从未签到

4#
发表于 2023-2-8 18:10 | 只看该作者
这多半跟芯片厂商讨论   各家芯片要求不一
* D( ]& Y3 q. l+ A6 D7 |除了MIPI   许多控制讯号   像是PCIe
5 T+ A5 O' p* V6 p( Z其落地电容值都有规范
; T6 _* q4 s2 E" P因为值太大   会使上升/下降时间拉长
: N' a: y' R; l' N( A' [  M( P# E进而影响逻辑判断   导致控制出问题
% r2 y+ B/ K% k. x- g% Q" G* x  @; K2 T0 y0 M) @0 q9 r
所以有些厂商  对于走线长度也有规范   即便走内层
; m* o% K1 A7 l" O; m1 o5 ]$ N(走表层会有EMI辐射问题  肯定太长不允许)
0 f7 W  a$ r) ~; F' |原因在于走线太长   除了Loss大   整体寄生电容也大
6 L8 N- V, d! V) }( }8 @, N: [: i% n! k$ z
当然你说寄生电容这么关键的话   要不要联机宽都限制?5 C, D. O9 p" o0 h
基本上是没严苛到这样  $ q" F0 n0 h* H3 \5 W' A
况且有些控制讯号   像是PCIe   需要阻抗控制  90 Ohm5 k7 L  W" \7 Z" d! I& }# c. @
那线宽就不能乱调" i3 q. e. `5 t& c1 d* n
7 [7 V! F1 w) ]7 [

& V% @$ v# l$ y! \3 u
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