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cadence15.5,使用allegro绘制PCB时,敷铜完成,并且赋予了gnd网络,但是焊盘和和s...

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发表于 2022-11-9 13:29 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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cadence15.5,使用allegro绘制PCB时,敷铜完成,并且赋予了gnd网络,但是焊盘和和shape就是没有连接?! \. j) x8 d& x& ~( I2 c4 @9 q5 m

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2#
发表于 2022-11-9 13:37 | 只看该作者
Database Check一下试试,另外铺铜要覆盖要超过焊盘的原点才算连接上!

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3#
发表于 2022-11-9 13:56 | 只看该作者
shape不自动避开导线可能是你没有设置距离的值,在setup-constraints-set values里面设置shape和各元素的距离值。等这些都设置完毕了,焊盘会自动连接在shape上的( W. b: J9 [3 ?9 P: |3 c

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4#
发表于 2022-11-9 14:36 | 只看该作者
smooth一下看行不行。不行的话看叠层设置里该层先的是正片还是负片,负片不能铺铜& o# ^) ^% `' b# g) g2 ]
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