请问cadence HDL创建元件时引脚间隔多大比较合适？

chanfu · 发表于 2022-9-27 13:40

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画原理图时有器件的格点与原理图对不上，线很难连接（设置器件时引脚间隔比较小）；可如果设置引脚间隔格点比较多时，原理图占位过大，比较浪费空间，求问有没有合适的引脚间隔格点数

oewqe · 发表于 2022-9-27 14:27

这个都是根据设计自定的我一般会选间隔大一点方便连线

starskyuu · 发表于 2022-9-27 14:50

我是格点设置的100，直接放在格点上

choose521 · 发表于 2022-9-27 15:01

要设置大一点，就是铜皮间距shape to 设置为10mil

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